规则一：高速信号走线屏蔽规则 在高速的PCB设计中，时钟等关键的高速信号线，走线需要进行屏蔽处理，如果没有屏蔽或只屏蔽了部分，都会造成EMI的泄漏。建议屏蔽线，每1000mil，打孔接地。 图1 高速信号线 规则二：高速信号的走线闭环规则 由于PCB板的密度越来越高，很多PCB LAYOUT工程师在走线的过程中，很容易出现一种失误，即时钟信号等高速信号网络，在多层的PCB走线的时候产生了闭环的结果，这样的闭环结果将产生环形天线，增加EMI的辐射强度。 图2 闭环
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PCB 硬件工程师
尖峰电流的形成： 数字电路输出高电平时从电源拉出的电流Ioh和低电平输出时灌入的电流Iol的大小一般是不同的，即：Iol>Ioh。以下图的TTL与非门为例说明尖峰电流的形成：
图1 TTL与非门 输出电压如右图(a)所示，理论上电源电流的波形如右图(b)，而实际的电源电流保险如右图(c)。由图(c)可以看出在输出由低电平转换到高电平时电源电流有一个短暂而幅度很大的尖峰。尖峰电源电流的波形随所用器件的类型和输出端所接的电容负载而异。 产生尖峰电流的
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PCB 去耦电容
20世纪后半期，随着集成电路和计算机技术的发展，数字系统也得到了飞速发展，其实现方法经历了由分立元件、SSI、MSI到LSI、VLSI以及UVLSI的过程。同时为了提高系统的可靠性与通用性，微处理器和专用集成电路(ASIC)逐渐取代了通用集成硬件LSI电路，而在这两者之间，ASIC以其体积小、重量轻、功耗低、速度快、成本低、保密性好而脱颖而出。总的来说，ASIC的制作可粗略地分为掩膜式方法和现场可编程方法两大类。目前，业界大量可编程器件(PLD)，尤其是现场可编程逻辑器件(CPLD/FPGA)被大量地
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EDA PCB
Achronix今日宣布其已在上海开设新的办公室，以组建由工程与技术支持专业人员组成的本地团队。新办公室的这支团队将与Achronix在全球其他地点的团队密切合作，为大中华地区的客户提供支持。该办公室位于上海张江高科技园区长泰广场，所在区域为我国集成电路产业中心之一。 Achronix在2017年的营业收入将比上年增长700%，使其成为2017年成长最快的半导体公司之一;其快速增长的营业收入得益于客户对最高性能、低功耗、可编程的基于FPGA的硬件加速解决方案的强劲需求。这些需求来自于诸如软件定义网络
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Achronix FPGA
对大多数人来说，微芯片是一些长着小小的金属针，标着看似随机的字母或数字的字符串的黑盒子。但是对那些懂的人来说，有些芯片就像名人一样站在红毯上。有许多这样的集成电路直接或间接地为改变世界的产品赋能，从而得到荣耀，也有一些芯片对整个计算环境造成了长期的影响。也有一些，它们的雄心壮志失败后成为警世的故事。 为了纪念这些伟大的芯片，并讲述它们背后的人和故事，IEEE Spectrum 制作了这个“芯片名人堂”(Chip Hall of Fame)。登堂的是7
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FPGA NAND
引言 传统测量频率的方法主要有直接测量法、分频测量法、测周法等，这些方法往往只适用于测量一段频率，当被测信号的频率发生变化时，测量的精度就会下降。本文提出一种基于等精度原理的测量频率的方法，在整个频率测量过程中都能达到相同的测量精度，而与被测信号的频率变化无关。本文利用FPGA(现场可编程门阵列)的高速数据处理能力，实现对被测信号的测量计数;利用单片机的运算和控制能力，实现对频率、周期、脉冲宽度的计算及显示。 等精度测量原理等精度测量的一个最大特点是测量的实际门控时间不是一个固定值，而
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Verilog FPGA
在电子工程，资源勘探，仪器仪表等相关应用中，频率计是工程技术人员必不可少的测量工具。频率测量也是电子测量技术中最基本最常见的测量之一。不少物理量的测量，如转速、振动频率等的测量都涉及到或可以转化为频率的测量。目前，市场上有各种多功能、高精度、高频率的数字频率计，但价格不菲。为适应实际工作的需要，本文在简述频率测量的基本原理和方法的基础上，提供一种基于FPGA的数字频率计的设计和实现过程，本方案不但切实可行，而且具有成本低廉、小巧轻便、便于携带等特点。 1 数字频率测量原理和方法及本系统硬件
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FPGA 数字频率计
1 功能概述 流水广告灯主要应用于LED灯光控制。通过程序控制LED的亮和灭， 多个LED灯组成一个阵列，依次逐个点亮的时候像流水一样，所以叫流水灯。由于其形成美观大方的视觉效果，因此广泛应用于店铺招牌、广告、大型建筑夜间装饰、景观装饰等。 在FPGA电路设计中，尽管流水灯的设计属于比较简单的入门级应用，但是其运用到的方法，是FPGA设计中最核心和最常用部分之一，是FPGA设计必须牢固掌握的基础知识。从这一步开始，形成良好的设计习惯，写出整洁简洁的代码，对于FPGA设计师来说至
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Verilog FPGA
半个世纪以来，静电在电子行业引起的着火、爆炸等事故不胜枚举。仅美国电子行业每年因静电造成的损失就高达几百亿美元，因此，静电防护在减少损失、提升品质和消费效率方面具有重要的意义。
随着集成电路行业的迅速发展，体积小、集成度高的器件越发受市场欢迎，这种需求也导致导线间间距越来越小，内部氧化膜逐渐变薄，以至于制造过程中一些微小电压就可能击穿这些电子器件。而电子产品在生产、运输、储存和转运等一系列过程中所产生的静电电压却远远超过其耐压值，这就可能造成器件的击穿或失效，影响产品的可靠性。所以必须要重视静电
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静电 PCB
EMC问题 在布板的时候还应该注意EMC的抑制哦!!这很不好把握，分布电容随时存在!! 如何接地 PCB设计原本就要考虑很多的因素,不同的环境需要考虑不同的因素.另外,我不是PCB工程师,经验并不丰富 地的分割与汇接 接地是抑制电磁干扰、提高电子设备EMC性能的重要手段之一。正确的接地既能提高产品抑制电磁干扰的能力，又能减少产品对外的EMI发射。 接地的含义 电子设备的“地”通常有两种含义：一种是“大地”(安全地)，另一种是“系统基准地”(信号地)。接地就是指在系统与某个电位基准面之间建
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PCB EMC
在电路设计过程中，应用工程师往往会忽视印刷电路板(PCB)的布局。通常遇到的问题是，电路的原理图是正确的，但并不起作用，或仅以低性能运行。在本文中，我将向您介绍如何正确地布设运算放大器的电路板以确保其功能、性能和稳健性。 最近，我与一名实习生在利用增益为2V/V、负荷为10k?、电源电压为+/-15V的非反相配置OPA191运算放大器进行设计。图1所示为该设计的原理图。
图1：采用非反相配置的OPA191]OPA191原理图 我让实习生为该设计布设电路板，同时为他
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PCB
广东高云半导体科技股份有限公司(以下简称“高云半导体”)今日宣布：高云半导体小蜜蜂家族GW1N系列新增GW1N-9和GW1N-6两款非易失性FPGA芯片成员，并开始向客户提供工程样片及开发板。 作为小蜜蜂家族GW1N系列成员，GW1N-9和GW1N-6继承了GW1N系列的低功耗、高性能、多用户I/O、用户逻辑资源丰富，支持高速LVDS接口，支持可随机访问的用户闪存模块等特点;并在此基础上，结合新的市场趋势，创造性地集成了新的功能，使之成为全球首款集成了支持MIPI I3C和MIPI&nbs
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高云 FPGA
集成电路技术和计算机技术的蓬勃发展。让电子产品设计有了更好的应用市场。实现方法也有了更多的选择。传统电子产品设计方案是一种基于电路板的设计方法。该方法需要选用大量的固定功能器件.然后通过这些器件的配合设计从而模拟电子产品的功能，其工作集中在器件的选用及电路板的设计上。 随着计算机性价比的提高及可编程逻辑器件的出现。对传统的数字电子系统设计方法进行了解放性的革命。现代电子系统设计方法是设计师自己设计芯片来实现电子系统的功能.将传统的固件选用及电路板设计工作放在芯片设计中进行。进人新世纪电子产品设计系统
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EDA FPGA
尽管现在的EDA工具很强大，但随着PCB尺寸要求越来越小，器件密度越来越高，PCB设计的难度并不小。如何实现PCB高的布通率以及缩短设计时间呢?本文介绍PCB规划、布局和布线的设计技巧和要点。 现在PCB设计的时间越来越短，越来越小的电路板空间，越来越高的器件密度，极其苛刻的布局规则和大尺寸的组件使得设计师的工作更加困难。为了解决设计上的困难，加快产品的上市，现在很多厂家倾向于采用专用EDA工具来实现PCB的设计。但专用的EDA工具并不能产生理想的结果，也不能达到100%的布通率，而且很乱，通常还需花
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PCB EDA
传统应用几近饱和，新应用还有待拓展，竞争对手步步紧逼，盈利能力面临挑战，这些难题要如何解决?看老牌FPGA玩家Xilinx是如何应对的…
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FPGA 英特尔
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