全球领先的半导体解决方案供应商瑞萨电子株式会社今日宣布，推出其最新的基于微处理器(MPU)RZ/N1L系列产品的解决方案套件。除了面向可编程逻辑控制器(PLC)等高端主站设备的RZ/N1D系列和面向人机界面(HMI)等中端设备的RZ/N1S系列，这次新推出的RZ/N1L则是针对远程IO及通信模块等从站设备以及网络驱动器而优化的。RZ/N1D和RZ/N1S解决方案套件此前已经提供。随着RZ/N1L解决方案套件的推出，RZ/N系列所有评估套件均已上市，可支持广泛的工业设备网络功能的评估。 瑞萨在2018
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瑞萨电子 MPU
我们(IEEE)最近与Bunny Huang进行了有趣的交流，他是硬件大师以及Chumby，NetTV和Novena Laptop等的创造者。他还是Hacking the Xbox，The Essential Guide to Electronics in Shenzhen两篇文章的作者，在IEEE Spectrum中有两篇专题文章。 我们感兴趣的是Huang的意见，一个小的资金适中的团队，
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芯片 FPGA
无线充电在今年成为移动装置充电标配，将带动无线充电周边产品的强劲需求，虽然无线充电MCU市场竞争激烈，但因市场刚进入成长爆发阶段，各家MCU厂都可望拿到不少订单，今年出货量也会较去年成长数倍。
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无线充电 MCU
2017年中国MCU市场的一个主要特点是供货紧张，据IHS Markit介绍，主要原因是上游晶圆厂和材料供货紧张，部分MCU巨头从低利润产品中退出或低投入，及芯片制造产能被转移到其他热点应用(诸如指纹芯片)。此时，一些本土MCU开始显山露水，逐渐引起业界的注目。为此，本文采编了2017年底部分研讨会和展会上的MCU企业。
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MCU 缺货 性能 服务 生态 201803
中国2017年MCU特点：增长最快的是消费市场，MCU供货紧张，大多数MCU供应商有很好的发展，基于Cortext-M的MCU继续保持着高速增长。未来MCU市场的趋势：8 bit 和32 bit MCU 将会长期共存和发展，高端MCU涵盖的功能会愈来愈多，应用的理解对MCU产品的发展愈来愈重要。
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中国 MCU 市场 展望 201803
CritICal Link公司的某客户需要针对多个应用开发一个扩频无线电收发器。该客户已经开发出一套算法，准备用于对信号进行调制和解调，但他们却缺少构建完整系统的资源和专业知识。客户希望利用软件定义无线电(SDR)系统的灵活性优势。本文将探讨如何基于德州仪器(TI)的OMAP-L138 DSP+ARM处理器与FPGA来实现该系统。 平台 Critical Link选择其MityDSP-L138F嵌入式系统模块作为SDR的基础，因为该模块不仅具有很强的处理能力，而且可以
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FPGA ARM
许多嵌入式极客都在想，如果他们继续在MICroChip的PIC32系列MCU上投入时间、精力和金钱，前景会怎么样。他们的投资会是安全的吗，和选择TI、NXP、ST的ARM Cortex-M3内核CPU的工程师相比又如何?ARM用户很有信心地认为，如果他们选择从Cortex-R系列升级到Cortex-A系列更高端的处理器，肯定会有效果。 另外还有一个观察，就是使用了强大的MCU以后，用户倾向于使用MPU(应用处理器)而不是继续使用MCU。MIPS的M4k/14k针对通用嵌入式和深度嵌入式应用
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MIPS MPU
本文将机器视觉与网络技术相结合，使用TI公司新近推出的6000系列DSPsTMS320DM642为核心，应用ALTERA公司的FPGA，用其实现图像预处理，减轻了DSPs的负担。应用网络技术实现图像传输。 1、引言 机器视觉自起步发展到现在，已有15年的发展历史。应该说机器视觉作为一种应用系统，其功能特点是随着工业自动化的发展而逐渐完善和发展的。 目前，国际上视觉系统的应用方兴未艾，1998年的市场规模为46亿美元。在国外，机器视觉的应用普及主要体现在半导体及电子行业，其中大概 40%
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DSP FPGA
新的一年开启新的希望，新的空白承载新的梦想。这是年初一集微网给读者们拜年时写的寄语。在中国农历新年开年之际，半导体产业里也迎来了许多新的起点。例如长江存储在与苹果就采购前者的Nand闪存芯片一事谈判，又例如前京微雅格副总裁王海力坚守18个月后的二次创业。
2005年年底，即将从清华大学计算机专业博士毕业的王海力加入了一家新成立的中外合资公司——雅格罗技，开始了国产FPGA芯片研发。2010年在北京市政府相关引导资金支持下，该公司也转换身份并更名为“京微雅格&r
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京微雅格 FPGA
10、FPGA的时序基础理论 我们的分析从下图开始，下图是常用的静态分析结构图，一开始看不懂公式不要紧，因为我会在后面给以非常简单的解释： 这两个公式是一个非常全面的，准确的关于建立时间和保持时间的公式。其中Tperiod为时钟周期;Tcko为D触发器开始采样瞬间到D触发器采样的数据开始输出的时间;Tlogic为中间的组合逻辑的延时;Tnet为走线的延时;Tsetup为D触发器的建立时间;Tclk_skew为时钟偏移，偏移的原因是因为时钟到达前后两个D触发器的路线不是一样长。 这里我们来做如下转
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FPGA 时序
8、FPGA时钟系统 1. FPGA的全局时钟是什么? FPGA的全局时钟应该是从晶振分出来的，最原始的频率。其他需要的各种频率都是在这个基础上利用PLL或者其他分频手段得到的。 2. 全局时钟和BUFG: BUFG，输入为固定管脚，输出为H型全铜全局高速网络，这样抖动和到任意触发器的延时差最小，这个也就是FPGA做同步设计可以不需要做后仿真的原因。 全局时钟：今天我们从另一个角度来看一下时钟的概念：时钟是D触发器的重要组成部分，一个有效边沿使得D触发器进行一次工作。而更多的时候，D触发器保
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FPGA 时钟
1、查找表LUT和编程方式 第一部分： 查找表LUT FPGA是在PAL、GAL、EPLD、CPLD等可编程器件的基础上进一步发展的产物。它是作为ASIC领域中的一种半定制电路而出现的，即解决了定制电路的不足，又克服了原有可编程器件门电路有限的缺点。 由于FPGA需要被反复烧写，它实现组合逻辑的基本结构不可能像ASIC那样通过固定的与非门来完成，而只能采用一种易于反复配置的结构。查找表可以很好 地满足这一要求，目前主流FPGA都采用了基于SRAM工艺的查找表结构，也有一些军品和宇航级FPGA采用
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FPGA CPLD
eFPGA：冉冉升起的新星,eFPGA即嵌入式FPGA(embedded FPGA)，是近期兴起的新型电路IP。 随着摩尔定律越来越接近瓶颈，制造ASIC芯片的成本越来越高。因此，设计者会希望ASIC能实现一定的可配置性，同时又不影响性能。在希望能做成可配置的模块中，负责与其他芯片或者总线通信的接口单元又首当其冲。在芯片中，模块间的通信往往使用简单的并行接口或者配合简单的时序逻辑，但是在芯片间通信时为了保证可靠性，必须通过一系列握手(handshake)协议来完成通信接口。设计者往往希望自己的SoC
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eFPGA FPGA
目前世界上有两种文明，一种是人类社会组成的的碳基文明，一种是各种芯片组成的硅基文明——因为几乎所有的芯片都是以单晶硅为原料制作的，芯片系统的总数比人类的数量还多出数十上百倍。芯片大家族里面也分各种不同类型的芯片，从古老的用电子管堆出来的成吨的逻辑门到现在的超级数据中心，电子技术的发展走过了一代又一代，到了今天，各种芯片更是百花齐放，芯片厂商百家争鸣。
可是，这么多芯片，按照功能分类，有专门用于计算的、有专门用于控制的、有专门用于存储的&hell
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FPGA SoC
引言 随着传感器、低成本摄像头和显示屏在当今嵌入式设计中的使用量飞速增长，市场上出现了许多激动人心的全新智能和视觉应用。与此同时，嵌入式视觉应用的爆炸式发展也让设计工程师对处理资源需求有了一个新的认识。包含丰富数据的全新视频应用促使设计工程师重新考虑到底采用哪种器件，是专用应用处理器(AP)、ASIC还是ASSP?然而，在某些情况下，在现有应用处理器、ASIC或ASSP方面的大量软件投入以及全新器件的高启动成本已然成为上述应用更新迭代的阻碍。这一次，摆在眼前的问题推动设计工程师寻求一种协处理解决方案
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FPGA 莱迪思
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