- 引言
信息处理机(图1)用于完成导弹上多路遥测信息的采集、处理、组包发送。主要功能包括高速1553B总线的数据收发、RS422接口设备的数据加载与检测、多路数据融合和数据接收、处理、组包发送的功能。其中，总线数据和其他RS422接口送来的数据同时进行并行处理;各路输入信息按预定格式进行融合与输出;数据输出速率以高速同步RS422口的帧同步脉冲为源，如果高速同步RS422口异常不影响总线数据和其它RS422口的数据融合与输出功能。在CPU发生异常或总线数据异常时不影响其它RS422口数据的融合与输
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军事电子 FPGA
- 以智能型混合信号FPGA开发真正符合需求的系统,要实现能够将所有重要功能集成在单一器件的设计理由很简单，因为这样就能将材料成本、部件库存及电路板面积减至最低。另外，相较于多芯片解决方案，单芯片方案的功耗也较低，同时也有助于提高对知识产权的保护。如果
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符合 需求 系统 真正 开发 混合 信号 FPGA 智能型
- 两家半导体大鳄且MCU全球市场排名前两位的瑞萨科技和NEC电子的合并，一直受到业内的重点关注。其合并的原因?合并后形成的航母级企业的整合效果?将对业界产生怎样的影响?
问：瑞萨与NEC电子合并后的新名称?哪些因素促使瑞萨与NEC电子进行这次合并?属于哪种类型的合并?
答：瑞萨与NEC电子合并后，于2010年4月1日，以瑞萨电子株式会社的新公司名称正式开始商业运营，并且得到来自大股东NEC、日立制作所和三菱电机的总额约2000亿日元(约合20亿美元)的增资，财务实力大幅增强。
NEC电
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瑞萨电子 SoC 模拟 功率半导体
- 日前，德州仪器 (TI) 宣布推出首款具有智能分析功能的百万像素 IP 摄像机片上系统 (SoC) —— 达芬奇 (DaVinci) DMVA2 视频处理器。视频监控与安全客户可便捷地使用集成型智能分析功能，该功能运行在整合于 DMVA2 SoC 的 TI 第一代视觉协处理器上。人数统计、触发区、智能运动检测、摄像机篡改检测以及流媒体元数据分析等功能均可在流媒体标准高达 1080p 的情况下得到实现。与其它业界多芯片解决方案相比，该集成单芯片 DMVA2 SoC 可将电子材料清
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TI 视频处理器 SoC
- 全球可编程平台领导厂商赛灵思公司(Xilinx, Inc. (NASDAQ:XLNX) )日前宣布NEC子公司NEC Display Solutions有限公司的三款DLP 数字影院投影仪产品， 均采用了赛灵思Virtex®-5 FPGA系列产品。
DLP 数字影院投影仪符合美国数字影院计划 (DCI1) 标准，拥有一系列优异的高安全特性，能够满足各种不同输入信号的要求。该系统能忠实再现输入源，而且集成的德州仪器 (TI) 高分辨率 2K(2,048 × 1,080 点)DL
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Xilinx Virtex FPGA DLP
- 在人手一支照相手机、数码相机或者DV的年代，每个人都可以都在随时随地捕捉和制作画面。在HDTV日渐盛行的年代，我们希望自己看到的每一幅画面都绚丽多姿。不过，并非每个人都是摄影大师，我们许多人弄出来的画面并不那么漂亮。过去，摄影大师都要借助于暗房技术来制作出精美的照片。如今，高水平的摄影爱好者都懂得使用Photoshop这类软件来美化照片。现在的问题是，如果要对HDTV电视画面进行美化，有多少Photoshop大师也不够用啊!
有一位大师，他不仅懂得怎样让一幅画面变得更美，而且发明了一种可以植入芯
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DarbeeVision FPGA IP GPU
- Cadence设计系统公司今天发布Cadence Open Integration Platform，该平台能够显著降低SoC开发成本，提高质量并加快生产进度。Cadence Open Integration Platform是支持其新一代应用驱动式开发的EDA360愿景的一个关键支柱，包含公司自身及其产业链参与者提供的面向集成而优化的IP、全新Cadence Integration Design Environment 以及按需集成服务。Cadence混合信号(模拟与数字)设计、验证与实现产品与解决
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Cadence SoC EDA
- 日前，德州仪器 (TI) 宣布推出专用于 DK-LM3S9B96 开发套件的新型 Stellaris FPGA 扩展板，可显着加速开发低成本安全接入控制系统及其它需要高速外部处理单元接口的应用。这款全新电路板使开发人员能够轻松评估 Stellaris 微处理器 (MCU) 高灵活性外设接口 (EPI) 的高带宽机器对机器 (M2M) 并行接口功能。EPI 的 M2M 模式可支持高达 32 位的数据宽度以及高达每秒 150 MB 的数据速率，专用于帮助低成本安全接入控制应用的开发人员将摄像系统或低分辨率
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TI FPGA 开发套件
- 自适应滤波器的研究是近年来研究的热门方向，在PFGA中实现高速的自适应滤波器的设计更是一个热点，在此采用DSP Builder系统建模的方法，在FPGA中实现了归一化LMS算法，实验结果表明：用DSPBuilder设计的8阶DNLMS算法比用底层的VHDL代码设计效率更高，灵活性更大，速度更快。同样比通用的DSP芯片设计的8阶NLMS滤波器处理速度快了20多倍。如果将8阶NLMS滤波器扩展到512阶或者1 024阶，可以很好地应用于自适应回声消除等很多自适应滤波的领域。
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实现 FPGA 滤波器 DNLMS
- 半导体工艺技术进入深亚微米时代后，基于总线系统芯片SoC(SvstemonChip)的体系结构在物理设计、通信带...
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FPGA NoC 验证平台
- 数字电压表是大学物理教学和实验中的重要仪表，其数字化是指将连续的模拟电压量转换成不连续、离散的数字...
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FPGA 数字电压表 A/D
- 为数字消费、家庭网络、无线、通信和商业应用提供业界标准处理器架构与内核的领导厂商美普思科技公司(MIPS Technologies, Inc.,)宣布，全球视觉式(vision-based)防撞系统的先驱和领导厂商 Mobileye 公司已获得其多线程、多处理 MIPS32 1004K 同步处理系统(CPS)授权。Mobileye 将在其新一代 EyeQ 视觉式 SoC 中采用 1004K CPS，用于驾驶辅助系统。Mobileye 在其现有的 EyeQ2 SoC 中已采用了多线程 MIPS32 34
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MIPS MIPS32 SoC
- 几年之前代工厂宣布建新生产线是为了超过它的竞争对手，而不是真正市场需求。
此种不计后果的思维，使得许多代工制造商即便在产业的下降时期也开建生产线，但是近年来代工己经变得越来越保守，因为它们害怕产能过剩。
眼下许多代工厂的表现又好象回复到过去的战术，开始进入新一轮的投资战或者武器竞赛。这是巴克莱投资公司分析师 CJ Muse在新报告中的描述。
三个厂GlobalFoundries,Samsung及TSMC都准备为了在新一轮上升周期中扩大自已的市场份额, 而开始投资竞赛。此种趋势显然对于
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GlobalFoundries 32纳米 SoC
- 基于开源思想与SOPC技术，采用32位开源软核处理器OR1200和开源软核DDS，在FPGA上实现了频率、相位可预置并且可调的3路正弦波信号发生器专用芯片的设计。该专用芯片基于OR1200固化专用程序实现，通过UART传输控制数据，可同时控制3路正弦波的产生，其频率范围为1 Hz~100 MHz，步进频率为1 Hz，相位范围为0°~359°。设计方案在DE2-70开发板上进行了实际验证，证明了设计的正确性和可行性。
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FPGA 多路 正弦波信号 发生器
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