致力于在电源、安全、可靠和性能方面提供差异化半导体技术方案的领先供应商美高森美公司(Microsemi Corporation) 宣布完成9项全新的美国国家标准与技术研究所(National Institute of Standards and Technology, NIST)加密算法验证程序(CAVP)认证。
美高森美SmartFusion®2 SoC FPGA和 IGLOO®2 FPGA通过的认证项目包括NIST “Suite B”中的AES加密/解
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美高森美 NIST FPGA
汽车在给人们生活带来便利的同时也带来了交通事故。其中超速行驶是造成交通事故的重要隐患之一。据研究表明，目前针对车辆超速行驶情况的道路抓拍系统中所使用的图像传感器大多为小面阵器件，普遍为100万～200万像素,从而导致抓拍图像的像素比较低、能够同时抓拍的车道数较少等等问题。面对这一系列问题，大面阵的图像传感器便逐渐成了人们关注的热点。在设计过程中，分析了具有500万像素的CMOS图像传感器MT9P401的工作模式,选用QuartusⅡ做为开发工具，使用Verilog HDL语言对驱动电路设计方案进行了硬
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FPGA 图像传感器
当人们考虑有两个图像传感器的应用时，首先很可能想到的是一个三维摄相机。不过，也有许多设计可以通过使用来自两个图像传感器的数据进行改善;一个例子是汽车司机录像机(CDR)的黑盒子，这通常是安装在后视镜附近，拥有两个摄像机(图1)。一个摄像机朝向挡风玻璃，而另一个摄像机指向司机。在本地的存储器芯片中存储摄像机的视频，如果有意外事故或疑问，可以进行检索。
基于FPGA的双图像传感器设计方案.pdf
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FPGA 图像传感器
就算你代码再怎么牛逼，硬件描述语言再怎么熟练，没有认知FPGA的工作原理，一切都是浮云。因此，在真正开始实战演练之前，Bingo将首先介绍FPGA最小工作配置要求，以及一些基本的外设，并通过DIY CPLD/FPGA系统板案例的分析讲解，用浅显易懂的语言，让初学者深刻认识CPLD/FPGA的工作原理，能够有一个更深刻的软硬件思维。
一、Altium Designer 09 winter 软件介绍
Layout的软件有很多，包括Altium Designer、P
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FPGA CPLD DIY
上次看了一下关于乘法器的Verilog代码，有几个地方一直很迷惑，相信很多初学者看这段代码一定跟我当初一样，看得一头雾水，在网上也有一些网友提问，说这段代码不好理解，今天小墨同学就和大家一起来看一下这段代码，我会亲自在草稿纸上演算，尽量把过程写的详细些，让更多的人了解乘法器的设计思路。
下面是一段16位乘法器的代码，大家可以先浏览一下，之后我再做详细解释
module mux16(
clk,rst_n,
start,ain,bin,yout,done
);
inpu
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FPGA Verilog 时序逻辑
Nios Ⅱ嵌入式处理器是ALTERA公司推出的采用哈佛结构、具有32位指令集的第二代片上可编程的软核处理器, 其最大优势和特点是模块化的硬件结构, 以及由此带来的灵活性和可裁减性。本文基于Nios Ⅱ介绍20款经典设计方案，供大家参考。
基于NiosⅡ的U盘安全控制器设计
本文针对U盘的安全隐患，分析目前较为常见的解决方法，利用SoPC技术，设计实现了一款基于NiosⅡ处理器的U盘安全控制器。该控制器位于PC机和U盘之间，通过对U盘进行扇区级的加解密操作，将普通U盘升级为安全U盘，保证U
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ALTERA FPGA SoPC
引言
以往的直流电机调速系统通常采用单片机或DSP进行控制，而单片机需要使用大量的外围电路，且系统的可升级性差，如更换控制器，往往要对整个软硬件进行重新设计，可重用性不高。而采用DSP作为主要控制器，如果碰到处理多任务系统时，一片DSP不能胜任，这时就需要再扩展一片DSP或者FPGA芯片来辅助控制，从而实行双芯片控制模式。但这样做，既增加了两个处理器之间同步和通信的负担，又使系统实时性变坏，延长系统开发时间。基于以上此类问题，本文提出了采用Altera公司推出的NiosⅡ软核来控制直流电机调速系
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PID NiosⅡ FPGA
系统以FPGA为核心,通过对正弦信号进行滤波、放大整形后得到标准的方波,由FPGA对其频率、周期及相位差进行测量。频率、周期测量采用等精度测量法,其具有精度高的特点;相位差测量采用鉴相器分辨出相位差后测量其高电平所占比例测量。摒弃传统的FPGA+单片机方案,利用SOPC Builder在FPGA上构建Nios Ⅱ处理器对测量的数据进行数据处理及显示,实现了频率、周期、相位差测量的片上系统(SOPC),提高了系统的稳定性、降低了布线难度。
基于Nios_处理器的多功能计数器系统设计.pdf
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NiosⅡ 多功能计数器 FPGA
自2005年9月LXI总线推出以来，已经显示出其组建测试系统的众多优点。基于LXI总线组建测试系统具有易于使用、灵活性高、模块化和可扩缩性、实现更快的系统吞吐率、可分布式应用、长寿命、低成本、通过IEEE1588时钟同步、机架空间小、合成仪器等诸多优点。
1553B总线的全名为“时分制指令/响应式多路传输数据总线”，国内多型战斗机、军舰等武器平台都采用其作为传输总线。因此研制基于LXI总线的1553B通讯模块，不仅能满足多型武器装备对1553B总线的测试需求，也对LXI总
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NiosⅡ 1553B FPGA
京微雅格是世界上除美国硅谷以外唯一自主研发并成功量产现场可编程逻辑(FPGA)芯片的公司，目前拥有数百项技术专利和近百款产品。目前，已经有越来越多的用户都开始使用国产FPGA来做自己的设计，然而在FPGA的开发过程中，免不了要对设计进行仿真。京微雅格的FPGA是支持在modelsim中进行仿真的。
京微雅格的FPGA需要在Primace软件中进行开发，为了便于客户进行仿真设计，在Primace5.0及以上版本都支持在工程中直接调用仿真工具Modelsim。同时，也支持在modelsim中直接进行
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京微雅格 FPGA 仿真
Spartan-3 FPGA能以突破性的价位点实现嵌入式DSP功能。本文阐述了Spartan-3 FPGA针对DSP而优化的特性，并通过实现示例分析了它们在性能和成本上的优势。
所有低成本的FPGA都以颇具吸引力的价格提供基本的逻辑性能，并能满足广泛的多用途设计需求。然而，当考虑在FPGA构造中嵌入DSP功能时，必须选择高端FPGA以获得诸如嵌入式乘法器和分布式存储器等平台特性。
Spartan-3 FPGA的面世改变了嵌入式DSP的应用前景。虽然Spartan-3系列器件的价位可能较低，
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赛灵思 FPGA Spartan-3
横跨多重电子应用领域、全球领先的半导体供应商意法半导体(STMicroelectronics，简称ST)宣布对基于射线跟踪 (ray-tracing) 技术的实验性3D图形应用系统进行测试验证。该解决方案采用一颗与现场可编程门阵列 (FPGA, Field-Programmable Gate Array) 相连、基于ARM®处理器的测试芯片。FASTER 研发项目以“简化分析合成技术，实现有效配置”为目标，是意法半导体与米兰理工大学 (Politecnico di Mi
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意法半导体 FPGA GPU
一、Altera Quartus II 11.0套件介绍
所谓巧妇难为无米之炊，再强的软硬件功底，再多的思维创造力，没有软件的平台，也只是徒劳。因此，一切创造的平台——Quartus II 软件安装，由零开启的世界，便从此开始。
自从Bingo 2009年开始接触FPGA，Quartus II 版本的软件从n年前的5.1版本到今天的最新发布的11.0，都使用过;当然对于软件核心构架而言，万变不离其宗。虽然多多少少有点bug，但这10多个版本发展到了现在，能看到Alt
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FPGA Quartus II
今天我们来写状态机。
关于状态机呢，想必大家应该都接触过，通俗的讲就是数电里我们学的状态转换图。状态机分为两中类型，一种叫Mealy型，一种叫Moore型。前者就是说时序逻辑的输出不仅取决于当前的状态，还取决于输入，而后者就是时序逻辑的输出仅仅取决于当前的状态。下面两个图分别表示两种不同的状态机。
下面我们就通过代码来写一下状态机，以下面的状态转换图为例
首先，是一种典型的状态机写法，这种写法我们称为
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FPGA 状态机 Mealy Moore
习题呢，来自夏雨闻老师的那本教材，就挑几个感觉自己做着有点难度的写写吧
这个题呢刚开始我是没看明白，记得书上只讲了我们习惯上的用法，这种用法我是没见过，问了下别人才知道，Verilog中一般是左高右低。第一个没问题，第二个，input [0:2] IP,习惯上我们这样写 input [2:0] IP，这里两个是等价的，即表示第0 .1 .2 三位。第三个，wire [16:23] A,也是，左高右低，表示第16.17.....22. 23位，左高右低就这样记就好了。
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FPGA 夏雨闻 寄存器
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