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256级灰度LED点阵屏显示原理及基于FPGA的电路设计

  • 摘    要:本文提出了一种LED点阵屏实现256级灰度显示的新方法。详细分析了其工作原理。并依据其原理,设计出了基于FPGA 的控制电路。关键词:256级灰度;LED点阵屏;FPGA;电路设计 引言256级灰度LED点阵屏在很多领域越来越显示出其广阔的应用前景,本文提出一种新的控制方式,即逐位分时控制方式。随着大规模可编程逻辑器件的出现,由纯硬件完成的高速、复杂控制成为可能。 逐位分时点亮工作原理所谓逐位分时点亮,即从一个字节数据中依次提取出一位数据,分8次点亮对应的像
  • 关键字: 256级灰度  FPGA  LED点阵屏  电路设计  发光二极管  LED  

基于DSP的高速数据采集系统的研制

  • 摘    要:本文介绍了基于数据采集系统的虚拟仪器设计。通过软、硬件技术结合,实现了对多路模拟信号的采集处理,输出多种波形,充分发挥了虚拟仪器的优势。关键词:虚拟仪器;DSP; USB 引言随着计算机技术的普及,运用高速数据处理的场合越来越多。例如,高速数字信号处理系统、高速图象信息转换、语音实时处理系统等。本文设计并实现了基于TMS320C32和USB芯片的一套高速、高精度数据采集分析系统。该系统的DSP负责数据的采集,数据通过USB口送到计算机显示、计算。计算机应用程序
  • 关键字: DSP  USB  虚拟仪器  

一种高效的复信号处理芯片设计

  • 摘    要:本文提出了一种高效的复信号处理芯片的设计方法。本芯片是某雷达信号处理机的一部分,接收3组ADC的输出复数据,依次完成去直流、加窗、512点FFT、求功率谱和累加3组信号的功率谱等功能。在这5种功能中,加窗、512点FFT和求功率谱复用一个蝶形单元。本芯片由单片FPGA实现,计算精度高、速度较快,满足雷达系统的实时处理要求。关键词:  FFT;蝶形单元;块浮点;功率谱; FPGA 引言复信号处理芯片是某雷达系统的一部分。雷达系统的实时处理特点要求芯片运
  • 关键字: FFT  FPGA  蝶形单元  功率谱  块浮点  

采用FPGA实现脉动阵列

  • 微电子学的发展彻底改变了计算机的设计:集成电路技术增加了能够安装到单个芯片中的元器件数目及其复杂度。因此,采用这种技术可以构建低成本、专用的外围器件,从而迅速地解决复杂的问题。
  • 关键字: FPGA  脉动  阵列    

基于PCI总线的双DSP系统及WDM驱动程序设计

  • 介绍了PCI总线控制芯片PCI2040的功能及内部结构,分析了基于PCI总线的双DSP通信的硬件结构及实现方法,并描述了利用Windows2000 DDK开发WDM设备驱动程序的方法及PCI双DSP通信驱动程序主要模块的设计方法和编程注意要点。
  • 关键字: PCI  DSP  WDM  总线    

基于DSP的自动指纹识别系统

  • 文章介绍了一种基于TI公司的TMS320VC5402来构造指纹识别系统的方法。详细论述了系统的各个组成部分以及指纹识别算法的实现流程,结合VC5402的指令集和自身结构特点,讨论了如何高效的设计应用程序的方法。
  • 关键字: 系统  指纹识别  自动  DSP  基于  

基于AD9430的数据采集系统设计

  • 摘   要:本文介绍了高速ADC AD9430的功能,详细说明了使用高速FPGA来控制AD9430构成高速(140MSPS)、高精度(12位)数据采集系统的设计方法,并给出了具体实现的系统框图和测试结果。关键词:数据采集;FPGA;AD9430引言结合实际任务的要求,本文提出了一种基于AD9430的高速数据采集系统,主要用于采集雷达回波。在这个系统中,选用高速逻辑器件控制A/D转换和FIFO存储,同时通过FPDP(Front Panel Data Port)总线将采集的数据发送出去。由
  • 关键字: AD9430  FPGA  数据采集  

基于双DSP的磁轴承数字控制器容错设计

  • 摘    要:本文介绍了应用于磁轴承的双DSP热备容错控制方案,该方案采用时钟同步技术,由总线表决模块实现系统的容错处理,硬件判决模块实现硬件故障判断。由中心仲裁模块根据两判决模块的结果进行复杂的仲裁,并完成切换和完善的报警逻辑,从而提高了磁轴承控制系统的可靠性。关键词:容错;磁轴承; 控制器; CPLD; DSP引言电磁轴承(AMB)是利用可控电磁吸力将转子悬浮起来的一种新型高性能轴承,具有无接触、无摩擦、高速度、高精度、不需润滑和密封等一系列特点,在交通、超高速超精密加工
  • 关键字: CPLD  DSP  磁轴承  控制器  容错  

基于FPGA的非对称同步FIFO设计

  • 摘    要:本文在分析了非对称同步FIFO的结构特点及其设计难点的基础上,采用VHDL描述语言,并结合FPGA,实现了一种非对称同步FIFO的设计。关键词:非对称同步FIFO;VHDL;FPGA;DLL;BlockRAM引言FIFO是一种常用于数据缓存的电路器件,可应用于包括高速数据采集、多处理器接口和通信中的高速缓冲等各种领域。然而在某些应用,例如在某数据采集和处理系统中,需要通过同步FIFO来连接8位A/D和16位数据总线的MCU,但是由于目前同步FIFO器件的输入与输
  • 关键字: BlockRAM  DLL  FPGA  VHDL  非对称同步FIFO  存储器  

基于DSP的列车应变力测试系统设计

  • 摘    要:本文介绍了基于TMS320VC33 DSP芯片的应变力测试系统的设计,给出了结构原理框图,并围绕DSP设计了测试系统的中断、复位子系统、存储子系统和通信子系统。同时还对测试系统进行了信号完整性分析。关键词:测试系统;DSP;应变力;信号完整性车轮与轨道间的作用力是评价车辆运行品质的重要因素,能否准确及时地获取轮轨间的作用力直接影响着车辆脱轨系数等参数的计算。应变力测试系统是设计列车运行状态地面安全监测平台的关键环节,本文用DSP芯片开发的测试系统正是针对这一需要
  • 关键字: DSP  测试系统  信号完整性  应变力  

基于FPGA的高速数字锁相环的设计与实现

  • 摘    要:本文提出了一种利用边沿触发鉴相缩短锁相环捕获时间的方案,并详细介绍了该方案基于FPGA的实现方法。通过对所设计的锁相环进行计算机仿真和硬件测试,表明该方案确实可以提高锁相环的捕获性能。关键词:数字锁相环(DPLL);捕获时间;FPGA;VHDL引言捕获时间是锁相环的一个重要参数,指的是锁相环从起始状态到达锁定状态所需时间。在一些系统中,如跳频通信系统,由于系统工作频率不断地发生快速变化(每秒几百次到几千次,甚至高达上万次),要求锁相环能够对信号相位快速捕获。因此
  • 关键字: FPGA  VHDL  捕获时间  数字锁相环(DPLL)  

基于DSP控制的PFC变换器的新颖采样算法

  • 为DSP控制的功率因数校正(PFC)变换器提出了一种新颖的采样算法,它能够很好地消除PFC电路中高频开关动作产生的振荡对数字采样的影响。
  • 关键字: 新颖  采样  算法  变换器  PFC  DSP  控制  基于  

高速DSP数据采集的信号完整性问题

  • 深入研究高速数字电路设计中的信号完整性问题;分析电路中破坏信号完整性的原因;结合一个实际的DSP数据采集系统、阐述实现信号完整性的具体方案。
  • 关键字: 完整性  问题  信号  数据采集  DSP  高速  

集系统级FPGA芯片XCV50E的结构与开发

  • VirtexE系列是XILINX公司生产的新型FPGA芯片,可用来进行数十万逻辑门级的系统设计和百兆赫兹级的高速电路设计。
  • 关键字: FPGA  50E  XCV  50    

基于FPGA的光栅尺信号智能接口模块

  • 介绍了一种基于ALTERA公司大规模可编程逻辑器件EPF10K10的多功能光栅尺处理品电路。叙述了该电路的主要电路――四倍频细分、辨向电路、计数电路、接口处理电路的设计原理,风时给出了详细的电路和仿真波形。
  • 关键字: FPGA  光栅  信号  模块    
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