- 流水线型模数转换器MAX1200及其与DSP的接口,1 MAX1200的特点功能 新型ADC正在朝着低功耗、高速、高分辨率的方向发展，新型流水线结构正是实现高速低功耗ADC的有效方法。而MAX1200则是采用这一新技术的高速、高精度、低功耗ADC的代表。 MAX1200是
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及其 DSP 接口 MAX1200 转换器 线型 模数 流水
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DSP MP3 音频编码
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PCI DSP 信号处理
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DSP USB 语音传输
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DSP 声卡接口 CPLD
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DSP 磁存储设备 抗冲击 控制系统
- 不久前，All Programmable技术和器件的企业——赛灵思公司（Xilinx）正式发货 Virtex-7 H580T FPGA—全球首款3D异构All Programmable产品。
Virtex-7 HT采用赛灵思的堆叠硅片互联 (SSI)技术，是提供业界带宽最高的FPGA，可提供多达16个28 Gbps收发器和72个13.1 Gbps收发器，也是能满足关键Nx100G和400G线路卡应用功能要求的单芯片解决方案。
为此，本刊访问了该公司负责人，澄
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Xilinx 赛灵思 3D FPGA all programmable 异构
- 一种基于ARM和FPGA的可重构MAC协议设计,摘要：为了在实际信道条件下研究Ad Hoc网络MAC协议，克服商业网卡芯片和理论仿真等带来的局限性，搭建了基于ARM和FPGA相结合的硬件平台，设计与实现了基于CSMA／CA的可重构MAC协议，并进行了仿真测试，验证了该协议设
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协议 设计 MAC 重构 ARM FPGA 基于
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DSP 软件编程 引导装载
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TMS320F206 DSP 图像采集卡
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DSP 心电监护 TMS320F206
- 传统的综合技术越来越不能满足当今采用 90 纳米及以下工艺节点实现的非常大且复杂的 FPGA 设计的需求了。问题是传统的 FPGA 综合引擎是基于源自 ASIC 的方法，如底层规划、区域内优化 (IPO,In-place Optimization) 以
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Synplify Premier FPGA 时序收敛
- 摘要：在分析了IRIG-B(DC)码码型特点的基础上，提出了一种IRIG-B(DC)时间码解码的设计方法。该方法由少量外围电路与一片现场可编程门阵列(FPGA)芯片组成，来实现对IRG-B(DC)码的解码、1 PPS信号输出、实时时间显示以
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IRIG-B FPGA DC 解码
- 摘要：以XC2V1500-FPGA为硬件架构，设计了一种图像信号发生器，作为自适应光学系统波前处理机的信号源，为波前处理机的调试和算法验证提供支持。系统采用大容量的NAND型FLASH存储数据，存储容量为1 GB。图像数据通过
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FLASH FPGA ROM 图像信号发生器
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