DSP 在电源设计中的应用,采用分立元件或CPLD、FPGA 进行电源的信号发生和测量的设计，会增加硬件设计复杂程度，延长开发周期。为了简化电源信号发生及测量的硬件设计，缩短开发周期，本文提出一种基于DSP 的嵌入式操作平台，采用DDS( 直接数字式频率合成器) 及乘法器矢量测量技术的设计方案。该方案利用DSP 的高速运算能力，通过实时计算来实现分立元件或CPLD、FPGA 的硬件逻辑功能。实验结果表明该方案切实可行。
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电源 频率 DSP
在FGPA战场上，众所皆知的头号两大对手就是Altera与Xilinx。一般认为这两对手会在同一个战场上争个你死我活，然而经过多年的鏖战，两厂商已经从过去积极的正面厮杀对决，改而转向较为保守的画地为王，以既有优势为基础，固守疆域，进而转化为更大的研发能量。
据了解，Xilinx在既有的28奈米FPGA市场已经打下稳定基础，而目前xilinx也不侧重在更先进製程上与对手争个你死我活，反倒是稳扎稳打固守疆土，选择将FPGA的可程式化优势发挥到极致。Xilinx认为，可程式
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Altera FPGA
视频显示器市场分为：大批量应用，如台式机、笔记本显示器和电视机面板;中等批量应用，如小型人机接口(HMI)面板和大尺寸数字标牌。本文将探讨的是大尺寸显示器面板应用(表1)，其中FPGA是一个备受关注的选择，它可以满
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FPGA 视频显示 接口
对于FPGA初学者而言，如何正确了解并理解FPGA的仿真是关键。应广大FPGA初学者和爱好者要求，电子发烧友网编辑根 ...
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FPGA 核心知识 仿真
全球领先的硅产品知识产权(SIP)平台解决方案和数字信号处理器(DSP)内核授权厂商CEVA公司针对基于Android系统推出全新低能耗软件框架，它使用异构CPU和DSP系统架构，能够有效地降低复杂多媒体应用所需的功耗。这款框架称作Android Multimedia Framework (AMF™)，面向包括音频、语音、成像和视觉的最密集的实时信号处理应用。
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CEVA DSP Android
当今的设计工程师受到面积、功率和成本的约束，不能采用GHz级的计算机实现嵌入式设计。在嵌入式系统中，通常是由相对数量较少的算法决定最大的运算需求。使用设计自动化工具可以将这些算法快速转换到硬件协处理器中。
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FPGA 协处理器 算法
1、电路设计与输入 电路设计与输入是指通过某些规范的描述方式，将工程师电路构思输入给EDA工具。常用的 ...
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FPGA 设计流程 布线资源
在调试FPGA电路时要遵循必须的原则和技巧，才能降低调试时间，防止误操作损坏电路。通常情况下，参考以下步骤执行 ...
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FPGA 硬件电路 调试必备
引 言门和人类文明是孪生的，它伴随着人类文明的发展而跃动。21 世纪的今天，门更加突出了安全理念，强调了有效性：有效地防范、通行、疏散，同时还突出了建筑艺术的理念，强调门与建筑以及周围环境整体的协调、和谐
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FPGA 自动门 控制设计
ARM是目前全球最大的嵌入式芯片技术的IP提供商，其所拥有的IP已经成为众多芯片设计公司采纳的一种技术标准和开发平台。所以基于ARM 内核的SoC已经成为嵌入式处理器的开发重点，可通过ARM实现LCD控制器来完成对嵌入式
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FPGA ARM 图像
全球领先的硅产品知识产权(SIP)平台解决方案和数字信号处理器(DSP)内核授权厂商CEVA公司宣布大唐电信科技产业集团(Datang Telecom Technology and Industry Group)的核心企业之一联芯科技有限公司(Leadcore Technology Co., Ltd.)已经获得CEVA公司DSP技术和平台授权许可，用于其下一代移动芯片。
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联芯 DSP CEVA
摘要：根据VGA(Video Graphic Array)的原理，采用VHDL硬件描述语言，设计了一种基于Zedboard FPGA板卡的图像显示方案。实验结果表明，在FPGA实现图片显示，达到了预期的效果，依据该原理，可以实现图像的采集及在VGA显示屏上显示的实现。
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VGA FPGA 图片显示 201304
智能相机是一种小型的视觉检测系统，主要运用于工况监视，产品检验和质量监控等领域，能够提高生产制造的柔性和自动化程度。与传统的PC式视觉系统相比，它具有易学、易用、易维护、易安装等特点。在此主要是提出了一种嵌入式智能相机的设计方案，它是以ADSP-BF537为系统控制核心，以CMOS传感器为图像采集装置，结合Oscar软件框架和OpenCV进行软件设计。最后通过一个检测条形码的应用来说明研究出来的智能相机的可行性，并且通过实验数据来说明智能相机运行速度和工作效率。
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相机 研究 智能 嵌入式 DSP 基于
为了实现靶场时统终端输出IRIG-B标准DC code信号，采用VHDL语言在FPGA逻辑电路中设计了DC code编码器硬件电路，通过QuartusⅡ软件建立工程文件对VHDL语言DC code编码器电路进行编译和仿真，获得了符合IRIG-B标准的DC code信号。经过实践验证，该电路具有实现方法简单、电路稳定性好、精度高的特点，实测同步精度小于1μs。
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IRIG-B FPGA code VHDL
摘要 对DDR SDRAM的基本工作特性以及时序进行了分析与研究，基于FPGA提出了一种通用的DDRSDRAM控制器设计方案。在Modelaim上通过了软件功能仿真，并在FPGA芯片上完成了硬件验证。结果表明，该控制器能够较好地完成DD
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控制器 设计 SDRAM DDR FPGA 基于
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