- 日前，京微雅格(北京)科技有限公司宣布适时推出了黄河系列CAP(可编程应用平台)HR系列，以迎合低功耗，小封装及灵活的应用场景需求。 据京微雅格产品市场总监窦祥峰介绍，其产品特点如下： CME-HR系列低功耗FPGA采用40纳米台联电低功耗工艺，静态最低功耗可达35.2uW，最小封装WLCSP16仅1.5mm*1.5mm。 该系列产品主要面向手持类或其它移动便携式终端与设备的相关应用领域，该领域要求具备远程升级、动态配置和功耗管理等功能，满足LTE及未来的5G智能手机、便携式智能终端(Tablet
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京微雅格 CAP FPGA
- 日前，德州仪器 (TI) 推出名为 TMS320C5517 (C5517) 的新一代超低功耗 DSP(属于 TI 的可扩展性 TMS320C5000™ 器件组合)。这款全新的 DSP 功耗很低，却可提供频率高达 200MHz 的性能，从而实现更快的数据处理，适用于要求极高的应用，如音频和视频、生物辨识和其它特定分析应用。这些应用开启了一个充满无限可能的世界，可为新一代智能产品添加人脸检测、目标跟踪和语音识别等功能。此外，随着性能的提高，C5517 DSP 还可提供低待机功率和低有功功率的魅
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TI C5517 DSP
- 在雷达信号处理、数字图像处理等领域中，信号处理的实时性至关重要。由于FPGA芯片在大数据量的底层算法处理上的优势及DSP芯片在复杂算法处理上的优势，DSP+FPGA的实时信号处理系统的应用越来越广泛。ADI公司的TigerSHARC系列DSP芯片浮点处理性能优越，故基于这类。DSP的DSP+FPGA处理系统正广泛应用于复杂的信号处理领域。同时在这类实时处理系统中，FPGA与DSP芯片之间数据的实时通信至关重要。
TigerSHARC系列DSP芯片与外部进行数据通信主要有两种方式：总线方式和链路口方式。链
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DSP FPGA
- 0 引言
智能电网的发展，对低压电器的智能化提出了较高的要求，目前国内使用较多的小型断路器的智能化稳定性不够，在于其体积较小，将信号采集电路、动作执行和智能脱扣器都安装在本体内，开关内的强电场产生的电磁干扰和高温，使得断路器可靠性降低。本文介绍的智能控制器脱离于断路器本体，并且能够连接多个断路器，实现对多个断路器的监控。
1 控制器的总体结构
群组智能控制器的核心采用DSP 芯片，辅以CPLD EPM3128芯片来实现键盘和液晶的时序逻辑，减少扩展芯片带来的体积问题，外围电路主要包括信号调理电路和脱
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DSP CPLD
- 全球领先的硅产品知识产权(SIP)平台解决方案和数字信号处理器(DSP)内核授权厂商CEVA公司宣布CEVA-TeakLite-4 DSP内核继音频、语音和感测技术后，现在还可处理蓝牙工作负载，从而显着降低智能手机、物联网(Internet of Things, IoT)、可穿戴产品和无线音频装置的芯片设计的成本、复杂性和功耗。通过利用最近发布的多功能CEVA-TeakLite-4 v2架构的新增指令和接口，这款DSP现在可运行 CEVA-蓝牙连接性(经典或低功耗)，以及广泛的音频和语音软件包;语音触
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SIP DSP CEVA
- CPLD(Complex programmable Logic Device，复杂可编程逻辑器件)是在传统的PAL、GAL基础上发展而来的，具有多种工作方式和高集成、高速、高可靠性等明显的特点。
在超高速领域和实时测控方面有非常广泛的应用，日前的CPLD普遍基于E2PROM和Flash电可擦除技术，可实现100次以上擦写循环。
CPLD选择及其扩展模块的设计
由于A是3.3v电平供电的，所以CPLD我们也选择3.3v电平供电的XL型号。XC95144XL是Xilinx公司 XC9500系列的一种。它
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CPLD DSP
- 摘要：近年来，自适应均衡技术在通信系统中的应用日益广泛，利用自适应均衡技术在多径环境中可以有效地提高数字接收机的性能。为了适应宽带数字接收机的高速率特点，本文阐述了自适应均衡器的原理并对其进行改进。最后使用FPGA芯片和Verilog HDL设计实现了自适应均衡器并仿真验证了新方法的有效性。
信道均衡技术(Channel equalization)是指为了提高衰落信道中的通信系统的传输性能而采取的一种抗衰落措施。它主要是减小信道的多径时延带来的码间串扰(ISI)问题。其原理是对信道或整个传输系统特性进行
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FPGA LMS
- 京微雅格的HR系列FPGA芯片已经能够提供EVB，并预计今年第三季度大规模量产，已成为世界上除美国外唯一自主研发并成功量产FPGA产品的公司。
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京微雅格 FPGA
- 十四个月之前，我参加了一次Plunify的媒体沙龙活动，写了一篇名为《云时代才刚刚开始》的文章，谈了一点我对把芯片设计结合云计算和对Plunify这家创业公司的看法。那时候，Plunify主推的业务是租用亚马逊的服务器资源，搭建一个FPGA开发的云端平台，让设计公司可以把设计方案上传到云端来仿真，以节省大量的时间，同时也避开了自建云的昂贵成本。 一年过去了，我终于又有机会和Plunify做一次更加深入的交流，看看Plunify在中国大陆市场的深水里摸了一年石头后，到底有没有摸到鱼。 Plunify
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Plunify 云端 FPGA InTime
- 时间都去哪了?当公司全球上下热烈庆祝成立30周年的时候， 回首我在赛灵思竟然也已有十载。从上海到北京，从新天地到盘古大观，从北京最开始几个人的小办事处到今天数十人数千规模的北京公司，我有幸见证了赛灵思在中国的巨大发展和变迁，但不变的是这份工作带来的强大吸引力和提供给大家的实现梦想的舞台。
赛灵思是我的第一份工作，一做就做了十年。很多周围的同学朋友都已经换了多家公司，也有很多在高校都成了学术带头人，教授， 也不停地有猎头和朋友追问我为什么不愿意动一动。 我清楚我的执着和坚守来源于公司人性化和平等的
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赛灵思 FPGA PAE
- 摘要：采用FPGA进行的数字电路设计具有更大的灵活性和通用性，已成为目前数字电路设计的主流方法之一。本文给出一种基于FPGA的数字钟设计方案。该方案采用VHDL设计底层模块，采用电路原理图设计顶层系统。整个系统在QuartusⅡ开发平台上完成设计、编译和仿真，并在FPGA硬件实验箱上进行测试。测试结果表明该设计方案切实可行。
EDA(Electronic Design Automation)又名电子设计自动化，其基本特征是：以超大规模可编程逻辑器件，如FPGA，为设计载体，以硬件描述语言，如VHDL，为
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FPGA QuartusⅡ
- 曾有句话这样说到：“当你认为设计完美的时候，不是因为没有什么可以加，而是你不能再去除什么。”这话用在FPGA上是再合适不过了。从简单的逻辑集成到现在集成ARM核、DSP、模拟电路、存储器等无所不包的系统级集成，从纯硬件开发到可以用C、C++或System C来开发，从此前价格高昂到现在低成本低功耗，从工艺的跟随到成为先进工艺的引领和3D IC的成功，从传统的通信、工业和军工等应用向消费电子、医疗电子、汽车电子、嵌入式市场等扩展，FPGA成为扩充我们想像力的“先锋”。
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赛灵思 FPGA All Programmable
- 您有没有留意到赛灵思的logo下面有两个英文单词——“All Programmable”? 这代表了什么?众所周知，赛灵思一直是FPGA行业的领头羊。那么未来呢?未来具有无限的可能性，但是All Programmable无疑是赛灵思正在全力推动的转型。All Programmable SoC无疑是这个转型的代表之作，Zynq这个革命性的产品，也就应运而生了。我和赛灵思的缘分也由此开始。
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赛灵思 FPGA Zynq
- 在FPGA领域，我们再次闻到了沉重的火药味。2010年中国农历新年前后，FPGA的28nm交响曲奏响。
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赛灵思 ASIC FPGA 28nm
- 写这篇文章的时候，我正处于硕士研究生毕业论文的准备阶段，眼睁睁看着我的大学生活即将画上句号，再看看身边有很多低年级的学生们一天天把时间白白荒费掉，我在心里替他们惋惜，在即将结束我的大学生活之际，我将我的大学几年的有意义的生活与大家分享，看过这篇文章后也许能让那些有梦想的同学为了实现自己的人生目标少走些弯路，大家要相信，大学校园——将为你提供一生最好的学习环境。
我高中毕业于新疆伊宁市三中，2002年考入哈尔滨工程大学信息与通信工程学院电子信息工程专业，2006年以创新人才
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DSP ARM FPGA/CPLD
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