基于FPGA芯片Stratix II EP2S60F672C4设计实现了数字基带预失真系统中的环路延迟估计模块。该模块运用了一种环路延迟估计新方法，易于FPGA实现。同时，在信号失真的情况下也能给出正确的估计结果。Modelsim SE 6.5c的时序仿真结果和SignalTaps II的硬件调试结果验证了模块的有效性。
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数字基带预失真系统 环路延迟估计 FPGA
通过研究通用串行循环冗余校验(CRC)编码技术并在此基础上,利用等式代换或矩阵变换等方法推导出通用并行CRC编码电路结构。根据传统的并行CRC编码方法,发现在高速数据传输校验中,需要大量的人为计算量,由于计算量大,容易产生一些计算错误。于是在传统的串行CRC编码的思想基础上,利用FOR循环语句与流水线技术相结合,提出基于FPGA的FOR循环并行CRC流水线算法。
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循环冗余校验 流水线技术 FPGA
介绍一种采用单片SRAM和FPGA实现红外图像显示的新方案，并对显示系统结构、FPGA各功能模块设计、SRAM的读/写时序设计进行了详细论述。该图像显示方案可用于红外图像处理系统的硬件调试和红外图像处理效果观测。
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红外图像显示 SRAM FPGA
设计了一组基于CPLD的PLC背板总线协议接口芯片，协议芯片可以区分PLC的背板总线的周期性数据和非周期性数据。详细介绍了通过Verilog HDL语言设计状态机、协议帧控制器、FIFO控制器的过程，25MHz下背板总线工作稳定的试验结果验证了协议芯片设计的可行性。
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VerilogHDL PLC背板 CPLD
在VHDL语言电路优化设计当中，优化问题主要包括面积优化和速度优化。面积优化是指CPLD／FPGA的资源利用率优化，即用尽可能少的片内资源实现更多电路功能；速度优化是指设计系统满足一定的速度要求。
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电路优化设计 VHDL FPGA
在今年举办的美国国广播电视设备展上亮相的数项创新中，BBC RD新开发的Stagebox可以安装到摄像机的背面，将有效传输距离从数百米延长到互联网协议数据包能抵达的几乎任何一个地方。在近期涌现的利用 FPGA与生俱来的可编程功能提供更多功能和适应性，实现协议和标准的对接的开创性设备中，Stagebox是最新一员。
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Zynq-7000 端到端广播 FPGA
提出了一种基于FPGA的雷达回波实时模拟器的实现方法。该模拟器采用cPCI标准总线，以FPGA为核心计算单元，配有高速数模、模数转换模块，可实现雷达回波信号实时在线注入模拟。该模拟器可实现多种体制下复杂回波的模拟，具有很好的工程应用价值。
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雷达回波实时模拟器 并行处理 FPGA
提出了一种FPGA远程动态重构的方法，结合FPGA动态重构技术和GSM通信技术来实现。利用GSM技术实现配置数据的无线传输，在单片机控制下将数据存储于CF卡中。在内嵌硬核微处理器PowerPC405控制下，FPGA通过内部配置存取端口读取CF卡中新的配置数据，对可重构区进行配置以实现新的功能。
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配置 GSM FPGA
阐述了一种基于FPGA的虚拟逻辑分析仪的设计，采用高性能的FPGA器件，再利用PC机的强大处理功能，配合LabVIEW图形化语言开发实现。由于虚拟逻辑分析仪的部分硬件功能软件化，使硬件电路大为简化，提高了可靠性，同时降低了成本，具有一定的教学和科研价值。
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逻辑分析仪 LabVIEW FPGA
基于数字信号处理器(DSP)TMS320VC5416和复杂可编程逻辑器件(CPLD)的嵌入式车牌识别系统的硬件设计，利用视频处理芯片SAA7111作为视频A／D，在CPLD的控制下将采集到的图像数据写入帧存储器中，DSP对图像数据进行实时分析处理。采用“乒乓”存储结构，实现了图像数据的采集和处理的并行运行。识别结果通过串口传到上位机或者保存在E2PROM中，实现了车牌识别系统脱机、联机工作，在实时高速图像处理系统中有广泛的工程技术应用前景。
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车牌识别系统 嵌入式 CPLD
大多数的勘探、观测工作都是在严苛的环境中进行的，对数据的准确性、实时性都有着较高的要求，并且大多情况下要求多参数同步测量。北京恒颐针对勘探、测控等行业的特点，推出了基于ARM+FPGA的低功耗、高速率
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数据采集 ARM FPGA
近年来，软件无线电已经成为通信领域一个新的发展方向，数字下变频技术(Digital Down Converter-DDC)是软件无线电的核心技术之一，也是计算量最大的部分。基于FPGA的DDC设计一
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DSP DDC FPGA 滤波器
提出了一种采用现场可编程门阵列器件(FPGA)并利用窗函数法实现线性FIR数字滤波器的设计方案，并以一个十六阶低通FIR数字滤波器电路的实现为例说明了利用Xilinx公司的Virtex-E系列芯片的设计过程。
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FIR滤波器 窗函数 FPGA
基于最大似然 (ML)估计算法，改进并利用FPGA实现了一种适用于TD-LTE系统的上行同步算法。主要介绍了如何利用FPGA实现ML算法。并以Virtex-5芯片为硬件平台，进行了仿真、综合、板级验证、联机验证等工作。结果表明，该同步算法应用到TD-LTE系统具有良好的稳定性和可行性。
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TD-LTE Virtex-5 FPGA
以CPLD作为主控芯片，设计了一种针对USB总线的数据读写控制器。u盘通过该控制器转接到Pc机的USB接口，利用控制器对usB总线上的数据进行实时监测分析，自动禁止Pc机上的文件数据输出到U盘，同时不影响Pc机对u盘中文件的正常读取。
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USB接口 读写控制器 CPLD
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