- 为了实现USB设备之间的直接通信，介绍一款USB 0TG IP核的设计与FPGA验证。在分析OTG补充规范的基础上，重点描述了USB OTG IP核的设计原理、模块划分以及每个模块的功能，然后对USBOTG的部分特性进行详细的阐述，最后给出该IP核在ModelSim中的功能仿真及FPGA验证结果。结果表明，该IP核具备主机功能和设备功能，可作为一个独立的IP模块应用到SoC系统中。
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FPGA 验证 设计 Core OTG IP USB
- 图为英特尔Core i7品牌标识
据国外媒体报道，英特尔下一代台式机处理器Nehalem将被正式命名为“Intel Core”(英特尔酷睿)，首批产品还将带有“i7”标识。
英特尔发言人乔治·阿尔弗斯(George Alfs)称，i7标识将被用于首批Nehalem高端台式机处理器中。以后，英特尔还将推出其它标识来补充i7。至于最高端的终极版(Extreme Edition)产品，英特尔还将专门为其打造一个黑色Logo，型号编号也有所
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英特尔 处理器 Core i7 Nehalem
- 1．前言
随着集成电路业工艺的发展，单位面积晶体管的数量急剧增加。按传统的方法，能满足芯片功能和时序要求设计的IC设计工程师，产能约为100门/天，要完成 1200万门的芯片设计需要500人年。设计复用（Design Reuse）技术成为解决问题的有效方法。根据业界经验，任何模块如果不作任何修改就可以在10个或更多项目中复用，都应该开发成IP 。基于IP的数字IC设计方法是有效提高设计产能的关键技术。IP核又称IP （Intellectual Property）Core指具有独立知识产权的电路核
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集成电路 晶体管 IC设计 IP Core
- 扬科技发布首款XTX模块(ETX的升级版)。XTX系列不仅为客户提供了最新Computer On Module (COM)技术，而且完善了研扬科技COM标准产品线。目前，研扬科技能够提供COM、ETX、XTX全系列模块。
XTX-945可配备Intel Core 2 Duo (Merom)/ Core Duo/ Core Solo/ Celeron M (Yonah)处理器，以及一个 200-pin DDR II 400/533/667 SODIMM支持系统内存最大2GB。XTX-945采用In
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研扬科技 XTX-945 Core 2 Duo 单板计算机
- 基于Smart Core的手持式飞参快速卸载器设计,文中采用Smart Core嵌入式开发技术，针对卸载设备的主要特点，设计并实现了手持式通用飞参快速卸载器。
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卸载 设计 快速 手持 Smart Core 基于
- 在通信网络系统中，流量管理的核心是缓存管理、队列管理和调度程序。本文结合使用FPGA及IP Core阐述缓存管理的结构、工作原理及设计方法
目前硬件高速转发技术的趋势是将整个转发分成两个部分：PE(Protocol Engine，协议引擎)和TM(Traffic Management，流量管理)。其中PE完成协议处理，TM负责完成队列调度、缓存管理、流量整形、QOS等功能，TM与转发协议无关。
随着通信协议的发展及多样化，协议处理部分PE在硬件转发实现方面，普遍采用现有的商用芯片NP(Network
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Core FPGA IP 单片机 嵌入式系统 通讯 网络 无线
- 亿道电子成为著名IP Core提供商ARM公司在中国区域的工具代理商。
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亿道 IP Core ARM
- 美国东部时间7月11日（北京时间7月12日）消息：经过2006年狂热的夏天，英特尔公司已经确定了推介其新一代电脑芯片的具体日程安排。 英特尔公司发言人在星期二发布切实消息称，公司将按照计划安排于7月27日在其加利福尼亚州圣克拉拉市的总部首次公开展示和介绍Core 2 Duo芯片。英特尔公司首席执行官保罗奥特里尼和公司其他高管将出席新芯片发布现场，Core 2 Du
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Core CPU 芯片 英特尔
- 英特尔已经制定了下一代PC芯片的发布日期。 英特尔一位发言人周二证实，Core 2 Duo将在7月27日上市，届时英特尔将在加州Santa Clara 的总部举行一个发行仪式。 英特尔的首席执行官Paul Otellini 和其它官员到时会宣布这种标志着奔腾芯片时代终结的新型处理器上市。 经过6 年，英特尔的Netburst家族处理器终于要退出历史舞台，而让位于新的Core芯片了。双核的奔腾D 处理器可以满足许多人
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2 Core CPU Duo 奔腾 双核 英特尔
- 摘 要：本文介绍了与免费IP Core运作有关的问题以及免费资源的若干来源，然后通过对两个不同来源的、免费的八位RISC CPU进行比较和分析，给出了若干选用免费核时应考虑的问题。关键词：IP Core； CPU引言随着集成电路单位面积晶体管数量的激增和人们对缩短设计周期的追求，设计重用已经成为有效的应对方法，它不但适合于ASIC，也适合于CPLD/FPGA。在CPLD/FPGA的设计过程中，由于开发工具的通用性、设计语言的标准化，设计过程几乎与所用器件的硬件结构无关，
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CPU IP Core
- 摘 要：本文介绍了与免费IP Core运作有关的问题以及免费资源的若干来源，然后通过对两个不同来源的、免费的八位RISC CPU进行比较和分析，给出了若干选用免费核时应考虑的问题。关键词：IP Core； CPU引言随着集成电路单位面积晶体管数量的激增和人们对缩短设计周期的追求，设计重用已经成为有效的应对方法，它不但适合于ASIC，也适合于CPLD/FPGA。在CPLD/FPGA的设计过程中，由于开发工具的通用性、设计语言的标准化，设计过程几乎与所用器件的硬件结构无关，
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CPU IP Core
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