随着嵌入式器件在过去数十年来的爆炸性成长，使得硬件组件及软件工具都有显著的改善。虽然有着这种成长与创新，但传统嵌入式系统的设计方法却少有进步，并逐渐变成一种障碍。有鉴于新标准与协议的快速发展，以及对产
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FPGA CPU 家 多核
不管你是一名逻辑设计师、硬件工程师或系统工程师，甚或拥有所有这些头衔，只要你在任何一种高速和多协议的复杂系统中使用了FPGA，你就很可能需要努力解决好器件配置、电源管理、IP集成、信号完整性和其他的一些关键
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FPGA 工程师 系统设计
将具有信号处理功能的FPGA与现实世界相连接，需要使用模数转换器(ADC)或数模转换器(DAC)一旦执行特定任务，FPGA系统必须与现实世界相连接，而所有工程师都知道现实世界是以模拟信号而非数字信号运转的。这意味着需要
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FPGA ADC DAC 工程师
致力于提供功率管理、安全、可靠与高性能半导体技术产品的领先供应商美高森美公司(Microsemi Corporation，纽约纳斯达克交易所代号：MSCC)为其抗辐射(radiation-hardened)解决方案产品组合增添两款用于航天、商业航空和国防应用的全新超低压降(Ultra-low dropout, ULDO)线性负载点(POL)调节器。
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美高森美 FPGA
滤波器是任何信号处理系统的关键组成部分，随着现代应用的日趋复杂，滤波器设计的复杂程度也日益提高。采用 FPGA 设计和实现的高性能滤波器的能力是模拟方法所望尘莫及的。另外，采用FPGA 设计的数字滤波器可以避免模
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FPGA 数字信号处理 滤波器
数字硬盘录像机是一种性价比很高的视频监控解决方案，具有对图像/语音进行长时间录像、录音、远程监控和控制...
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DSP FPGA 视频编码器
演示程序
设计工具对于选择FPGA进行设计是非常重要的一个部分，Xilinx公司提供了强大的集成设计工具ISE Design Suite。Spartan-6系列FPGA芯片也是适用于Xilinx所倡导的目标设计平台，丰富的IP资源是设计变得更加灵活、方便。Digilent也提供了丰富的Demo程序和参考设计，可以在其官网免费下载。
本文的演示程序分为两种版本，分别基于ISE和EDK。可以了解如何在ISE环境下进行FPGA的设计以及如何用EDK搭建系统平台。该演示程序主要是如何控制N
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Digilent FPGA
针对目前广泛对高精度频率源的需求，利用FPGA设计一种恒温晶振频率校准系统。系统以GPS接收机提供的秒脉冲信号为基准源，通过结合高精度恒温晶振短期稳定度高与GPS长期稳定特性好、跟踪保持特性强的优点，设计数字锁相环调控恒温晶振的频率。详细阐述系统的设计原理及方法，测试结果表明，恒温晶振的频率可快速被校准到10 MHz，频率偏差小于0．01Hz，具有良好的长期稳定性，适合在多领域中作为时间频率的标准。
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频率校准 恒温晶振 数字锁相环 FPGA
在Altera宣布进入采用英特尔的14奈米三闸极电晶体制程后，赛灵思(Xilinx)也不甘示弱，宣布进入全新的产品线进入台积电(TSMC)20奈米的投片时程，并于今年第四季取得少量样本，明年第一季正式进入量产时程。
然而，同样也是采取台积电的20奈米制程，Altera旗下的Arria10FPGA，则是在2014年初提供样本贩售，单以台积电的20奈米制程的进度上来说，Altera落后赛灵思约有一季的时间。但相对的，Altera在14奈米三闸极电晶体制程，向英特尔靠拢，将于今年提供测试晶片。就这方面
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Altera FPGA
All Programmable FPGA、SoC和3D IC的全球领先企业赛灵思公司 (Xilinx, Inc. (NASDAQ:XLNX) )日前宣布，延续28nm工艺一系列行业创新，在20nm工艺节点再次推出两大行业第一：投片半导体行业首款20nm器件，也是可编程逻辑器件(PLD)行业首款20nm All Programmable器件;发布行业第一个ASIC级可编程架构UltraScale™。
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赛灵思 ASIC UltraScale
一.面积与速度的平衡互换原则
这里的面积指的是FPGA的芯片资源，包括逻辑资源和I/O资源等;这里的速度指的是FPGA工作的最高频率(和DSP或者ARM不同，FPGA设计的工作频率是不固定的，而是和设计本身的延迟紧密相连)。 在实际设计中，使用最小的面积设计出最高的速度是每一个开发者追求的目标，但是“鱼和熊掌不可兼得”，取舍之间展示了一个开发者的智慧。
1.速度换面积
速度优势可以换取面积的节约。面积越小，就意味着可以用更低的成本来实现产品的功能。速度换面积的
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FPGA DSP
工业、航空航天和国防系统中常见之 24V 至 28V 中间总线与新式数字处理器之输入电源电压之间不断加大的差距带来了设计风险，有可能轻易导致系统故障、有毒烟雾甚至更加糟糕的火灾。
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凌力尔特 FPGA
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