- Altera公司今天宣布提供第二代Nios® II嵌入式评估套件(NEEK)，它安装了Altera的非易失MAX® 10 FPGA以及Nios II软核嵌入式处理器。MAX 10 NEEK是功能丰富的平台，为嵌入式设计人员体验非易失FPGA的定制嵌入式处理器功能提供了简单便捷的方法。MAX 10 NEEK是由Altera及其电路板合作伙伴Terasic联合开发的。
MAX 10 NEEK结合了基于MAX 10 FPGA的电路板以及一个7英寸5点多点触摸显示屏。嵌入式开发人员可
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Altera MAX 10
- 最近，航天子系统采用的先进半导体最底限是需有多个低电压、具高电流轨条件，例如核心电压小于1伏特(V)/30安培(A)的现场可编程门阵列(FPGA)。此外，各个负载也须具有独特的排序、暂瞬、线路与负载调节的要求，这样会让配电网络的设计变得更复杂。
目前航天总线提供28和100伏特不稳定的电源轨，可用于为最新的航天级半导体生成隔离的、有效率的稳压电源。为满足未来航天子系统的需求，开发一个低成本、可扩展的配电架构，且可重复的设计是寻求从28或100伏特两种输入中，可有效地生成多个较小的电轨，并同时限制
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FPGA PCB
- 尽管很多人听说过FPGA和CPLD，但是关于FPGA与CPLD之间的区别，了解的人可能不是很多。虽然FPGA与CPLD都是“可反复编程的逻辑器件”，但是在技术上却有一些差异。简单地说，FPGA就是将CPLD的电路规模、功能、性能等方面强化之后的产物。(特权同学版权所有)
一般而言， FPGA与CPLD之间的区别如表1.1所示。(特权同学版权所有)
表1.1 FPGA和CPLD的比较
总而言之，FPGA和CPLD最大的区别是他们的存储
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FPGA CPLD
- 当前对于各种加密算法。除了有针对性的破解算法，最基本的思想就是穷举密钥进行匹配，通常称为暴力破解算法。由于暴力破解算法包含密钥个数较多，遍历的时间超过实际可接受的范围。如果计算速度提高到足够快。这种遍历的算法因结构设计简便而具有实际应用的前景。
PCI总线(外设互联总线)与传统的总线标准——ISA总线(工业标准结构总线)相比，具有更高的传输率(132MBps)、支持32位处理器及DMA和即插即用等优点，用于取代ISA总线而成为目前台式计算机的事实I/O总线标准，在普通PC
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FPGA PCI
- FPGA丰富的逻辑资源、充沛的I/O引脚以及较低的功耗，被广泛应用于嵌入式系统和高速数据通信领域。现如今，各大FPGA生产厂商为方便用户的设计和使用，提供了较多的、可利用的IP核资源，极大地减少了产品的开发周期和开发难度，从而使用户得以更专注地构思各种各样创意且实用的功能，而不是把大量时间浪费在产品的调试和验证中。
千兆以太网技术在工程上的应用是当前的研究热点之一。相比于其他RS-232或RS-485等串口通信，千兆以太网更加普及和通用，可以直接与Internet上的其他终端相连;相比于百兆网络
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FPGA DDR2
- 研发成本居高不下，再加上物联网时代的到来，国际芯片产业近日再一次迎来并购高潮，寡头垄断趋势加剧。对于中国芯片产业来说，国际并购潮在带来更多机遇的同时，也在提醒人们，单纯买技术、专利的老路已经走不通。
全球芯片业并购潮再起
近日，美国芯片巨头英特尔公司宣布，以总价167亿美元收购编程逻辑芯片的领头厂商阿尔特拉(Altera)。此次收购创造了英特尔并购史上的最大金额纪录。英特尔收购阿尔特拉只是最新一波全球芯片并购浪潮的浪花。今年3月，新加坡安华高科技以370亿美元的现金和股票收购芯片厂商博通;
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英特尔 Altera
- Altera公司今天宣布，公司加入了NFV开放平台(OPNFV)，这是运营商级、集成、开源的灵活平台，旨在使用NFV(网络功能虚拟化)加速新产品和服务的推出。作为一个开源项目，OPNFV定位于把标准组织、开源社区和商业提供商的工作整合起来，为业界提供事实上的标准开源NFV平台。
NFV使用IT虚拟化技术将整个网络节点功能虚拟化为构建模块，进行连接或者构成链路，建立通信服务。Altera将参加OPNFV内部工作组，将FPGA加速器应用扩展到虚拟机中，在业界标准的大批量服务器、存储和云计算基础设施顶
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Altera OPNFV
- 因为硬件有了更多的模块，及其解决方案，给人一种假象：硬件设计好像很简单的一样，实际呢，硬件设计才真正是考验功底的。
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硬件设计 FPGA
- 英特尔和Altera传出收购消息以后，分分合合好几次。导致我买的股票上涨了5美元，我奖励自己吃了一顿麦当劳，但是这些消息对于被收购前的Altera可能更有价值。
2008年1月16日，我在一次发布会上和英特尔的战略市场人员讨论过嵌入式市场。这更像是一场盘问，英特尔提出了一些开放性问题，如发展趋势、竞争格局，但是没有谈到收购，因为英特尔当时不对自己的信息做分享。我不经意提到了“SoC可重构”的概念，把一个FPGA设置在一个处理器附近可以加速后面的I/O速度,听完以后大部分人
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ARM Altera
- Altera公司开发了基于其Arria® 10 SoC的存储参考设计，与目前的NAND闪存相比，NAND闪存的使用寿命将加倍，程序擦除周期数增加了7倍。参考设计在经过优化的高性价比单片解决方案中包括了一片Arria 10 SoC和集成双核ARM® Cortex®A9处理器，同时采用了Mobiveil的固态硬盘(SSD)控制器，以及NVMdurance的NAND优化软件。这一参考设计提高了NAND应用的性能和灵活性，同时延长了数据中心设备的使用寿命，从而降低了NAND阵列的成本。
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Altera FPGA
- Altera公司今天宣布，任命庄秉翰先生为亚太区副总裁兼总经理。在这一职位上，庄先生将负责领导Altera公司亚太区的销售业务，在香港办公。庄先生曾担任Altera日本公司的总裁。
对于此次任命，Altera全球销售和技术服务资深副总裁Mark Nelson说：“多年来，他一直专注于服务客户以及Altera业务的增长，为Altera的销售和FAE组织做出了重要贡献。我们非常高兴将他丰富的经验带到Altera亚太区的这个重要的管理职位上来。”
庄秉翰先生表示：&l
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Altera
- 本文档主要讲解实现一个1024点的16位正弦波数据的生成，并将该数据制作成quartus II使用的mif文件，使用此文件，我们便可以使用FPGA，基于直接数字合成(DDS)原理生成标准的正弦波，即实现信号发生器的功能。小梅哥的DDS实验已经做完，目前还没有进行文档的编写。朋友今天邀请我为他制作一个1024点的16位的正弦波mif文件，实现之后，发现过程中涉及到MATLAB软件、Excel软件、Quartus II软件的使用，每个过程简单，但是步骤较多，因此在这里以文档的方式记录下来，分享给需要的朋友
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FPGA mif
- 本文介绍了一种以FPGA为基础的数字密码锁。采用自顶向下的数字系统设计方法，将数字密码锁系统分解为若干子系统，并且进一步细划为若干模块，然后用硬件描述语言VHDL来设计这些模块，同时进行硬件测试。测试结果表明该数字密码锁能够校验10位十进制数字密码，且可以预置密码，设有断电保护装置，解码有效指示等相应功能。
1功能概述
(1)密码锁的工作时钟由外部晶振提供，时钟频率为50MHz，运算速度高，工作性能稳定。
(2)密码的设置和输入由外接键盘完成，控制电路的安全系数高，操作方便;
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FPGA 数字密码锁
- 即将于2015年秋天提供Stratix 10 FPGA和SoC工程样片的Altera公司，近日发布其Stratix 10 FPGA和SoC体系结构和产品细节，在性能、集成度、密度和安全特性方面实现了突破。 Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex FPGA架构，由Intel 14nm三栅极工艺技术制造，内核性能是前一代FPGA的2倍。性能好、密度高、具有先进的嵌入式处理功能的FPGA与GPU类浮点计算性能和异构3D SiP集成特性相结合，支持Altera客户
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Stratix 10 FPGA SoC工程样片 Altera 201507
- Altera公司今天宣布，任命庄秉瀚先生为亚太区副总裁兼总经理。在这一职位上，庄先生将负责领导Altera公司亚太区的销售业务，在香港办公。庄先生曾担任Altera日本公司的总裁。
对于此次任命，Altera全球销售和技术服务资深副总裁Mark Nelson说：“多年来，他一直专注于服务客户以及Altera业务的增长，为Altera的销售和FAE组织做出了重要贡献。我们非常高兴将他丰富的经验带到Altera亚太区的这个重要的管理职位上来。”
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Altera
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