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硬件描述语言(hdl) 文章 进入硬件描述语言(hdl)技术社区

基于Verilog HDL语言的CAN总线控制器设计及验证

  • 摘要：在此利用Verilog HDL设计了一款CAN总线控制器，首先根据协议把整个CAN总线控制器划分为接口逻辑管理、寄存器逻辑和CAN核心模块3个模块，然后用Verilog HDL硬件描述语言设计了各个功能模块，并使用Modelsim软件
  • 关键字： 控制器  设计  验证  总线  CAN  Verilog  HDL  语言  基于  

MATHWORKS推出基于MATLAB生成HDL代码的产品

  • MathWorks近日宣布推出HDL Coder，该产品支持MATLAB 自动生成 HDL 代码，允许工程师利用广泛应用的 MATLAB 语言实现 FPGA 和 ASIC 设计。MathWorks还宣布推出了HDL Verifier，该产品包含用于测试 FPGA 和 ASIC 设计的 FPGA 硬件在环功能。有了这两个产品，MathWorks现在可提供利用 MATLAB 和 Simulink 进行 HDL 代码生成和验证的能力。
  • 关键字： MathWorks  FPGA  HDL  

基于XCR3032的大容量FLASH存储器接口设计

  • 摘要：提出一种使用Xilinx公司生产的低功耗CPLD芯片XCR3032来实现微控制器与大容量FLASH存储器相接口的...
  • 关键字： XCR3032  FLASH存储器  K9K1G08U0M  Verilog  HDL  

学习FPGA应注意的问题

  • FPGA的基础就是数字电路和HDL语言，想学好FPGA的人，建议床头都有一本数字电路的书，不管是哪个版本的，这个是基础，多了解也有助于形成硬件设计的思想。在语言方面，建议初学者学习Verilog语言，VHDL语言语法规范严格，调试起来很慢，Verilog语言容易上手，而且，一般大型企业都是用Verilog语言。
  • 关键字： 赛灵思  FPGA  HDL  

基于Verilog HDL的I2C总线分析器

  • 提出了采用VerilogHDL设计I2C总线分析器的方法，该I2C总线分析器支持三种不同的工作模式：被动、主机和从...
  • 关键字： Verilog  HDL  I2C总线分析器  

Verilog HDL阻塞属性探究及其应用

  • Verilog HDL中，有两种过程赋值方式，即阻塞赋值(blocking)和非阻塞赋值(nonblocking)。阻塞赋值执行时，RHS(right hand statement)估值与更新LHS(left hand statement)值一次执行完成，计算完毕，立即更新。在执行时
  • 关键字： Verilog  HDL  阻塞属性    

基于Verilog HDL滤波器的设计

  • 　现代计算机和通信系统中广泛采用数字信号处理的技术和方法，其基本思路是先把信号用一系列的数字来表示，然后对这些数字信号进行各种快速的数学运算。其目的是多种多样的，有的是为了加密，有的是为了去掉噪声等无
  • 关键字： 设计  滤波器  HDL  Verilog  基于  

ST-BUS总线接口模块的Verilog HDL设计

  • ST-BUS总线接口模块的Verilog HDL设计,ST-BUS是广泛应用于E1通信设备内部的一种模块间通信总线。结合某专用通信系统E1接口转换板的设计，本文对ST-BUS总线进行了介绍，讨论了ST-BUS总线接口收发模块的设计方法，给出了Verilog HDL实现和模块的时序仿真图。
  • 关键字： HDL  设计  Verilog  模块  总线  接口  ST-BUS  

PLD/FPGA硬件语言设计verilog HDL

  • PLD/FPGA硬件语言设计verilog HDL,HDL概述　　随着EDA技术的发展，使用硬件语言设计PLD/FPGA成为一种趋势。目前最主要的硬件描述语言是VHDL和verilog HDL及System Verilog。 VHDL发展的较早，语法严格;而Verilog HDL是在C语言的基础上发展起来的一种硬
  • 关键字： verilog  HDL  设计  语言  硬件  PLD/FPGA  

Verilog HDL与VHDL及FPGA的比较分析

  • Verilog HDL与VHDL及FPGA的比较分析,　Verilog HDL　　优点：类似C语言，上手容易，灵活。大小写敏感。在写激励和建模方面有优势。　　缺点：很多错误在编译的时候不能被发现。　　VHDL　　优点：语法严谨，层次结构清晰。　　缺点：熟悉时间长，不够灵
  • 关键字： 比较  分析  FPGA  VHDL  HDL  Verilog  

嵌入式系统设计方法的演化—从单片机到单片系统

基于FPGA的步进电机加减速控制器的设计

基于Verilog HDL的UART模块设计与仿真

  • 摘要：通用异步收发器UART常用于微机和外设之间的数据交换，针对UART的特点，提出了一种基于Ver4log HDL的UART设计方法。采用自顶向下的设计路线，结合状态机的描述形式，使用硬件描述语言设计UART的顶层模块及各个子
  • 关键字： Verilog  UART  HDL  模块设计    

基于FPGA和DDS的信号源设计

  • 基于FPGA和DDS的信号源设计,1 引言
    直接数字频率合成DDS(Direct Digital Synthesizer)是基于奈奎斯特抽样定理理论和现代器件生产技术发展的一种新的频率合成技术。与第二代基于锁相环频率合成技术相比，DDS具有频率切换时间短、频率分辨率
  • 关键字： 设计  信号源  DDS  FPGA  基于  FPGA，DDS，Verilog HDL  

Altium加快其软件更新步伐

  • 　　Altium继续在其下一代电子产品设计软件Altium Designer中提供新功能，帮助电子产品设计人员站在新科技和潮流的最前沿。 　　Altium公司首席执行官Nick Martin表示：“我们认为，让用户等待每隔数年才更新一次版本的产业模型已经完全不符合当前的需求。” 　　此次最重要的新特性是基于网络的软件许可证管理和访问选项。它使电子产品设计人员能够有效地管理设计团队、工作量及项目。 　　Altium Designer中的其他新特性包括针对板卡级设计人员的定制FP
  • 关键字： Altium  电子产品设计  FPGA  HDL  
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硬件描述语言(hdl)介绍

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