基于PCI 9052总线的高速噪声检测系统

　　3. 逻辑控制电路

　　逻辑控制电路的作用是用于产生目标设备准备好信号LRDYi#。在MAX 1446完成一个A/D转换后,使目标设备准备好信号LRDYi#有效,表明数据已经在数据线上,通知主设备可以从数据线上读取数据了。

　　由于MAX 1446的数据转换时间需要5.5个时钟周期,因此采用一个模6计数器作为控制电路,以保证在数据转换完成后,才产生LRDYi#。

　　数据采集卡原理图

　　数据采集卡原理图如图2所示。

　　对原理图有以下几点说明。

　　(1)设计中采用9052的非复用模式,因此将MODE接地,所以9052的LAD[31..0]上只有数据信息,而其地址信息在LA[27..0]上,又由于MAX1446的转换位数为10bit,因此将该10位输出数据D[9..0]连接到PCI 9052的LAD[9..0],而LAD[31..10]接地。

　　(2)A/D变换器MAX 1446的时钟频率可高达60MHz。在设计中将PCI总线时钟(33MHz)作为A/D的时钟信号,从而简化了A/D的时钟电路。为了保证LRDYi#信号的产生同MAX 1446的转换同步,模6计数器的时钟信号也采用PCI总线的时钟信号。

　　(3)数据采集的速率的控制是通过上层的软件完成的。在设计中,将PCI 9052的局部总线端的输出信号CS0#作为A/D的使能信号,驱动A/D的转换功能。CS0#是PCI 9052局部总线端的一个通用片选信号,它是在配置寄存器编程指定的。通过上层软件对CS0#低电平产生的时间间隔的控制,即可实现实现对A/D采样速率的控制。由于A/D转换需要5.5个