- 随着快速傅里叶变化(FFT)在信号处理应用领域的广泛应用，不同场合对硬件实现的 FFT 算法结构提出了多样化的要求，针对这种需求在硬件编程设计中将 FFT 分割成模块化的三部分：数据存储重排模块、旋转因子调用模块、蝶形运算模块。通过时序调用可组成不同结构的 FFT 处理器，实现流水结构与递归结构两种方案，分别侧重于处理速度与资源占用量两方面的优势。在FPGA硬件设计中使用 Verilog 语言完成代码编程，实现了两种结构的 512 点基 2 算法的快速傅里叶变换，使用 Modelsim 完成功能仿真。与
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FFT 硬件实现 基 2 算法 模块化设计 流水线结构 递归结构 201902
- 着重讨论基于FPGA的64点高速FFT算法的实现方法。采用高基数结构和流水线结构，大大提高了FFT处理器的运行速度。同时块浮点结构的引入，也大幅减少了浮点操作占用FPGA器件的资源数目，兼顾了FPGA高精度、低资源、低功耗的特点。
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高速FFT算法 高基数结构 FPGA 流水线结构
- MSL4163提供1MHz I2C串口，器件包括先进的PWM引擎以及片上EEPROM等。主要用在电视和台式电脑监视器、医疗、工业仪表和汽车音/视频显示器。本文介绍了MSL4163/MSL4164主要特性、方框图和典型应用电路、级联连接电路。
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3GPP协议 流水线结构 FPGA
- 摘要：本文介绍了一款高速率、高精度、基于流水线结构的A／D转换芯片THS1206；并基于红外成像系统，详细介绍了该款芯片的基本结构、主要特点、应用要点及软硬件设计方案。实际测试表明，THS1206较好地实现了红外成像
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A／D转换器 流水线结构 红外成像系统 高数据率
- 摘要：在应用FPGA进行DDS系统设计过程中，选择芯片的运行速度优化和资源利用优化常常是相互矛盾的，从发展趋势和运算要求看，系统速度指标的意义比面积指标更趋重要。基于此，介绍了一种流水线结构来优化传统的相位累
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DDS 流水线结构 多功能 信号发生器
- 提出一种采用三级流水线型结构的9位100 MSPS折叠式A／D转换器，具体分析了其内部结构。电路使用0．6μm Bipolar工艺实现，由5 V／3．3V双电源供电，经优化设计后，实现了9位精度。100MSPS的转换速度，功耗为650mW，差分输入范围2．2V。给出了在Cadence Spectre的仿真结果，讨论了流水线A／D转换器设计的关键问题。
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MSPS 100 D转换 流水线结构
- 设计实现了基于FPGA的256点定点FFT处理器。处理器以基-2算法为基础，通过采用高效的两路输入移位寄存器流水线结构，有效提高了碟形运算单元的运算效率，减少了寄存器资源的使用，提高了最大工作频率，增大了数据吞吐量，并且使得处理器具有良好的可扩展性。详细描述了具体设计的算法结构和各个模块的实现。设计采用Verilog HDL作为硬件描述语言，采用QuartusⅡ设计仿真工具进行设计、综合和仿真，仿真结果表明，处理器工作频率为72 MHz，是一种高效的FFT处理器IP核。
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FPGA FFT 移位寄存器 流水线结构
- 摘 要： 设计了一种应用于多标准收发器的可重构流水线结构模数转换器，通过一个重构配置控制信号动态地配置采样频率的大小及分辨率的位数，以满足不同标准及系统的需要。在设计中还采用了共源共栅两级运放和差分
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可重构 流水线结构 模数转换器
流水线结构介绍
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