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DSP架构 数字PLL 数字振荡器
- 多年以来，作为业界主流产品的模拟PLL已被熟知，模拟PLL性能稳定，可为频率合成和抖动消除提供低成本的解决方案，工作频率高达8GHz及以上。然而新兴的基于直接数字频率合成（DDS）的数字PLL在某些应用中极具竞争力。
数字PLL利用数字逻辑实现传统的PLL模块。虽然实现数字PLL的方法有很多，但本文只介绍基于DDS的数字PLL架构。
图1 典型的模拟PLL结构框图
图1所示的是典型的模拟PLL。输入信号首先进入参考分频器，参考分频器可降低输入鉴相器的信号频率。在PLL中，参考分频器的
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DDS 数字PLL
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