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CMOS 2.0：后纳米芯片时代的分层逻辑

• 五十多年来，半导体行业一直依赖一个简单的方程式——缩小晶体管，在每片晶圆上封装更多晶体管，并随着成本的下降而看到性能飙升。虽然每个新节点在速度、能效和密度方面都提供了可预测的提升，但这个公式正在迅速耗尽。随着晶体管接近个位数纳米工艺，制造成本正在飙升，而不是下降。电力传输正在成为速度与热控制的瓶颈，定义摩尔定律的自动性能提升正在减少。为了保持进步，芯片制造商已经开始抬头看——字面意思。他们不是将所有内容都构建在一个平面上，而是垂直堆叠逻辑、电源和内存。虽然 2.5D 封装已经将其中一些投入生产，将芯片并排
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