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基于VHDL的Petri网系统的FPGA实现

1引言Petri网是一种系统的、数学的和图形的描述和分析工具[1],随着超大规模集成电路FPGA和CPLD的发展,Petr...
关键字： VHDL Petri

基于VHDL的4PSK调制器设计与仿真

阐述了4PSK调制器的基本原理，给出调制系统设计框图。在MAX+plusII环境下，利用VHDL语言实现了4PSK调制器设计，并对系统的各模块仿真。采用VHDL模块化和自上而下的设计方法，提高了系统的稳定性和可靠性。
关键字： VHDL 4PSK 制器设计仿真

VHDL密码控制系统的设计和仿真

1 引言　　随着电子技术和ASIC技术的发展．数字系统设计向速度快、容量大、体积小、重量轻的趋势发展。目前数字系统设计可直接面向用户需求，根据系统的行为和功能要求，自上而下地逐层完成设计过程：描述、综合、优化、仿真与验证，以及器件生成。该设计过程除系统行为和功能描述外，其他设计几乎都由计算机自动完成，从而实现电子设计自动化(EDA)。这样大大地缩短了系统的设计周期，适应当今品种多、批量小的电子市场要求，提高了产品的竞争能力。由于电子设计自动化是采用硬件描述语言描述硬件电路，所以研究硬件语言及仿真、综合
关键字： VHDL EDA

基于单片机和CPLD的数字频率计的设计

　　引言　　在传统的控制系统中，通常将单片机作为控制核心并辅以相应的元器件构成一个整体。但这种方法硬件连线复杂、可靠性差，且在实际应用中往往需要外加扩展芯片，这无疑会增大控制系统的体积，还会增加引入干扰的可能性。对一些体积小的控制系统，要求以尽可能小的器件体积实现尽可能复杂的控制功能，直接应用单片机及其扩展芯片就难以达到所期望的效果。　　复杂可编程逻辑器件（CPLD）具有集成度高、运算速度快、开发周期短等特点，它的出现，改变了数字电路的设计方法、增强了设计的灵活性。基于此，本文提出了一种采用Alt
关键字： CPLD 开发环境单片机元器件 VHDL ASIC

VHDL设计中电路简化问题的探讨

　　近年来，随着集成电路技术的发展，用传统的方法进行芯片或系统设计已不能满足要求，迫切需要提高设计效率。在这样的技术背景下，能大大降低设计难度的VHDL设计方法正越来越广泛地被采用。但是VHDL设计是行为级的设计?熕?带来的问题是设计者的设计思考与电路结构相脱节。设计者主要是根据VHDL的语法规则，行为进行描述，综合工具进行电路结构的综合、编译、优化，通过仿真工具进行逻辑功能仿真和系统时延的仿真。实际设计过程中，由于每个工程师对语言规则、对电路行为的理解程度不同，每个人的编程风格不同，往往同样的系统功能，
关键字： VHDL 电路集成电路

基于Modelsim FLI接口的FPGA仿真技术

　　1、Modelsim 及 FLI接口介绍　　Modelsim是 Model Technology（Mentor Graphics的子公司）的 HDL 硬件描述语言仿真软件，可以实现 VHDL, Verilog，以及 VHDL-Verilog 混合设计的仿真。除此之外，Modelsim还能够与 C 语言一起实现对 HDL 设计文件的协同仿真。同时，相对于大多数的 HDL 仿真软件来说，Modelsim 在仿真速度上也有明显优势。这些特点使 Modelsim 越来越受到 EDA设计者、尤其是 FPGA
关键字： FPGA 仿真 Modelsim FLI VHDL

SDRAM接口的VHDL设计

　　RAM（随机存取存储器　是一种在电子系统中应用广泛的器件，通常用于数据和程序的缓存。随着半导体工业的发展，RAM获得了飞速的发展，从RAM、DRAM(Dynamic RAM，即动态RAM)发展到SDRAM(Synchronous Dynamic RAM，即同步动态RAM)，RAM的容量越来越大、速度越来越高，可以说存储器的容量和速度已经成为半导体工业水平的标志。　　１任务背景　　SDRAM具有大容量和高速的优点，目前其存取速度可以达到100～133MHz，单片容量可以达到64Mbit或更高
关键字： VHDL SDRAM 存储器微处理器

基于SystemC的系统级芯片设计方法研究

　　随着集成电路制造技术的迅速发展,SOC设计已经成为当今集成电路设计的发展方向。SO C设计的复杂性对集成电路设计的各个层次,特别是对系统级芯片设计层次,带来了新挑战，原有的HDL难以满足新的设计要求。　　硬件设计领域有2种主要的设计语言：VHDL和Verilog HDL。而两种语言的标准不统一，导致软硬件设计工程师之间工作交流出现障碍,工作效率较低。因此，集成电路设计界一直在寻找一种能同时实现较高层次的软件和硬件描述的系统级设计语言。Synopsys公司与Coware公司针对各方对系统级设计语言的
关键字： SOC SystemC 集成电路 VHDL Verilog HDL

SVPWM信号发生器的VHDL实现

　　近年来，DSP在SVPWM(空间矢量脉宽调制)控制领域得到了广泛应用。　　但是使用DSP单核心的控制方法仍然存在一些缺陷：基于软件的：DSP在实现SVPWM触发信号时需要较长的时钟周期；微处理器中不确定的中断响应会导致PWM脉冲的相位抖动。针对以上问题，本文提出了一种利用FPGA实现的SVPWM信号发生器，系统结构如图1所示。作为DSP的外围接口电路，该信号发生器能够屏蔽DSP内部错误中断对输入时间信号的影响，保证输出完整的SVPWM触发信号波形，其三相并行处理结构还能够有效提升系统的动态响应速度
关键字： DSP SVPWM VHDL 信号发生器

简易通用型PCI接口的VHDL-CPLD设计

　　用CPLD设计所构成的CPI接口系统具有简洁、可靠等优点，是一种行之有效的设计途径。很多技术杂志和网站上，都有不少用CPLD设计PCI常规传输系统的文章。但用这些方法在MzxPlusII、Fundition等环境下进行模拟仿真时，其产生的时序往往与PCI规范有很大出入。虽然 Altera 等公司推出PCI核可以直接使用，但这样的内核占用CPLD资源较多，且能适配的器件种类少，同时价格也高，在实际设计应用中有很大的局限性。因此，使用通用型CPLD器件设计简易型PCI接口有很大的现实意义。在Compact
关键字： VHDL-CPLD

AC-Link数字音频VHDL编/解码的FPGA设计

　　引言　　数字音频处理是指为真实再现声音的逼真效果而对音频进行的编解码处理技术,它是宽带网络多媒体、移动多媒体通信的关键技术.Audio Codec′97(音频数字信号编/解码器)是其中一种用于声音录放的技术标准,简称AC′97. AC′97采用双集成结构,即Digital Controller(数字信号控制器)和Audio Codec(音频编解码),使模/数转换器ADC和数?模转换器DAC转换模块独立,尽可能降低EMI(电磁干扰)的影响。　　利用FPGA,可
关键字： FPGA VHDL

AC-Link数字音频VHDL编/解码的FPGA设计

提出一种利用FPGA实现AC-Link数字音频处理的设计方案.AC-Link音频编解码系统以VHDL模块进行设计,经过波形仿真和结果验证后,将程序下载到FPGA中实现1这种设计方法可以缩短设计周期,提高设计的可靠性和效率。　　引言数字音频处理是指为真
关键字： AC-Link VHDL FPGA

基于现场可编程门阵列的数控延时器的设计

　　l 引言　　利用硬件描述语言结合可编程逻辑器件(PLD)可以极大地方便数字集成电路的设计，本文介绍一种利用VHDL硬件描述语言结合现场可编程门阵列(FPGA)设计的数控延时器，延时器在时钟clk的作用下，从8位数据线输入延时量，到LATCH高电平时锁存数据，可以实现对触发脉冲TRIG的任意量的延时。由于延时范围不同，设计所用到的FPGA的资源也不同，本文详细介绍最大延时量小于触发脉冲周期的情况。该延时器的软件编程和调试均在MuxplusⅡ环境下完成，系统设计选用Altera公司的EPFl0K30A
关键字： VHDL 现场可编程门阵列

一种用VHDL设计实现的有线电视机顶盒信源发生方案

　　VHDL是随着可编辑逻辑器件(PLD)的发展而发展起来的一种硬件描述语言。它是1980年美国国防部VHSIC(超高速集成电路)计划的一部分，并于1986年和1987年分别成为美国国防部和IEEE的工业标准。作为一种硬件设计时采用的标准语言，VHDL具有极强的描述能力，能支持系统行为级、寄存器传输级和门级三个不同层次的设计，这样设计师将在TOP-DOWN设计的全过程中均可方便地使用同一种语言。而且，VHDL设计是一种“概念驱动式”的高层设计技术，设计人员毋需通过门级原理图描述电路
关键字： VHDL

使用VHDL语言设计FPGA的几个常见问题的探讨

详细讨论了在MAX plusⅡ开发平台下使用VHDL硬件描述语言设计现场可编程门阵列(FP-GA)时常见的三个问题：等占空比分频电路、延时任意量的延时电路、双向电路。 1 引言随着EDA技术的发展，使用硬件语言设计可编程逻辑器件(PLD)/现场可编程门阵
关键字： VHDL FPGA 问题

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