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基于CPLD的水下冲击波记录仪的设计

  • 基于CPLD的水下冲击波记录仪的设计,1.引言
      
    随着大规模集成电路和单片机的迅速发展,复杂可编程逻辑器件(CPLD)具有使用灵活、可靠性高、功能强大的优点,在电子产品设计中得到了广泛的应用。CPLD可实现在系统编程,重复多次,而且还兼容IEEE1
  • 关键字: 记录仪  设计  冲击波  水下  CPLD  基于  

节省电池能量的系统断电电路CPLD

  • 节省电池能量的系统断电电路CPLD,今天,大多数的CPLD(复杂可编程逻辑器件)都采用可减少功耗的工作模式,但当系统未使用时,应完全切断电源以保存电池能量,从而实现很多设计者的终极节能目标。图1描述了如何在一片CPLD 上增加几只分立元件,实现一
  • 关键字: 电路  CPLD  断电  系统  电池  能量  节省  

基于CPLD的专用键盘接口芯片的方案设计

  • 基于CPLD的专用键盘接口芯片的方案设计,在单片机应用系统中,存在多种形式的外部数据输入接口界面,例如RS-232C串行通信、键盘输入等[1,4] 。其中利用键盘接口输入数据,是实现现场实时调试、数据调整和控制最常用的方法。单片机的外围键盘扩展电路有多种实
  • 关键字: 芯片  方案设计  接口  键盘  CPLD  专用  基于  

基于CPLD的数字电压表设计

  • 双积分型ADC具有转换精度高,速度慢的特点,因而被广泛应用于高精度数字仪器仪表中。该设计的主要创新点是以可编程器件(CPL-D)为核心,采用积分电路、检零比较器等组成16位ADC,控制部分采用51单片机,能实现自动量程转换。由于采用了CPLD技术,减少了外界干扰和所占空间,而且大大提高了系统的响应时间,提高了数字电压表的性能。
  • 关键字: CPLD  数字  电压表设计    

用VHDL实现的有线电视机顶盒信源发生方案

  • VHDL是随着可编辑逻辑器件(PLD)的发展而发展起来的一种硬件描述语言。它是1980年美国国防部VHSIC(超高速集...
  • 关键字: PLD  VHDL  机顶盒  信源  

基于CPLD的图像传感器非均匀性校正研究

  • 图像传感器是现代视觉信息获取的一种基础器件,它将入射到光敏面上按空间分布的光强信息转换为按时序输...
  • 关键字: CPLD  图像传感器  非均匀性校正  

基于CPLD/FPGA的CMI编码设计与实现

  • 根据CMI码的特性,介绍了一种新的编程思路实现CMI编码,在Max+PlusⅡ开发平台上使用VHDL编程实现CMI编码,并得到仿真波形。实验结果表明,这种编程思路简单、清晰。在产生7位伪随机序列的前提下,分别对“O”,“1”进行编码。这种思路为其他码型设计提供了参考。
  • 关键字: CPLD  FPGA  CMI  编码    

一种基于CPLD的压电生物传感器检测电路的设计

  • 本文介绍了一种基于复杂可编程逻辑器件(CPLD)的压电生物传感器检测电路.该检测电路以高性能CPLD(MAX7128)为核心,实现了对压电生物传感器10MHz高频信号的测量与采集,以及所采集的频率数据动态、实时显示以及频率数据串行通信等功能.该电路体积小、集成度高,具有可靠性高、实时性高的特点.此外该系统还可以通过RS-232串行接口与计算机连接进行数据传输和数据存储及分析.详细阐明了系统整体结构设计以及系统硬件部分的实现,并给出了CPLD内核仿真结果和数据采集软件实测频率曲线.
  • 关键字: 检测  电路  设计  传感器  生物  CPLD  压电  基于  功率模块  

使用用CPLD和Flash实现FPGA的配置

  • 电子设计自动化EDA(ElectronicDesignAutomation)是指以计算机为工作平台,以EDA软件为开发环境,以硬件描...
  • 关键字: CPLD  FPGA  Flash  RAM  EDA  VHDL  

VHDL语言实现的帧同步算法

  • 数字通信网中,帧同步是同步复接设备中最重要的部分,他包括帧同步码的产生和帧同步码的识别,其中接收端的帧同步识别电路的结构对同步性能的影响是主要的。

    1 工作原理

    实现帧同步的基本方法是在发送端预先规
  • 关键字: 算法  同步  实现  语言  VHDL  

基于VHDL的线性分组码编译码器的研究设计

  • 在通信系统中,由于信道存在大量的噪声和干扰,使得经信道传输后的接收码与发送码之间存在差异,出现误码。在...
  • 关键字: VHDL  编译码器  线性分组码  

基于CPLD器件的单稳态脉冲展宽电路的设计

  • 在数字电路设计中,当需要将一输入的窄脉冲信号展宽成具有一定宽度和精度的宽脉冲信号时,往往很快就想到利...
  • 关键字: FPGA  CPLD  宽脉冲信号  ISP  

基于VHDL语言的99小时定时器设计及实现

  • 0引言传统的定时器硬件连接比较复杂,可靠性差,而且计时时间短,难以满足需要。本设计采用可编程芯片...
  • 关键字: FPGA  VHDL  定时器  EP1C6Q240C8  

基于VHDL的线性分组码编译码器设计

  • 数字信号在传输过程中受到干扰的影响,降低了其传输的可靠性,线性分组码作为一种常用的信道编码,在通信传输系统中应用广泛。在对线性分组码的编译码规则研究基础上,讨论了生成矩阵、监督矩阵与错误图样集之间的关系,在Max+PlusⅡ开发环境中,用VHDL语言设计线性分组码编译码器,对其各项设计功能进行了仿真和验证。结果表明,该设计正确,其功能符合线性分组码编译码器的要求。
  • 关键字: VHDL  线性  分组码  编译码器    
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