- Lattice公司的LatticeECP3 FPGA系列可提供高性能特性如增强的DSP架构，高速SERDES和高速源同步接口。LatticeECP3采用65nm技术，查找表(LUT)高达149k逻辑单元，支持高达486个用户I/O，提供高达320个18times;18乘法器
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Lattice ECP3 FPGA 评估板
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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FPGA Linux 基础架构
- 在芯片的研发环节，FPGA 验证是其中的重要的组成部分，如何有效的利用 FPGA 的资源，管脚分配也是必须考虑的一个重要问题。一般较好的方法是在综合过程中通过时序的一些约束让对应的工具自动分配，但是从研发的时间
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FPGA 分配 管脚
- 0 引言自1992年Jeo Mitola中提出了软件无线电(Software Defined Radio，SDR)的概念以来，有许多公司和团体致力于SDR的研究和开发，并取得了一定成果。但由于没有统一的标准，各研发单位采用各自不同的解决方案和实现
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CORBA FPGA 通信系统 设计方案
- 引言全球可编程平台领导厂商赛灵思(Xilinx)公司今年的市场重点是28nm的7系列产品及Zynq。不久前，Xilinx公司才宣布开始向客户出货首款 Zynq可扩展处理平台(EPP)。那么，Zynq是什么样的产品?为何Xilinx称“Zynq
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ZYNQ FPGA 嵌入式处理器 单芯片
- 过去十年来，车载网络架构变得越来越复杂。虽然车载网络协议的数量有所减少，但实际部署的网络数量却有显著增加。这就提出了网络架构的可缩放性问题，并且要求为满足各种应用和网络的实际需要而优化半导体器件。FPGA
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FPGA 方案 电气 架构设计
- 在FPGA中，动态相位调整(DPA)主要是实现LVDS接口接收时对时钟和数据通道的相位补偿，以达到正确接收的目的。ALTERA的高端FPGA，如STRATIX(r) 系列中自带有DPA电路，但低端的FPGA，如CYCLONE(r)系列中是没有的。本文主
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FPGA LVDS DPA 低端
- DS18B20是DALLAS公司生产的一线式数字温度传感器，采用3引脚TO-92型小体积封装；温度测量范围为-55℃～+125℃，可编程为9位～12位A/D转换精度，测温分辨率可达0.0625℃，被测温度用符号扩展的16位数字量方式串行输出
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FPGA 18B B20 DS
- Q1：FPGA设计与DSP设计相比，最大的不同之处在哪里？A1：这个问题要从多个角度看。它们都用于某个功能的硬件电路实现，但是它们的侧重点有所不同。这里涵盖的说一下。1) 内部资源FPGA侧重于设计具有某个功能的硬件电
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FPGA DSP 角度
- 在通信、广播、电视系统中，都需要射频发射，即载波，把音频、视频信号或脉冲信号运载出去，这就需要能产生高频信号的振荡器。正弦波振荡电路在各个科学技术部门的应用是十分广泛的。在工业、农业、生物医学等领域(如
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FPGA MCU 多功能 正弦信号发生器
- 采用WCDMA速率适配算法的FPGA设计,随着因特网爆炸性的增长以及各种无线业务需求的增加，传统的无线通信网已经越来越无法适应人们的需要。因此，以大容量、高数据率和承载多媒体业务为目的的第三代移动通信系统(IMT-2000)应运而生。码分多址(CDMA)由于
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FPGA 设计 算法 适配 WCDMA 速率 采用
- 低压差分信号LVDS（Low Voltage Differential Signal）是由ANSI/TIA/EIA-644-1995定义的用于高速数据传输的物理层接口标准。它具有超高速（1.4Gb/s）、低功耗及低电磁辐射的特性，是在铜介质上实现千兆位级高速通信的
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及其 外围 电路设计 设计 内核 FPGA LVDS 基于
- 基于微处理器的FPGA的在线可重配置,可编程逻辑器件（PLD）广泛应用在各种电路设计中。基于查找表技术、SRAM工艺的大规模PLD/FPGA，密度高且触发器多，适用于复杂的时序逻辑，如数字信号处理和各种算法的设计。类器件使用SRAM单元存储配置数据。配置数据
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配置 在线 FPGA 微处理器 基于
- 对FPGA设计进行编程并不困难,硬件设计者已经开始在高性能DSP的设计中采用FPGA技术，因为它可以提供比基于PC或者单片机的解决方法快上10-100倍的运算量。以前，对硬件设计不熟悉的软件开发者们很难发挥出FPGA的优势，而如今基于C语言的方法可以让
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困难 编程 进行 设计 FPGA
- 摘要：速度与面积的互换一直是基于FPGA设计中的一个不变的主题，在此介绍了两种YUV分离的FPGA的实现方式：基于面积的实现和基于速度的实现。前者仅用一片双口RAM串行，实现了YUV分离数据的输出；后者利用流水线的思想
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FPGA YUV 分离
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