- 摘要：介绍了软件无线电的思想和结构，提出了一种实现软件无线电试验平台的设计方案，随后对各个模块进行了分析。整个试验平台可以根据用户的需求产生各种调制制式的中频信号；也可以接收各种中频信号，并变频成基
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CPLD 无线
- 摘要：采用MAX II系列CPLD器件来实现LCD控制器。由于MAX II CPLD是唯一具有用户闪存(UFM)的CPLD，因此用一片CPLD 芯片就可完成LCD全部的时序控制、显示控制等功能,这样无需再加入其它的接口器件，使微处理器和LCD显示
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CPLD LCD
- 介绍了14位ADC采样芯片MAX1032的特性及工作原理，结合CPLD，给出MAX1032使用外部时钟模式由CPLD控制采样和存储结果应用方案及CPLD的逻辑设计方法。本方案适用于工业控制，自动测试，数据采集等领域。文中同时给出了使用Verilog编写的CPLD代码及主要原理图。
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1032 CPLD MAX
- FPGA/CPLD设计思想与技巧, 本文讨论的四种常用FPGA/CPLD设计思想与技巧：乒乓操作、串并转换、流水线操作、数据接口同步化，都是FPGA/CPLD逻辑设计的内在规律的体现，合理地采用这些设计思想能在FPGA/CPLD设计工作中取得事半功倍的效果。
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技巧 设计思想 FPGA/CPLD
- 基于MCU和DSP的步进电机控制技术,步进电机也叫步进器，它利用电磁学原理，将电能转换为机械能，人们早在20世纪20年代就开始使用这种电机。随着嵌入式系统(例如打印机、磁盘驱动器、玩具、雨刷、震动寻呼机、机械手臂和录像机等)的日益流行，步进电机
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MCU DSP
- 基于ARM7和CPLD的数字公交站亭系统设计, 摘要：提出了一种基于ARM7 和CPLD 架构的数字公交站亭系统。系统通过GPRS 模块与公交控制中心实时通信，使用CA 认证保证通信的安全性，采用两块SRAM 组成具有“乒乓逻辑”的高速缓存确保显示数据的连续性
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ARM DSP CPLD
- 基于ARM的可定制MCU可承担FPGA的工作,如今的产品生命周期可能短至六个月，因此在这种情况下要想取得定制ASIC的低成本、低功耗和高性能优势几乎是不可能的。定制ASIC的设计周期通常要一年左右，这通常要比终端产品的生命周期还要长。另外，标准单元ASIC还
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ARM MCU FPGA
- 因应MCU成长快速及程序数据储存需要，MCU内嵌Flash内存设计成为主流趋势，MCU大厂也纷纷以购并或结盟掌握内嵌Flash的相关IP与制程技术。本文将探讨内嵌FlashIP制程技术，为下一代FlashMCU带来的技术变革。
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MCU Flash
- 继赛灵思今年年初发布了与ARM的合作计划之后，Altera近日发布了与ARM、英特尔等的合作计划，Actel则被模拟/混合信号公司Microsemi收购，这一系列事件都预示着在微控制器、模拟IC和FPGA领域正出现一些多层次的整合趋势。针对这些整合趋势，FPGA业内的另一些企业如Lattice、SiliconBlue、Acrhonix、Quicklogic和InPa未来会如何?
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ARM FPGA MCU
- 富士通半导体(上海)有限公司与华南理工大学近日在华南理工大学电子与信息学院逸夫科学馆举行了联合实验室揭牌仪式。这是自2008年以来，富士通半导体在中国高校投资成立的又一联合实验室，成为富士通半导体大学计划的又一次重要拓展。新联合实验室的建立，将增强富士通半导体与中国高校间的优势互补，有力地促进中国半导体人才培养和行业发展。
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富士通 MCU 大学
- 身为全球第1大MCU(Micro Controller Unit)供应商，市占率高达30%以上的瑞萨电子(Renesas)，近几年来在全球MCU市场开疆闢士的好表现，足以成为日本科技公司的表率，而日系企业细心、负责、强调质量与效能的特色，更让瑞萨在非常强调服务内容及中、长期合作关系的MCU市场里如鱼得水，并立下5年后在全球MCU市占率达到 35%为目标。
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瑞萨 MCU
- 针对目前靶场测试领域尤其是外弹道测试通常采用人工击发枪械的方式，存在安全性差、无法精确控制等问题，设计一种基于CPLD技术的枪械电磁扳机控制仪。采用步进电机作为执行单元，CPLD作为主控制器实现逻辑控制、通信功能。设计中着重考虑了电磁兼容及安全性，通过机械及电气两部分联锁确保控制仪无误触发。通过靶场试验，该控制仪能够适应靶场电磁环境，而且对其他仪器无干扰，其通信功能还可实现整体测试系统的同步性、自动化、网络化及远程控制。
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CPLD 枪械 电磁 控制仪
- 利用CPLD实现数字滤波及抗干扰,1 滤波和抗干扰概述
单片机应用系统的输入信号常含有种种噪声和干扰，它们来自被测信号源、传感器、外界干扰源等。为了提高测量和控制精度，必须消除信号中的噪声和干扰。噪声有两大类：一类为周期性的；另一类为
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波及 抗干扰 数字 实现 CPLD 利用
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