- 摘要：为了提高红外成像系统图像放大算法的资源利用率和实时性。在此基于传统线性插值算法，充分考虑红外探测器信号的输出方式，并根据红外成像平台的结构特点。提出了一种适用于FPGA的改进型线性插值算法，该算法基
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FPGA 红外图像 放大模块
- 全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc. )11月14日宣布，全球电信设备和网络解决方案上市提供商—中兴通讯，在其基于分组的多业务承载平台中，采用赛灵思的高性能 Virtex-6 FPGA，实现了 100G 以太网业务的部署。
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赛灵思 以太网 Virtex-6 FPGA
- 基于FPGA单芯片四核二乘二取二的安全系统,引 言
二乘二取二系统的两套计算机系统各有两个CPU，并且所有结构和配件完全相同。两套系统之间采取双机热备份，大幅提高了系统可靠性，在一些领域得到了广泛应用。基于二乘二取二容错结构的计算机联锁系统在国
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系统 安全 单芯片 FPGA 基于
- 摘要：针对目前交叉路口交通控制信号灯的绿信比固定不变的问题，提出一种模糊控制的方案。根据当前相位的车流量和当前相位与下一相位车流量之差，实时控制相位绿信比，缩减车辆在交叉路口的排队长度。绿信比可在FPGA
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FPGA 模糊控制 交通灯控制 方案设计
- 基于FPGA的大型LED显示屏系统设计,随着平板显示技术的不断更新，大型LED显示系统利用发光二极管构成的点阵模块或像素单元组成大面积显示屏，主要显示字符、图像等信息，具有低功耗、低成本、高亮度、长寿命、宽视角等优点。近年来广泛应用在证券交易所
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系统 设计 显示屏 LED FPGA 大型 基于
- 新型数据格式转换的FPGA实现,引言 浮点运算作为数字信号处理中最常见的运算之一，各大EDA软件都带有免费的浮点运算IP核。通过对IP核的生成和例化来实现浮点运算，把FPGA设计者从繁重的代码编写中解脱了出来，同时可以对IP核进行功能剪裁以避免
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FPGA 实现 转换 格式 数据 新型
- 摘要：本文针对AAL5业务,采用FPGA实现了AAL层中SAR子层功能和ATM层功能,向下提供UTOPIA主接口与物理层从接口...
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FPGA ATM SAR
- 全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc. )在 2011 年 SCTE 有线电视技术博览会 (SCTE Cable-Tec Expo 2011)上演示了有线电视行业第一个用单个 RF 端口支持多达 160 个正交幅度调制 (QAM )信道的方案，该方案是在基于赛灵思 28nm 7 系列 FPGA上实现的。该技术对多系统运营商 (MSO) 通过现有有线电视前端系统提供更丰富的三重播放业务至关重要，同时也展示了基于 FPGA 的前端设备可以提供关键的器件和信号密度，满足竞争激烈的数据和内容
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Xilinx FPGA RF
- Altera公司(NASDAQ: ALTR)今天发布FPGA和SoC FPGA的开放计算语言(OpenCL™)标准开发计划。OpenCL标准是基于C语言的开放标准，适用于并行编程。Altera的OpenCL计划结合了FPGA的并行能力以及OpenCL标准，实现强大的系统加速功能。与使用Verilog或者VHDL等底层硬件描述语言(HDL)的传统FPGA开发方法相比，这一混合系统(CPU + FPGA，使用OpenCL标准)还具有明显的产品及时面市优势。通过其OpenCL计划，Altera与
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Altera FPGA
- 摘要： 在仪器仪表电路中，人机交互界面是必不可少的环节。为了解决单纯采用单片机制作的系统功耗高、速度慢、 ...
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51单片机 FPGA 人机交互系统
- Altera公司今天发布FPGA和SoC FPGA的开放计算语言(OpenCL™)标准开发计划。OpenCL标准是基于C语言的开放标准，适用于并行编程。Altera的OpenCL计划结合了FPGA的并行能力以及OpenCL标准，实现强大的系统加速功能。与使用Verilog或者VHDL等底层硬件描述语言(HDL)的传统FPGA开发方法相比，这一混合系统(CPU + FPGA，使用OpenCL标准)还具有明显的产品及时面市优势。
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Altera FPGA
- 全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc. )今天宣布，赛灵思联盟计划 (Xilinx Alliance Program)推出高等设计服务成员计划，作为其设计服务成员计划的一个重要扩展，帮助 FPGA 客户加速新产品的开发，并使其更轻松找到满足其设计与开发需求的最佳合作伙伴。
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赛灵思 FPGA
- 引 言 众所周知， 视觉是人类感知世界的最重要的方式， 而现实生活中的所有物质形态都是以三维空间而客观存在。三维显示能真正地再现客观世界的立体空间， 提供更符合人们观察习惯的交流方式， 有助于人们在综合
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FPGA LED 体三维 方案
- 摘要：为了使基于FPGA设计的信号处理系统具有更高运行速度和具有更优化的电路版图布局布线，提出了一种适用于FPGA结构的改进型WALLACE TREE架构乘法器。首先讨论了基于标准单元3：2压缩器的改进型6：4压缩器，根据FP
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WALLACE FPGA TREE 乘法器设计
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