数字系统的设计人员擅长在其印制电路板上用FPGA和CPLD将各种处理器、存储器和标准的功能元件粘合在一起来实现数字设计。除了这些数字功能之外，FPGA和CPLD还可以使用LVDS输入、简单的电阻电容(RC)电路和一些FPGA或CP
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FPGA ADC 高频
“未来赛灵思将不仅仅是一家FPGA的芯片厂商，而是向成为Smarter System All Programmable方案提供商转型，我们将为客户提供交钥匙的解决方案。”提到赛灵思的未来，其亚太区销售与市场副总裁杨飞如是说。
赛灵思的这一蓝图在去年已经初露端倪，而就在最近他们走出了面向具体应用的第一步，即面向FPGA的优势领域--通信网络应用推出了一系列的基于7系列FPGA以及SoC FPGA产品的解决方案。
追根溯源
笔者在这里想带大家一起回溯一下赛灵思的这
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赛灵思 FPGA
上周，京微雅格(北京)科技有限公司参加了在上海举办的慕尼黑电子展 (electronica Shanghai) 展会，现场展示了基于M1(衡山)和M5(金山)芯片的众多系统应用解决方案，包括多媒体人机交互界面、面向工业电子的控制应用，面向医疗电子的应用和面向安防监控的宽动态视频补偿应用等，获得现场观众的极大关注和一致好评，纷纷为终于有了自己的国产FPGA而欢欣鼓舞。
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京微雅格 FPGA M5
引言中国散裂中子源实验的简图如图1所示，其原理是把中子束打在被测样品(例如新药品或机翼材料)上，探测被反射的中子位置就能计算出样品的内部结构图像，其特点如下： A/D采集通道多，每个通道的数据带宽高，且需要把
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Linux FPGA 嵌入式 千兆网
就在不久前Xilinx和Altera两大战车竞相宣布要推出20nm FPGA时，2月底，已声称要做22nm FPGA两年的Achronix公司，正式宣布推出22纳米3D Tri-Gate晶体管的FPGA样片，其Speedster 22i系列HD1000型号的样片已发运给客户，总裁兼CEO Robert Blake称，预计今年2季度底或3季度初将量产，并自己估计在工艺方面领先竞争对手两年。
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Achronix 英特尔 FPGA 201303
一.面积与速度的平衡互换原则这里的面积指的是FPGA的芯片资源，包括逻辑资源和I/O资源等;这里的速度指的是FPGA工作的最高频率(和DSP或者ARM不同，FPGA设计的工作频率是不固定的，而是和设计本身的延迟紧密相连)。 在
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FPGA 系统
研发EHB控制器的关键点在于通过大量测试实验掌握执行元件的工作性能，在模拟环境下有效地进行参数仿真、软件仿真，减少实际路面测试带来的困难，并开发基于虚拟现实技术的混合仿真平台，在不同虚拟环境下由驾驶员产生的的实际操纵动作对EHB快速原型的控制器进行功能验证和逼真的产品性能演示。
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LabVIEW EHB FPGA PWM
莱迪思半导体公司(NASDAQ: LSCC)今日宣布推出iCE40 LP384 FPGA，超低密度FPGA扩展的iCE40系列的最小器件。能够使设计人员快速地添加新的功能，使成本敏感、空间受限、低功耗的产品差异化，新的小尺寸FPGA对许多应用是理想的选择，诸如便携式医疗监护仪、智能手机、数码相机、电子书阅读器和紧凑的嵌入式系统。
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莱迪思 FPGA iCE40
在可靠的通信系统中，要保证接收端能正确解调出信息，必须要有一个同步系统，以实现发送端和接收端的同步，因此同步提取在通信系统中是至关重要的。一个简单的接收系统框图如图1所示。 本文介绍一种基于现场可编程
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FPGA 通信系统
文中介绍了一种基于FPGA的多通道应力应变信号监测系统的设计方案，该系统的研究为一些大型建筑结构由于年代久远而需要维护、维修提供客观依据，主要阐述了前端信号采集电路硬件以及FPGA上各个控制模块的设计，系统可以通过NiosⅡ软核修改FPGA中的各项采样参数，如采样率、采样通道数、起始通道等，来实现对不同对象的应变情况进行实时监测，模拟实验表明系统运行稳定可靠，采集精度高，具有很高的实用价值。
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FPGA 应力 信号监测系统
网络化运动控制是未来运动控制的发展趋势，随着高速加工技术的发展，对网络节点间的时间同步精度提出了更高的要求。如造纸机械，运行速度为1 500～1 800m/min，同步运行的电机之间1mu;s的时间同步误差将造成30 mu;
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FPGA 时钟频率 时间同步
摘要：为了将现有模拟视频系统接入到数字串行视频系统，需要将模拟视频转换成SDI信号。采用SAA7113先将模拟视频数字化，用Altera公司的CYCLONE III系列FPGA完成SDI信号的扰码、编码等功能，接口芯片采用国家半导体公司的LMH0001，使用Tektronix VFM 7120进行测试，信号指标符合SMPTE259M标准。
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FPGA SDI LMH0001 201303
摘要：用FPGA芯片来实现时分复分接技术，设计复用电路和分接电路。发送端完成复用电路。在发送端将一路1024K数据、一路512K数据、7路64K数据通过时分复用，合成一路2048K数据，传输出去。接收端完成分接电路。
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PCM FPGA 201303
摘要：我们在本文介绍的算法阐述了如何使用运行在嵌入式处理器(诸如Zynq处理平台采用的ARM9核)上的软件，控制执行像素级色彩校正的定制图像和视频处理算法。
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赛灵思 嵌入式 Zynq FPGA 201303
针对两电平DSP2407控制板在三电平逆变器控制中资源不足的问题，在不改变原有成熟算法和硬件的基础上，提出一种基于现场可编程门阵列(FPGA)的三电平实现方法。采用FPGA构造了三电平脉宽调制(PWM)IP核，包含三电平调制策略、驱动脉冲分配和保护、死区补偿、零序电压注入、中点电压平衡控制及阻尼振荡抑制算法等功能，并解决了DSP与FPGA的同步问题。基于FPGA和DSP构建一个三电平逆变器硬件平台，在一台30 kW三相异步电机上完成了相关实验。实验结果验证了该方法的可行性和正确性，为两电平调速算法拓展到三
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FPGA 三电平 方式 原理
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