- 本文介绍Virtex - 5 FXT FPGA系列浮点接口，赛灵思logiCORE的IP处理器单元( APU )辅助PowerPC 440嵌入式微处理器设计的IP基础知识。
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Virtex-5 FPGA
- 功能强大的可编程逻辑平台使得Prisma Engineering公司能够针对所有蜂窝网络提供可重配置无线测试设备。长期演进(LTE)是移动宽带的最3GPP标准，它打破了现有蜂窝网络的固有模式。LTE与前代UMTS和GSM标准相比，除采用高频谱效率的射频技术外，其架构还得到了大幅简化。LTE系统的无线接入部分Node-B，是连接无线电和整个互联网协议核心网络之间的边缘设备。这种架构无法监测和测试等效于UMTS中间链路上的元件。必须通过无线电接口，才能有效地测试LTE网络元件。
这正是Prisma
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Virtex-5 FPGA 仿真器
- 1 引言
随着电子系统的不断发展，芯片间以及板间的数据传输需求也在不断增长，传统的单端并行数据传输模式早已不能满足现在高带宽应用的要求。USB 3.0、SATA 3.0、PCI-E 2.0等新串行规范的发布以及更高速的串并/并串转换单元(SERDES)芯片的推出更是引起了业界对高速差分串行数据传输的无限憧憬。为了解决下一代无线通信基站中多天线(MIMO)信号处理所带来的巨大数据吞吐量要求，本文基于Virtex-5 FPGA的GTP单元给出了一种在高级电信计算架构(ATCA)机箱内实现单对差分线进
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FPGA Virtex-5
- 本文基于Virtex-5FPGA设计面向未来移动通信标准的Gbps无线通信基站系统，具有完全的可重配置性，可以完成MIMO、OFDM及LDPC等复杂信号处理算法，实现1Gbps速率的无线通信。
引言
随着集成电路(IC)技术进入深亚微米时代，片上系统SoC(SySTem-ON-a-Chip)以其显着的优势成为当代IC设计的热点。基于软硬件协同设计及IP复用技术的片上系统具有功能强大、高集成度和低功耗等优点，可显着降低系统体积和成本，缩短产品上市的时间。IP核是SoC设计的一个重要组成部分，
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FPGA MIMO SoC
- 真随机数发生器(TRNG)在统计学、信息安全等领域有着广泛的应用。在这些领域中，不仅要求数据序列分布均匀、彼此独立，而且要求其具有不可预测性，能够抵御针对随机性的攻击。B.Sunar，W.J.Martin和D.R.Stinson提出，真随机数发生器的性能受3个因素的影响：熵源(Entropy Source)，采集方式(Harvesting Mechanism)和后续处理(Post-Processing)。在电路系统中最常见的三种真随机数产生方法为：1)直接放大法：放大电路中的电阻热噪声等物理噪声，通过
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FPGA Virtex-5 随机数发生器
- 是德科技公司日前宣布与 YellowSys 携手推出 U5303A 12 位 PCle® 高速数据采集卡，该产品提供专为光学相干断层成像(OCT)技术设计的新选件。YellowSys 是一家 IP 处理固件和软件供应商。
是德科技数据采集解决方案使用信号重采样方法，为极差分析提供板上增强，并提供稳定的 ADC 信号采样节奏。该解决方案主要关注信号采集过程中的时钟稳定性，以避免采样节奏发生变化。在使用外部 k 时钟时，通常会对信号采集产生不利影响。此外，信号处理直接在数据采集卡上实时进行，
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是德科技 U5303A FPGA
- 新年伊始，美高森美(Microsemi)全球市场营销执行副总裁Russ Garcia向媒体展示了一个全新的美高森美。 全新体现在：美高森美的营收在过去五年里增长了一倍。2014财年，营收为11.4亿美元。焦点市场集中在通信(占总营收的38%)、国防和安全(28%)、航空航天(13%)以及工业(23%)。几年来，通过不断地并购和通过创新实现自有产品的内生增长，美高森美不断成长为产品线多样，多元化发展的公司。 Russ Garcia透露，2015的美高森美将在以下三个领域更上层楼：
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美高森美 FPGA 分立器件 原子钟
- 长期以来很多新入群的菜鸟们总 是在重复的问一些非常简单但是又让新手困惑不解的问题。作为管理员经常要给这些菜鸟们普及基础知识，但是非常不幸的是很多菜鸟怀着一种浮躁的心态来学习 FPGA，总是急于求成。
再加上国内大量有关FPGA的垃圾教材的误导，所以很多菜鸟始终无法入门。为什么大量的人会觉得FPGA难学?作为著名FPGA 提供商Altera授权的金牌培训师，本管理员决心开贴来详细讲一下菜鸟觉得FPGA难学的几大原因。
1、不熟悉 FPGA的内部结构，不了解可编程逻辑器件的基本原理。
F
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Altera FPGA SRAM
- 一、为什么要讲边沿检测
也许，没有那么一本教科书，会说到这个重要的思想;也许，学了很久的你，有可能不知道这个重要的思想吧。很惭愧，我也是在当年学了1年后才领悟到这个思想的。
说实话，我的成长很艰辛，没有人能给我系统的指导，而我得撑起这一片蓝天，于是乎无数个漏洞，我一直在修补我的不足。我没能对自己满足过，不是说我“贪得无厌”，而是，我不够“完美”。人可以不完美，但不可以不追求完美;或许终点永远达不到，但努力的过程，你一直在靠近完美;有方向感地奋
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FPGA 边沿检测
- 上次提出了一个处于异步时钟域的MCU与FPGA直接通信的实现方式，其实在这之前，特权同学想列举一个异步时钟域中出现的很典型的问题。也就是要用一个反例来说明没有足够重视异步通信会给整个设计带来什么样的危害。
特权同学要举的这个反例是真真切切的在某个项目上发生过的，很具有代表性。它不仅会涉及使用组合逻辑和时序逻辑在异步通信中的优劣、而且能把亚稳态的危害活生生的展现在你面前。
从这个模块要实现的功能说起吧，如图1所示，实现的功能其实很简单的，就是一个频率计，只不过FPGA除了脉冲采集进行计数外，
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FPGA 同步设计
- 从Xilinx公司推出FPGA二十多年来，研发工作大大提高了FPGA的速度和面积效率，缩小了FPGA与ASIC之间的差距，使FPGA成为实现数字电路的优选平台。今天，功耗日益成为FPGA供应商及其客户关注的问题。
降低FPGA功耗是降低封装和散热成本、提高器件可靠性以及打开移动电子设备等新兴市场之门的关键。
Xilinx在提供低功耗FPGA解决方案方面较有经验。本文说明如何应用计算机辅助设计(CAD)技术，如Xilinx ISE(集成软件环境)9.2i版本软件使功能有效降低。
CMO
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FPGA ISE
- 6.9 典型实例12：增量式设计(Incremental Design)演示
6.9.1 实例的内容及目标
1.实例的主要内容
6.7节对增量式设计这一方法的基本概念和流程做了全面的介绍。本节将以一个具体的实例帮助读者熟悉增量式设计的操作流程。
本实例的源代码参见随书光盘Example6.9。此程序为PC机通过串口向SRAM写入数据，再由FPGA从SRAM中读取数据通过串口将其送到PC机。
本实例的重点在于设计过程中是如何应用增量式设计的，而不是如何实现程序本身的功能。
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FPGA ISE
- 6.8 典型实例11：ChipScope功能演示
6.8.1 实例的内容及目标
1.实例的主要内容
本节通过一个简单的计数器，使用ChipScope的两种实现流程，基于Xilinx开发板完成设计至验证的完整过程。本实例的工作环境如下。
· 设计软件：ISE 7.1i。
· 综合工具：ISE自带的XST。
· 仿真软件：ModelSim SE 5.8C。
· 在线调试：ChipScope Pro 8.2i。
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FPGA ISE
- 6.7 片上逻辑分析仪(ChipScope Pro)使用技巧
在FPGA的调试阶段，传统的方法在设计FPGA的PCB板时，保留一定数量的FPGA管脚作为测试管脚。在调试的时候将要测试的信号引到测试管脚，用逻辑分析仪观察内部信号。
这种方法存在很多弊端：一是逻辑分析仪价格高昂，每个公司拥有的数量有限，在研发期间往往供不应求，影响进度;二是PCB布线后测试脚的数量就确定了，不能灵活地增加，当测试脚不够用时会影响测试，测试管脚太多又影响PCB布局布线。
ChipScope Pro是ISE下
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FPGA ISE
- 6.6 增量式设计(Incremental Design)技巧
本节将对ISE下增量式设计做一个全面的介绍。FPGA作为一种现场可编程逻辑器件，其现场可重编程特性能够提高调试速度。每次硬件工程师可以很方便地改变设计，重新进行综合、实现、布局布线，并对整个设计重新编程。
然而当设计算法比较复杂时，每一次综合、实现、布局布线需要花很长的时间。即使仅仅改变设计中的一点，也会使综合编译的时间成倍增加。而且更为麻烦的是如果整个工程的运行频率很高，对时序的要求也很严格，这样重新布线往往会造成整个时序错
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FPGA ISE
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