赛灵思公司和Brilliant 电信公司日前宣布：针对下一代有线和无线网络推出业界第一个基于FPGA的电信级时序(Timing)解决方案。这一联合开发的解决方案为下一代通信网络设计人员提供了第一个嵌入式可编程解决方案，该方案具有无与伦比的灵活性、现场可升级能力和定制化能力。通过将时序功能集成到赛灵思FPGA器件中，这一解决方案可显著降低成本。在赛灵思Virtex™ 或 Spartan™ FPGA中实现的这一解决方案以两款知识产权(IP)内核—NGNTime 和 FemtoTim
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嵌入式系统 单片机 赛灵思 Brilliant FPGA MCU和嵌入式微处理器
近日，由ARM公司举办的“ARM中国2007技术研讨会”相继在上海、北京、深圳成功召开。该研讨会是ARM公司一个的全球性的系列会议，今年的主题是“创新中国”。本次研讨会吸引了ST、TI、英蓓特、亿道电子、优龙科技、杰得微电子等合作伙伴的参与。ARM及其合作伙伴的专家们与中国半导体、电子行业同人共同讨论了中国创新之路的昨天、今天和明天。
据了解，以ARM为核心的产品2006年出货量超过24亿，相当于每秒钟76个。围绕它的产业联盟成员超过400家，是全球最大的企业联盟。每年在中国有超过10万名工程师
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消费电子 ARM 电子 处理器 嵌入式
1.引言
随着集成电路复杂度越来越高，测试开销在电路和系统总开销中所占的比例不断上升，测试方法的研究显得非常突出。目前在测试源的划分上可以采用内建自测试或片外测试。内建自测试把测试源和被测电路都集成在芯片的内部，对于目前SOC级的芯片测试如果采用内建自测试则付出的硬件面积开销则是很大的，同时也增加了芯片设计的难度：因此片外测试便成为目前被普遍看好的方法。由于FPGA具有可重构的灵活性，利用FPGA来作为测试源实现片外测试就是一种非常有效的手段。
由于伪随机模式测试只需要有限个数的输入向量便
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摘 要： 如何将家庭里相对独立的设备连接成一个系统，从而方便进行本地和远程控制？本文通过采用ARM构成智能家居控制器来实现这个目标。智能家居控制器使用S3C2410、SIM100-E等元件来组成硬件平台，再将Linux系统移植到硬件平台上，然后设计好相应的驱动程序和应用程序，最后将软件下载到硬件平台来对家电进行本地和远程控制。 关键词： ARM；GPRS；嵌入式
0 前言
随着数字化家用电器的飞速发展，如何对家庭中相对独
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ARM GPRS 嵌入式 MCU和嵌入式微处理器
基于WinCE的ARM视频监控系统,设计一种嵌入式系统，以WinCE操作系统和ARM硬件平台为核心实现对现场的实时监控；通过无线网络把视频图像传输到主机端，以实现分析、存储扣显示等功能。
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FPGA简介
FPGA是英文Field Programmable Gate Array的缩写，即现场可编程门阵列，它是在可编程阵列逻辑PAL(Programmable Array Logic)、门阵列逻辑GAL(Gate Array Logic)、可编程逻辑器件PLD(Programmable Logic Device)等可编程器件的基础什么是FPGA上进一步发展的产
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FPGA 新手 入门 元器件 其他IC 制程
a.Memory Controller b.Nand Flash c.UART d.Interrupt e.Timer Memory Controller SDRAM: S3C2410提供了外接ROM、SRAM、SDRAM、NOR Flash、NAND Flash的接口。S3C2410外接存储器的空间被分为8 BANKS，每BANK容量为128M：当访问BANKx(x从0到7)所对应的地址范围x*128M到(x+1)*12
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ARM S3C2410 硬件 手册 重点 嵌入式系统 嵌入式
1 引言
FPGA凭借其方便灵活、可重复编程等优点而日益被广泛应用;闪速存储器(Flash Memory)以其集成度高、成本低、使用方便等优点，在众多领域中也获得了广泛应用。在现代数字电路设计中。经常需要保存大量数据，而Flash存储速度快、体积小、功耗低且价格低廉，可在线电擦写，信息在掉电后不会丢失，因此成为设计人员的首选。
2 M25P80的介绍
Flash是一种具有电可擦除的可编程ROM，可以分为两大类：并行Flash和串行Flash。并行Flash存储量大，速度快;而串行Fl
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Cadence设计系统公司与ARM 宣布推出两种由它们联合开发的新的实现参考方法学，一种用于ARM11(TM) MPCore(TM)多核处理器，另一种用于ARM1176JZF-S(TM)处理器的低功耗实现，后者集成了ARM® Intelligent Energy Manager (IEM(TM))技术。针对这两款ARM处理器的这些Cadence参考方法学是两个公司紧密合作的成果，为设计多核、低功耗器件的共同客户提供了增强的设计解决方案。
“Cadence低功耗解决方案包括Encounte
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程序优化是指软件编程结束后，利用软件开发工具对程序进行调整和改进，让程序充分利用资源， 提高运行效率， 缩减代码尺寸的过程。按照优化的侧重点不同， 程序优化可分为运行速度优化和代码尺寸优化。 运行速度优化是指在充分掌握软硬件特性的基础上， 通过应用程序结构调整等手段来降低完成指
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ARM 程序 设计 优化 嵌入式
1 引言
中国于2006年8月颁布了数字电视的地面广播标准GB20600-2006，成为继美国ATSC、欧洲DVB-T、日本ISDB-T之后又一重要的地面数字电视广播的国家标准。GB20600-2006中对中国数字电视地面传输(DigitalTerrestrial Television Broadcasting，DTTB)系统传输的帧结构、信道编码和调制作了具体的规定。其中帧结构的基本单元——信号帧采用了循环扩展的时域帧头结构，即在每3780个符号的帧体前加入一定长度的经循环扩展后的伪随机序列作
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赛灵思公司宣布开始正式发放高性能计算行业首款针对Intel前端总线(FSB)的FPGA加速解决方案商业许可。基于高性能65nm Virtex™-5 平台 FPGA 和Intel® QuickAssist技术，赛灵思公司的加速计算平台(Accelerated Computing Platform, ACP)M1许可包支持实现全速1066MHz FSB性能。ACP M1许可包目前已开始向系统集成商提供，支持他们进行解决方案的开发，以提高基于Intel处理器的服务器平台的性能，并保证把功
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1.引言
示波器测量频率和相位的方法很多， “李沙育图形法”就是其中用得最多的一种。“李沙育图形法”又称波形合成法，就是将被测频率的信号和频率已知的标准信号分别加至示波器的Y轴输入端和x轴输入端，在示波器显示屏上将出现一个合成图形，这个图形就是李沙育图形。李沙育图形随两个输入信号的频率、相位、幅度不同，所呈现的波形也不同。
早期的模拟示波器显示李沙育图形的原理是将电信号转换为光信号，核心部分是阴极射线示波管(CRT)。将输入信号加到示波管内部的偏转系统，高速电子经聚焦、加速和偏转后，打到荧
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嵌入式系统 单片机 FPGA 示波器 MCU和嵌入式微处理器
1 引言
TCN(Train Communication Network)总体结构是由WTB(绞线式列车总线)和MVB(多功能车辆总线)组成，符合IEC61375-1标准。本文主要围绕WTB链路控制的帧格式进行研究。鉴于IEC61375-1标准中规定的WTB帧数据格式与IS03309中定义的HDLC(High Level Data Link Control)格式一致，基带Manchester-Biphase-L技术编解码器现则围绕HDLC展开。
随着深亚微米工艺技术的发展，FPGA(Fie
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嵌入式系统 单片机 TCN HDLC FPGA MCU和嵌入式微处理器
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