随着雷达信号处理技术的不断发展以及现代国防对雷达技术的需求，系统对雷达信号处理的要求也越来越高，需要实时处理更加庞大的数据。先进的雷达信号处理设备不仅要求性能高、功能多样化，而且要求信号处理设备
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CPCI FPGA 总线 信号处理板
爱特公司 (Actel Corporation) 独资的子公司Pigeon Point Systems宣布，延续其xTCA™板级及模块管理控制器产品的兼容性和互用性举措。在2009 ATCA Summit会议上，Pigeon Point Systems使用Polaris Networks公司的ATCA测试器，现场对基于Actel Fusion® 混合信号FPGA和Renesas H8S微控制器的最新Pigeon Point管理解决方案xTCA SlotFest进行形式测试(form
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Actel FPGA 管理组件 xTCA
1．引言
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实现 FPGA 基于 FPGA
0 引言
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FPGA 模块化 雷达接收机 中的应用
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LabVIEW FPGA DAQ 自动
首先分析Chirp函数在频域上的一般特性，并且分析Altrea公司提供的数控振荡器知识产权核(NCO IP core)的输入／输出特性，通过MegaCore环境确定其输入控制字，通过外围逻辑电路实时向NCO IP core调入控制频率控制字以达到改变输出频率的目的，并通过在示波器上观测FPGA的运行情况，验证了该设计具有很好的输出效果。
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Chirp core NCO IP
软件无线电的出现，是无线电通信从模拟到数字、从固定到移动后，由硬件到软件的第三次变革。简单地说，软件无...
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FPGA 软件无线电平台
引言 分频器在CPLD/FPGA设计中使用频率比较高,尽管目前大部分设计中采用芯片厂家集成的锁相环资源 ,但是对于要求奇数倍分频（如3、5等）、小数倍（如2.5、3.5等）分频、占空比50%的应用场合却往往不能满足要求。
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CPLD FPGA 多功能 分频器
基于DSP和FPGA的调幅广播信号监测系统, 引言 随着通信与广播电视业务的发展，无线电频谱迅速、大量的被占用，频道拥挤和相互间干扰日趋严重，为了能有效地利用无线电频谱，减少相互间的干扰，信号监测业务随之成为必要。调幅广播信号监测系统是用于实
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信号 监测 系统 广播 调幅 DSP FPGA 基于 DSP FPGA
Altera 公司 (NASDAQ: ALTR) 今天宣布推出业界首款支持 RapidIO® 2.1 规范的知识产权 (IP) 内核。Altera 的串行 RapidIO IP 内核可支持多达四条通道，每条通道速率为 5.0 GBaud，从而满足了无线市场日益增长的带宽和可靠性需求。该 IP 内核专门针对拥有多个嵌入式收发器的 Stratix® IV FPGA 而优化，并得到了Quartus® II 软件 v9.1 的支持。
RapidIO 2.1 规范在许多应用中均可实
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Altera RapidIO FPGA Quartus
随着经济情势与市场环境的改变,历经长足发展的可编程逻辑组件(PLD)正凭借着成熟的技术将触角深入量产型的消费及嵌入式市场,并以更加经济的开发成本持续抢占传统ASIC/ASSP市场.
"ASIC/ASSP的商业模式愈来愈难以为继,"爱特(Actel)公司应用工程师陈冠志指出.巨额的芯片制造成本是首先面临的关卡."300mm晶圆厂的成本以惊人的速度增长,在45nm节点约需30亿美元;而到了32nm节点,估计会达到100亿美元."另一方面,全球市场的动荡情况,也
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Altera FPGA 40nm
Altera 公司 宣布推出业界首款支持 RapidIO® 2.1 规范的知识产权 (IP) 内核。Altera 的串行 RapidIO IP 内核可支持多达四条通道，每条通道速率为 5.0 GBaud，从而满足了无线市场日益增长的带宽和可靠性需求。该
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RapidIO Altera 2.1 IP
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