- 1引言当前在EDA领域,只要具备台式或笔记本电脑并装有工具软件,就可以方便地对可编程ASIC(CPLD/FPGA)...
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FPGA ASIC 嵌入式 EDA ISP
- 超长指令字VLIW(VeryLongInstructionWord)微处理器架构采用了先进的清晰并行指令设计[1]。VLIW微处...
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FPGA VLIW 微处理器
- 介绍了一种基于FPGA和DSP的多功能高速数据采集处理系统的设计,该系统的数据采集速度最高可达到105 Msps ,运算能力强,通过更改软件可适用于大部分的高速数据处理场合,具有较强的通用性。
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数据采集 FPGA DSP 201007
- 设计实现了基于FPGA的256点定点FFT处理器。处理器以基-2算法为基础,通过采用高效的两路输入移位寄存器流水线结构,有效提高了碟形运算单元的运算效率,减少了寄存器资源的使用,提高了最大工作频率,增大了数据吞吐量,并且使得处理器具有良好的可扩展性。详细描述了具体设计的算法结构和各个模块的实现。设计采用Verilog HDL作为硬件描述语言,采用QuartusⅡ设计仿真工具进行设计、综合和仿真,仿真结果表明,处理器工作频率为72 MHz,是一种高效的FFT处理器IP核。
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FPGA FFT 移位寄存器 流水线结构
- 从增量型光电编码器的构造特点出发,分析其输出信号中引起抖动误码脉冲的原因。根据编码器两相输出信号(A相、B相)不能同时跳变的特点,设计了一种高精度抗抖动二倍频电路,能有效滤除信号的干扰脉冲。
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FPGA 增量 光电编码器 抖动
- 利用飞速发展的FPGA技术,在图像采集前端实现Bayer插值变换。比较了常用的3种插值方法,选用计算复杂度较高但图像质量最佳的Optimal Recovery方法。采用Lattice的FPGA芯片LFECP2-M50,实现1 208×1 024图像,12 f/s,实时Bayer转换。给出了实时采集图像结果,显示了插值变换前的原始图像,计算了变换后图像的峰值信噪比PSNR。
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Bayer FPGA 彩色图像 变换
- 在此基于Altera公司的现场可编程门阵列(FPGA)芯片EP2C8F256C6,采用最小均方算法设计了自适应谱线增强(ALE)处理系统。以FPGA为处理核心,实现数据采样控制、数据延时控制、LMS核心算法和输出存储控制等。充分利用FPGA高速的数据处理能力和丰富的片内乘法器,设计了LMS算法的流水线结构,保证整个系统具有高的数据吞吐能力和处理速度。并且通过编写相应的VHDL程序在QuartusⅡ软件上进行仿真,仿真结果表明该设计可以快速、准确地实现自适应谱线增强。
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FPGA 谱线 系统设计
- 该系统由FPGA、单片机控制模块、键盘、LED显示组成,采用直接数字频率合成(DDS),D/A以及实时计算波形值等技术,设计出具有频率设置功能,频率步进为100 Hz,频率范围为1 kHz~10 MHz之间正弦信号发生器。该系统的频率范围宽,步进小,频率精度较高。
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FPGA DDS 正弦信号发生器
- 近日,作为2010年“全国电子专业人才设计与技能大赛”官方协办单位,Altium于6月5日至6日及6月12日至13日分两批在大连、北京、青岛、苏州、西安、郑州、杭州和成都共八个城市为预选赛阶段参赛选手提供“Altium Designer设计专题技术”培训辅导。此次Altium与工信部人才交流中心的战略合作旨在为培养电子行业的创新型专业人才提供最先进的技术和最好的平台。
本次系列培训会共吸引了超过700位大赛选手和指导老师亲临现场。Altium专业技
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Altium 电子设计 FPGA
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