全球可编程平台领导厂商赛灵思公司(Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出其第四代部分可重配置设计流程，以及智能时钟门控技术的多项全新强化方案，可针对Virtex™®-6 FPGA设计中BRAM(block-RAM)降低24%的动态功耗。设计人员即日起即可下载ISE12.2设计套件，利用其简便易用、直观的部分可重配置设计流程，进一步降低功耗和整体系统成本。同时，最新推出的ISE版本还可提供一项低成本仿真方案， 支持嵌入式设计流程。
赛灵思 ISE
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Xilinx FPGA ISE12.2
对扩声系统来讲，要求声场稳定，尽可能抑制各种干扰和噪声，特别是啸叫声，同时要求声场均匀，声信号清晰。传统的扩声系统很难做到声场的稳定。本文提出利用现代阵列信号处理技术，结合 DSP和有效的算法，达到稳定声场的目的，通过仿真，验证了该方案的可行性。将该设计方案应用于室内扩声系统中，不会增加大的成本，却可达到好的效果。
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DSP 扩声系统
引言随着FPGA技术的发展，出现了一种新概念的嵌入式系统，即SOPC（SystemOnProgrammableChip）。SOPC技...
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FPGA SOPC NOR Flash 嵌入式
面向电机和功率级动态特性的高级建模技术可以大幅提高电机控制效率，确保根据系统行为的实时变动实行精密控制。通过无传感器矢量控制，设计人员可以增强电机系统的性能，降低功耗，并且符合旨在提高能效的新法规要求。基于新一代数字信号处理技术的新型电机控制技术有望加速先进控制方案的运用。
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ADI DSP PMSM
介绍了一种利用DSP对电阻焊焊接电流进行在线检测的系统，主要包括硬件设计、电流检测软件、LCD和按键软件设计。本系统通过温度和初值补偿设计，提高了检测准确度。试验结果表明，系统最大检测误差为0.67%。
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检测系统 设计 电流 焊接 DSP 基于 收发器
美国赛灵思(Xilinx)发布了抗辐射性和性能均高于其原产品的航天领域用FPGA“Virtex-5QV FPGA”。将耐辐射总剂量(TID)提高到了该公司原产品的2倍以上之外，其规模也达到了13万个逻辑单元，作为航天领域用FPGA中属业界最高水准。此外，还集成了最高速度为3.125Gbit/秒的高速收发器，并强化了DSP功能。主要面向人造卫星和宇宙飞船上的遥感处理、图像处理以及导航仪等用途。目前正在样品供货，将从2011年1～3月开始65nm工艺的量产。赛灵思表示：&ldquo
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Xilinx Virtex FPGA
带服务能够支持三重应用（即支持语音、视频和数据）至第一英里的客户，例如持续发展的小商业和住宅。FTTx中的...
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FPGA GPON 低功耗
DDR3存储器系统可以大大提升各种数据处理应用的性能。然而，和过去几代（DDR和DDR2）器件相比，DDR3存储器器件...
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FPGA IP核 DDR3 数据处理
自适应控制理论在燃料电池车电机控制系统中的应用，对于提高电动汽车的驱动性能具有较好的效果。在此给出采用离散模型参考自适应控制的燃料电池车电机控制系统，控制系统设计以数字信号处理器为核心，简单介绍了系统的硬件设计，并在此基础上重点探讨DSP控制系统的软件设计，分析了主程序、脉宽调制中断处理程序、电流PI调节程序和速度自适应调节程序的软件实现，给出了主要程序流程图。探讨在电机DSP控制系统中，离散模型参考自适应算法的实现对于各种先进的控制策略在电动汽车中的应用具有重要意义。
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DSP 软件 设计 控制系统 电机 电池 离散 MRAC 燃料
为改善红外图像的视觉效果和后续处理质量，需要对图像进行增强处理。在此介绍并实现了一种空间域图像增强算法，自适应分段线性拉伸算法。首先简要分析算法原理，对该算法基于Xilinx公司XC4VLXl5系列FPGA的实现方法进行了研究，以兼顾系统实时性和集成度为目的，提出灰度直方图统计和拉伸运算等关键模块的解决方案。通过试验结果分析，对压缩因子的选取提出建议。该设计的输出延迟仅为62.-5ns，且具有实现简单、集成度高、功耗低等优点，适合在精确制导武器和导航系统中应用。
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FPGA 图像自适应 分段线性 算法
日前，德州仪器 (TI) 宣布推出最新开发平台与 TMS320C6457 数字信号处理器 (DSP) 的更高速度选项，继续为开发人员提供可实现低成本应用的各种高价值、高性能器件。TI 简化型开发平台与 TMS320C6457 - 850MHz 器件配合使用，不但可帮助网络、测试、影像以及工业等市场领域的客户快速推进开发工作，同时还可为现有 TMS320C6457 处理器提供高度的设计灵活性与升级功能，并确保极具竞争力的低价位。此外，TI 还可为该器件的低价位 1GHz 与 1.2GHz 版本提供引脚兼
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TI DSP TMS320C6457
提出了一种基于高频帧摄像头的高频帧实时图像压缩技术，以此技术为基础，使用TMS320CDM642和EP2C35 FPGA相结合，设计了一种高频帧实时图像处理器硬件系统。该系统采用2片SRAM乒乓结构，以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000压缩算法，实现了100帧/s的压缩速度，系统同时解决了图像压缩中容量和速度的问题，实验了采集和压缩过程的同步进行，大大提高了图像压缩速度。
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FPGA DSP 实时图像 压缩系统
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