- 无论是设计通信、消费、计算机或工业应用，MAX?II器件都能够为成本和功率受限的控制通道应用提供所需的功能。MAX II更低的价格，更低的功率和更大的容量使其成为复杂控制应用的理想方案，包括以往不可能在CPLD中实现的新应用。MAX II器件采用了全新 CPLD体系结构，比以往的MAX器件有重大改进。
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应用手册 CPLD
- Xilinx CoolRunner 系列CPLD器件分CoolRunner-Ⅱ系列和CoolRunner XPLA 3系列器件。1999年8月，Xilinx收购了Philips的CoolRunner生产线并开始提供XPLA（eXtenden Programmable Logic Array，加强型可编程逻辑阵列）系列器件
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Xilinx CoolRunner CPLD
- Xilinx CPLD 器件可使用 Foundation 或 ISE 开发软件进行开发设计，也可使用专门针对 CPLD 器件的 Webpack 开发软件进行设计。XC9500系列器件分XC9500 5V器件、XC9500XL 3.3V器件和XC9500XV 2.5V器件3种类型，XC9500系列可提供从最简单的PAL综合设计到最先进的实时硬件现场升级的全套解决方案。
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Xilinx XC9500 CPLD
- 经过几十年的发展，全球各大开发商和供货商都开发出了多种可编程逻辑器件 . 比较典型的就是 Xilinx 公司的 FPGA 器件和 Altera 公司的 CPLD 器件系列，他们开发较早，占有大部分市场?在欧洲用 Xilinx 的人多，而 Altera 公司占有日本和亚太地区的大部分市场，在美国则是平分秋色。
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Xilinx Altera 芯片 选型 CPLD
- FPGA/CPLD 的设计思想与技巧是一个非常大的话题，由于篇幅所限，本文仅介绍一些常用的设计思想与技巧，包括乒乓球操作、串并转换、流水线操作和数据接口的同步方法。希望本文能引起工程师们的注意，如果能有意识地利用这些原则指导日后的设计工作，将取得事半功倍的效果！
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设计思想 FPGA CPLD
- 电子设计自动化（EDA）的实现是与CPLD/FPGA技术的迅速发展息息相关的。CPLD/FPGA是80年代中后期出现的，其特点是具有用户可编程的特性。利用PLD/FPGA，电子系统设计工程师可以在实验室中设计出专用IC，实现系统的集成，从而大大缩短了产品开发、上市的时间，降低了开发成本。此外，CPLD/FPGA还具有静态可重复编程或在线动态重构特性，使硬件的功能可象软件一样通过编程来修改，不仅使设计修改和产品升级变得十分方便，而且极大地提高了电子系统的灵活性和通用能力。
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可编程逻辑器件 FPGA CPLD 电子设计 灵活性
- 近年来,随着信息科技的发展,电子存包系统由于其安全性高、可靠性高、方便快捷等特点,在车站码头、超市、图书馆、宾馆、游泳馆、俱乐部等公共场所及机关、企事业单位文件档案管理等部门得到了广泛的应用,有着广阔的市场前景。
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CPLD
- CPLD（Complex Programmable Logic Device）是Complex PLD的简称,一种较PLD为复杂的逻辑元件。CPLD是一种用户根据各自需要而自行构造逻辑功能的数字集成电路。其基本设计方法是借助集成开发软件平台，用原理图、硬件描述语言等方法，生成相应的目标文件，通过下载电缆（“在系统”编程）将代码传送到目标芯片中，实现设计的数字系统。
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CPLD
- 基于单片机和CPLD的DDS正交信号源，其频率幅度可精密控制，扩展输出频率达300 kHz，增加扫频输出功能。采用红外键盘控制频率和幅度，采用液晶同步显示信号的频率和幅度；输出端产生正弦波、方波、三角波、锯齿波，梯形波、短形波、频率突变的方波、尖脉冲数字信号等，且具有扫频输出的功能。测试结果表明，系统稳定可靠，人机交互界面友好，操作简单方便。
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DDS 正交信号源 CPLD 滤波器 DT9205 AT28C64
- SOPC一词主要是源自Altera, 其涵义是因为目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上价格下跌的推波助澜之下, 以往ASIC产品才能具有的 SoC观念, 也能移植到CPLD/FPGA上, 并且因为CPLD/FPGA的可编程(Programmable)能力, 使得CPLD/FPGA不仅能实现一个高复难度的系统, 而且还能快速改变系统的特性. 类似的观念也鉴于Xilinx的Platform FPGA.
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SOPC CPLD FPGA
- 本文提出一种基于CPLD的简易字符叠加器，具有成本低、抗干扰性能好等特点，适用于视频监控。由于采用了CPLD器件，增强了系统集成度和设计灵活性。
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字符叠加器 RAM CPLD VHDL
- 设计了一组基于CPLD的PLC背板总线协议接口芯片，协议芯片可以区分PLC的背板总线的周期性数据和非周期性数据。详细介绍了通过Verilog HDL语言设计状态机、协议帧控制器、FIFO控制器的过程，
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PLC FIFO CPLD 总线协议
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