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DSP FPGA TMS320DM642
- 基于ARM+zigBee的通用网络测控系统硬件设计,0引言随着物联网概念的提出及相关技术的发展，网络化测量控制已成为测控系统发展的必然趋势。然而，当前国内外工业控制领域普遍使用且技术相当成熟的PLC(Programable Logic Controller)基本都不支持网络，也不能简单
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系统 硬件 设计 网络 通用 ARM zigBee 基于
- IPTV系统中的FPGA供电问题解决方案介绍,目前越来越多的家用电器从低速的拨号上网向宽带互联网接入或互联网协议电视(IPTV)转移，尤其是IPTV有望在中国获得快速的发展。比较而言，IPTV的基础设施成本相当低，因为这种方法不需要铜轴电缆，而是采用DSL或宽带链
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解决方案 介绍 问题 供电 系统 FPGA IPTV
- 如何在低成本FPGA中实现动态相位调整,在FPGA中，动态相位调整(DPA)主要是实现LVDS接口接收时对时钟和数据通道的相位补偿，以达到正确接收的目的。ALTERA的高端FPGA，如STRATIX(r) 系列中自带有DPA电路，但低端的FPGA，如CYCLONE(r)系列中是没有的。本文主
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相位 调整 动态 实现 成本 FPGA 如何
- IIR数字滤波器设计-在FPGA上实现任意阶IIR数字滤波器摘要：本文介绍了一种采用级联结构在FPGA上实现任意阶I...
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IIR数字滤波器 fpga
- 本文主要介绍了虚拟化路由器的结构以及其中的关键调度机制的算法和实现，通过多级的调度处理，实现了支持多个可灵活配置，线速转发的路由实例的虚拟化路由器。本文所提到虚拟化路由器实际设计名称为“IsoRouter”，它基于NetFPGA板卡，本文所介绍的调度机制不针对具体某一型号的FPGA，它可以在任何一款FPGA上实现。
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路由器 FPGA
- FPGA设计一个很重要的设计是时序设计，而时序设计的实质就是满足每一个触发器的建立(Setup)/保持(Hold)时间的要求。建立时间(Setup Time)：是指在触发器的时钟信号上升沿到来以前，数据稳定不变的时间，如果建立时间
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FPGA 基础 时序设计
- 逻辑分析仪测试在基于FPGA的LCD显示控制中的应用摘要：逻辑分析仪作为基础仪器，应该在基础数字电路教学中得到广泛应用。本文介绍了基于FPGA的液晶显示控制设计方案，通过使用OLA2032B逻辑分析仪，对控制线进行监测与
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FPGA LCD 逻辑分析仪 测试
- 摘要：首先介绍了两种高精度相位差测量算法，一种是基于直接数字频率合成(DDS)的相关测量法，另一种是基于快速傅里叶变换(FFT)的FFT测量法。其次，通过理论仿真分析两种算法在不同信噪比和数据长度下的性能，并在此基
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FPGA 高精度 测量算法 相位差
- 现场可编程门阵列(Field Programmable Gate Array，FPGA)可通过用户软件编程来配置生成硬件电路，极大提高了电子系统设计中的灵活性和通用性，因而被广泛应用于航天、通信、医疗和工控等重要领域。但在空间环境中，基于SRAM的FPGA容易受SEU(Single Event Upset)和SETs(Single Event Transients)的影响，从而导致系统故障。DMR(Dual Modular Redundancy)和TMR(Triple Modular Redundancy
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乘法器 FPGA
- 0 引 言USB(通用串行总线)是英特尔、微软、IBM、康柏等公司1994年联合制定的一种通用串行总线规范，它解决了与网络通信问题，而且端口扩展性能好、容易使用。最新的USB2.0支持3种速率：低速1.5 Mbit/s，全速12 Mbit/
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Verilog C68013 68013 FPGA
- 摘要：以单片机和可编程逻辑器件(FPGA)为控制核心，设计了一个程控滤波器，实现了小信号程控放大、程控调整滤波器截止频率和幅频特性测试的功能。其中放大模块由可变增益放大器AD603实现，最大增益60dB，10dB步进可调
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FPGA 程控滤波器
- 摘要：基于VGA接口时序以，高性能视频D／A芯片ADV7120为核心。实现了基于嵌入式CPU S3C2440的VGA显示子系统。系统一方面利用S3C24 40自带的LCD控制器产生符合VGA显示要求的时序逻辑，另一方面通过LCD数据线将数字RGB
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S3C2440 ARM VGA 处理器
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