- 本文结合MSP430系列微处理器，详细论述了通过控制改变MCU的时钟频率来降低功耗的设计方法。 1 功耗产生的原因 在CMOS电路中，功耗损失主要包括静态功耗损失和动态功耗损失两部分。其中静态功耗主要是由反偏PN结
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配置 分析 时钟 动态 系列 MCU MSP430
- 产品必须符合EMC(电磁兼容)要求，欧洲规定：销售违反电磁兼容法令(89/336/EEC)的产品将面临高额罚款，因此，商家越来越重视产品的电磁兼容性问题，为了降低成本，要根据公司需求和规模的不同，组建一个EMC实验室，本
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配置 仪器 实验室 电磁兼容
- 通过多核低功耗技术以及各种不同的IP模块，VF1000不仅仅能够满足数字手机电视对低功耗视频解码芯片的需求，同时也适用于包括GPS、IPTVSTB、PMP甚至腕表电视这样需要超低功耗解码技术的各类应用。“移动电视和可
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- 随着计算机应用的不断发展，许多企业计算机局域网规模在不断扩大，网络的独立网关或独立网点数目也日益增多;同时，由于应用的发展，需要对网络进行优化和改造，并且增加新的业务，如语音和视频通信等，因此，必须对原
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大全 配置 路由器 Cisco
- 之前通过场景实例向大家展示了用Virtual Routing and Forwarding (VRF，虚拟路由转发)将一个路由器分割成八个虚拟路由器的方法。当时我向大家演示了如何配置VRF，在本文中我们继续使用这个场景，并通过IPsec配置，将
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VPN 详解 IPsec VRF-aware 路由器 配置 Cisco
- 1、保存配置Router # write memoryRouter # write network tftp2、删除配置Router # write erase3、基本检测命令(telnet、ping、trace)Router 》 telnet paris/222.34.27.1Router 》 ping 182.105.130.110Router 》
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- 通常对思科路由器或者交换机进行了修改，然后又需要将这些修改移除掉的情况？其实，有很多种方法可以完成这一点，可能很多人对思科路由器配置还不是特别的了解，今天我在这里拿出来和大家分享一下，希望对大家有用。
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- IPTV接收终端，即IPTV机顶盒，是IPTV系统关键设备之一，其主要功能包括：支持LAN或xDSL网路传输、接收及处理IP数据和视频流；支持H.264、MPEG-2、MPEG-4、WMV和Real等视频解码；支持相应CA技术；支持HTML网页浏览及网
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维护 方案设计 配置 智能化 机顶盒 IPTV
- VxWorks网络驱动配置及分析,VxWorks支持两种形式的网络驱动,一种是BSD驱动支持通用的BSD4.4网络,API,结构等和大多数BSD网络的驱动类似.另一种是END网络驱动,是VxWorks独有的,根据VxWorksMUX接口编程,不过END驱动在底层也要转换成BSD的形式.VxWo
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- 摘要：为确保视频传输过程中传输数据的正确性，设计了一个简单的视频信号传输系统。在该系统中，对视频解码芯片的配置很关键。与其它普通视频解码芯片相比，SAA7115解码芯片内有自适应的NTSC／PAL／SECAM制式的梳状滤
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配置 应用 寄存器 芯片 视频 解码 SAA7115
- 嵌入式控制和监测应用的趋势：可重配置 I/O(RIO) 架构,多年来，嵌入式系统设计人员一直都在使用FPGA（现场可编程逻辑门阵列）配合微处理器(MPU)及微控制器(MCU)进行系统开发。FPGA已经广泛应用于扩展MPU I/O的功能，以及作为各种子系统和通信端口的连接接口。随着FPGA容量
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I/O RIO 架构 配置 趋势 控制 监测 应用 嵌入式
- 对于城域网络和长途网络来说，如果光传送层具有远程重新配置的能力，则可以极大地降低运营成本。运营商也已经意识到这种潜力，并在最近业务网络的招标中加入了对于可重配置光分插复用器(ROADM)以及多维光开关的要求
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控制 应用 嵌入式 ROADM 配置 复用器 基于
- 基于微处理器的FPGA的在线可重配置,可编程逻辑器件（PLD）广泛应用在各种电路设计中。基于查找表技术、SRAM工艺的大规模PLD/FPGA，密度高且触发器多，适用于复杂的时序逻辑，如数字信号处理和各种算法的设计。类器件使用SRAM单元存储配置数据。配置数据
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配置 在线 FPGA 微处理器 基于
- 用FPGA实现Nios II嵌入式系统配置技术,现场可编程门阵列(FPGA，Field Programmable Gate Array)是一种高密度可编程逻辑器件，其逻辑功能是通过把设计生成的数据文件配置进芯片内部的静态配置数据存储器(SRAM )来实现的，具有可重复编程性，可以灵活实现各
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系统 配置 技术 嵌入式 II 实现 Nios FPGA
- 基于DSP的FPGA配置方法研究与实现,摘要：在数字电路中，FPGA+DSP的系统结构应用日益广泛。为了减小此种结构的体积和降低成本，对FPGA采用了被动并行的配置方式。上电后，DSP首先完成自身程序的加载，之后充当配置FPGA的主处理器，从FLASH芯片中读取FP
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方法研究 实现 配置 FPGA DSP 基于
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