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用于CDR电路的相位插值选择电路设计
- 0 引言 在高速多通道串行收发系统中，由于数据在传输时会受到多种噪声的影响而失真，因此在接收端要进行时钟的恢复和数据的重定时，即时钟数据恢复(CDR)。然而由于工艺、电压的影响以及系统对功耗和抖动性能的要求，过去采用的各通道拥有独立锁相环路的方案已逐渐被设计者舍弃，取而代之的是双环时钟数据恢复环路。其基本思想是：时钟数据恢复单元的各个通道共享同一个锁相环，由该环路统一向各通道提供多相参考时钟，各通道的CDR环路则利用已经产生的多相时钟完成数据的重定时。这样既避免了由于不同锁相环输出时钟间的差异而造成
- 关键字： CDR
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