- 用可编程DSP器件实现数字滤波，通过修改滤波器参数可方便地改变滤波器的特性。以TMS320F2812数字信号处理器为核心，将滤波器算法作为DSP／BIOS的任务来实现，可方便地实现多任务系统。详细介绍一种基于DSP／B10S的软件开发过程，并在DSK2812平台上实现数字滤波器的开发实例，对需进行数字信号处理的多任务软件开发具有一定的参考价值。
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设计 实现 滤波器 数字 DSP/BIOS FIR 基于
- 现场可编程门阵列(FPGA)器件广泛用于数字信号处理领域．而使用VHDL或VerilogHDL语言进行设计的难度较大。提出一种采用DSP Builder实现FIR滤波器的设计方案，按照Matlab／Simulink／DSP Builder／Modelsim／QuartusⅡ的设计流程，设计一个16阶的FIR低通滤波器，并完成了软硬件的仿真与验证。结果表明，该方法简单易行，可满足设计要求，它验证了采用DSP Builder实现滤波器设计的独特优势。
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Builder DSP FIR 滤波器
- 为设计一个项目可用的FIR数字带通滤波器，采用Matlab／Simulink软件中DSPBulider强大的算法模块设计工具，结合Altera公司的FPGA开发板实现FIR数字带通滤波器的系统集成、RTL级仿真、综合编译、下载等设计流程，并对正弦信号进行滤波，结果下载到开发板上用示波器观测，达到了预期的滤波效果和目的。基于DSPBuilder完成系统建模，省去了复杂的VHDL编程，还可针对具体模块进行参数设置从而适应不同的滤波需求。该方法实现简单、可靠，还可类推实现其他复杂的嵌入式系统设计。
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FPGA FIR 带通滤波器
- 有限冲激响应(FIR)数字滤波器的设计实质是一个多参数优化的问题，而传统的一些优化设计方法，如遗传算法、神经网络法等，存在算法复杂，收敛速度慢，效果不明显等缺点。提出一种改进粒子群优化算法(IMPSO)的FIR数字滤波器设计。该方法首先根据粒子聚合度情况引入变异思想，克服PSO算法容易早熟的毛病，对算法进行改进，然后利用改进的IMPSO搜索滤波器参数的最优解，对FIR滤波器进行优化设计。实例设计FIR数字低通、带通滤波器，仿真结果表明，该方法具有算法简单，收敛速度快，鲁棒性好等优点。
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PSO FIR 数字 滤波器设计
- 0 引言
数字滤波器是一种用来过滤时间离散信号的数字系统，通过对抽样数据进行数学处理来达到频域。滤波的目的。根据其单位冲激响应函数的时域特性可分为两类：无限冲激响应(IIR)滤波器和有限冲激响应(FIR)滤波
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56F8O13 DSP FIR 滤波器设计
- 介绍了一种利用ALTERA公司的复杂可编程逻辑器件（CPLD）快速卷积法实现数字滤波器的设计。
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CPLD FIR 数字滤波器
- 摘要：提出一种基于模拟退火神经网络设计FIR数字滤波器的方法，是对用神经网络设计方法的一种改进。由于线性相位FIR数字滤波器的幅频特性是有限项的傅里叶级数，因此构造了一个三层余弦基神经网络模型，并用模拟退火
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FIR 模拟退火 滤波器设计 神经网络
- 提出一种基于全相位幅频特性补偿的FIR滤波器设计算法，此方法可通过设置频移参数λ来控制边界频率。该方法采用了偶对称的频率采样模式，对两个子滤波器作了反向的相移处理，另外还构造了一全相位单窗滤波器用于幅频特性补偿，再将此补偿滤波器和各子滤波器进行组合即可形成各种低通、高通、带通、陷波类型的滤波器。
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FIR 相位 补偿 滤波器设计
- 摘要：采用基于分布式算法思想的方法来设计FIR滤波器，利用FDAt001设计系统参数，计算滤波器系数，同时为了要满足系统要求考虑系数的位数。根据FIR数字滤波器结构，对FIR数字滤波器的FPGA实现方法进行分析。
关键词
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FPGA FIR 抽取滤波器
- 1 Fir滤波器原理
有限冲激响应(FIR)数字滤波器和无限冲激响应(IIR)数字滤波器广泛应用于数字信号处理系统中。IIR数字滤波器方便简单，但它相位的非线性，要求采用全通网络进行相位校正，且稳定性难以保障。FIR滤
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FPGA FIR 并行 流水线
- 摘要：基于FIR数字滤波器的原理和层次化、模块化设计思想，结合Altera公司的CycloneII系列FPGA芯片，提出了FIR数字滤波器的实现硬件方案，给出了采用Matlab、QuartusⅡ设计及实现32阶低通FIR滤波器的方法步骤，仿真及
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Matlab FPGA FIR 数字
- FIR滤波器的结构主要是非递归结构，没有输出到输入的反馈。并且FIR滤波器很容易获得严格的线性相位特性，避免...
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FIR 数字滤波器 DSP
- 数字滤波作为数字信号处理技术的重要组成部分，广泛应用于信号分离、恢复、整形等场合。FIR滤波器因其严格的线性相位特性而应用广泛，通过系统研究数字滤波器的基本理论及基于FPGA的实现方法。给出利用MATLAB仿真软件设计出符合要求的数字滤波器并对其进行仿真验证。
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FPGA FIR 数字 滤波器设计
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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DSP FPGA FIR QuartusⅡ
- 数字滤波器在数字信号处理的各种应用中发挥着十分重要的作用，他是通过对采样数据信号进行数学运算处理来达到频域滤波的目的。数字滤波器既可以是有限长单脉冲响应(FIR)滤波器也可以是无限长单脉冲响应(IIR)滤波器。在维纳滤波器理论发明的早期，人们使用IIR滤波器，但现在更多是使用FIR滤波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，设计一个FIR滤波器。Altera DSP Builder是连接Simulink和QuartusⅡ开发软件的DSP开发工具。在DSP
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滤波器 设计 FIR Builder DSP 基于
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