- RS码是线性分组码中一种典型的纠错码，既能纠正随机错误，也能纠正突发错误，在现代通信领域越来越受到重视。文中介绍基于FPGA使用Verilog―HDL语言的RS(15，9)编码器的设计方法，并在QuartusII 5．O软件环境下进行了功能仿真，仿真结果与理论分析相一致，该设计方法对实现任意长度的RS编码有重要参考价值。
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FPGA RS编码器
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