- 基于CPLD的DSP人机接口模块设计, CPLD(Complex programmable Logic Device，复杂可编程逻辑器件)是在传统的PAL、GAL基础上发展而来的，具有多种工作方式和高集成、高速、高可靠性等明显的特点。 在超高速领域和实时测控方面有非常广泛的应用，
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模块 设计 接口 人机 CPLD DSP 基于
- 采用CPLD的MAX1032采样控制的实现方法,0 引言
本文主要介绍MAX1032采样芯片以及使用CPLD对MAX1032采样进行控制的方法。事实上，虽然微控制器也能对MAX1032进行方便的控制，但使用CPLD来控制系统外围设备，可以节省微控制器的资源，减轻其负担，同时可
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实现 方法 控制 采样 CPLD MAX1032 采用
- 基于CPLD的片内环形振荡器的设计方案,本文介绍一种通用的基于CPLD的片内振荡器设计方法，它基于环形振荡器原理，只占用片上普通逻辑资源(LE)，无需使用专用逻辑资源(如MaxII中的UFM)，从而提高了芯片的资源利用率；振荡频率可在一定范围内调整，振荡输出
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设计 方案 振荡器 内环 CPLD 基于
- 摘要：介绍了软件无线电的思想和结构，提出了一种实现软件无线电试验平台的设计方案，随后对各个模块进行了分析。整个试验平台可以根据用户的需求产生各种调制制式的中频信号；也可以接收各种中频信号，并变频成基
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CPLD 无线
- 摘要：采用MAX II系列CPLD器件来实现LCD控制器。由于MAX II CPLD是唯一具有用户闪存(UFM)的CPLD，因此用一片CPLD 芯片就可完成LCD全部的时序控制、显示控制等功能,这样无需再加入其它的接口器件，使微处理器和LCD显示
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CPLD LCD
- 介绍了14位ADC采样芯片MAX1032的特性及工作原理，结合CPLD，给出MAX1032使用外部时钟模式由CPLD控制采样和存储结果应用方案及CPLD的逻辑设计方法。本方案适用于工业控制，自动测试，数据采集等领域。文中同时给出了使用Verilog编写的CPLD代码及主要原理图。
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1032 CPLD MAX
- FPGA/CPLD设计思想与技巧, 本文讨论的四种常用FPGA/CPLD设计思想与技巧：乒乓操作、串并转换、流水线操作、数据接口同步化，都是FPGA/CPLD逻辑设计的内在规律的体现，合理地采用这些设计思想能在FPGA/CPLD设计工作中取得事半功倍的效果。
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技巧 设计思想 FPGA/CPLD
- 基于ARM7和CPLD的数字公交站亭系统设计, 摘要：提出了一种基于ARM7 和CPLD 架构的数字公交站亭系统。系统通过GPRS 模块与公交控制中心实时通信，使用CA 认证保证通信的安全性，采用两块SRAM 组成具有“乒乓逻辑”的高速缓存确保显示数据的连续性
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ARM DSP CPLD
- 针对目前靶场测试领域尤其是外弹道测试通常采用人工击发枪械的方式，存在安全性差、无法精确控制等问题，设计一种基于CPLD技术的枪械电磁扳机控制仪。采用步进电机作为执行单元，CPLD作为主控制器实现逻辑控制、通信功能。设计中着重考虑了电磁兼容及安全性，通过机械及电气两部分联锁确保控制仪无误触发。通过靶场试验，该控制仪能够适应靶场电磁环境，而且对其他仪器无干扰，其通信功能还可实现整体测试系统的同步性、自动化、网络化及远程控制。
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CPLD 枪械 电磁 控制仪
- 利用CPLD实现数字滤波及抗干扰,1 滤波和抗干扰概述
单片机应用系统的输入信号常含有种种噪声和干扰，它们来自被测信号源、传感器、外界干扰源等。为了提高测量和控制精度，必须消除信号中的噪声和干扰。噪声有两大类：一类为周期性的；另一类为
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波及 抗干扰 数字 实现 CPLD 利用
- 基于MAX7000系列CPLD的数据采集系统,CPLD是复杂的PLD，专指那些集成规模大于1000门以上的可编程逻辑器件。它由与阵列、或阵列、输入缓冲电路、输出宏单元组成，具有门电路集成度高、可配置为多种输入输出形式、多时钟驱动、内含ROM或FLASH(部分支持在系
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数据采集 系统 CPLD 系列 MAX7000 基于
- 输入系统的信息大多数是模拟量，为使计算机能够处理这些模拟量，必须经由数据采集系统将模拟量转化为数字量...
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AVR CPLD 高速数据采集
可编程逻辑器件(cpld)介绍
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