- 在IC封装制程的制程模拟中，为了同时提升工作效率与质量，CAE团队常会面临到许多挑战。在一般的CAE分析流程中，仿真分析产生结构性网格，是非常繁琐且相当花时间的。必须要先汇入2D (或3D) 图档，接着陆续建立表面网格、高质量的三维实体网格，再检查其网格的质量及正确性，以确保没有网格缺陷；接着再设定不同的属性，如chip, die等等；完成一个单元 (unit) 的实体网格建立后，还需要根据 strip 的设计并透过复制实体网格等方式建立一个完整封装模型，并且在模型外进行流道等实体网格的建立及边界条件设定
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