现代DSP芯片功能的扩展概述

因此，在C64x+核上，每个周期可执行8次16位×16位MAC。在1.2GHz时钟速率下，每秒钟可发生9600次16位MMAC。此外，C64x+核的每个乘法器每个时钟周期可计算一次32位×32位MAC或者四次8位×8位MAC。顺便提一下，C6452不是以900M的最快的速度工作。

C64x+处理器的新特征有一个令人钟爱的名字SPLOOP。这一小型指令缓冲器有助于创建软件流水线操作环路，在这些环路中并行执行环路的多次迭代。SPLOOP缓冲器减小了有关软件流水线操作的代码大小。

DSP+微控制器芯片

另一类DSP在芯片上附加微控制器核。有时，为一个分离的核，如ARM处理器。有的情况下，处理器核同时包含DSP和MCU功能。这种情况就是众所周知的模拟器件公司(ADI)的Blackfin DSP架构。

Blackfin是基于具有混合16/32型指令集架构的10级RISC MCU/DSP流水线，包括双16位MAC DSP指令和一个32位类似于RISC的指令集。这种组合提供信号处理功能，具有与通用处理器有关的使用方便的特点。Blackfin处理器架构完全兼容SIMD(单指令多数据)并包括视频与图像处理加速指令。

这种处理属性组合使Blackfin处理器与其同类产品不同。他们被设计为在信号处理和控制处理应用方面工作都非常好，在很多情况下，设计中无需独立的异类处理器。Blackfin处理器在单核产品中速率高达756MHz。

除本地支持8位数据外，8位数据字长是很多像素处理算法常用的，Blackfin架构包括专门定义的指令，用于在视频处理应用中增强性能。例如，SUM ABSOLUTE DIFFERENCE指令支持用于视频压缩算法(如MPEG2、MPEG4和JPEG)的运动估算算法。

这种架构处理多长度指令编码。非常常用的控制型指令被编码为紧凑的16位字，更多算术密集的信号处理指令编码为32位值。处理器将16位控制指令与32位信号处理指令混合并连接成64位组，以使存储器容量最大化。缓冲和取指令时，内核完全自动挑选总线长度，因为内核没有调整约束。

所有Blackfin处理器，如ADSP-BF523，都包含独立的DMA控制器，支持自动数据传输，而对处理器内核的操作压力很小(图3)。DMA传输可发生在内部存储器与许多具备可直接存储器存取(DMA)功能外设的任何部分之间。传输也能发生在外设和接至外部存储器接口的外部器件之间，包括SDRAM控制器和异步存储控制器。