- 滤波和抗干扰是任何智能仪器系统都必须考虑的问题。在传统的应用系统中，滤波部分往往要占用较多的软件资源和硬件资源。复杂可编程逻辑器件(CPLD)的出现，为解决这一问题开辟了新的途径，采用CPLD实现滤波是一种高效
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CPLD USB 串并转换 通信设计
- 全球领先的硅产品知识产权(SIP)平台解决方案和数字信号处理器(DSP)内核授权厂商CEVA公司宣布，凌阳科技有限公司(Sunplus Technology Co., Ltd.)已经实现采用CEVA-TeakLite-III DSP进行高清音频处理的系列家庭娱乐SoC产品批量出货。
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CEVA 凌阳科技 DSP
- 全球领先的硅产品知识产权(SIP)平台解决方案和数字信号处理器(DSP)内核授权厂商CEVA公司宣布，专业开发高成本效益卫星通信SoC器件的无晶圆厂半导体企业SatixFy公司已经获得CEVA-XC DSP授权许可，助力其最新的卫星基带SoC产品，目标是为固定和移动宽带市场带来价格相宜的高性能卫星通信功能。
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SatixFy 宽带卫星 SoC DSP
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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DSP 处理器 Flash存储器 接口
- 引言在电子工程设计与测试中，常常需要一些复杂的、具有特殊要求的信号，要求其波形可任意产生，频率方便可调。通常的信号产生器难以满足要求，市场上出售的任意信号产生器价格昂贵。结合实际需要，我们设计了一种任
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CPLD 单片机 任意波形发生器
- 今天，大多数的CPLD(复杂可编程逻辑器件)都采用可减少功耗的工作模式，但当系统未使用时，应完全切断电源以保存电池能量，从而实现很多设计者的终极节能目标。图1描述了如何在一片CPLD 上增加几只分立元件，实现一个
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CPLD 自动断电
- 1 引言ACEX 1K 系列器件是Altera 公司近期推出的新型CPLD 产品。该器件基于SRAM，结合查找表(LUT)和嵌入式阵列块(EAB)提供了高密度结构，可提供10 000 到100 000 可用门，每个嵌入式阵列块增加到16 位宽可实现双端口
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ACEX CPLD 配置方法
- 概述·DTMF信号发生器将按键或数字信号转化成双音信号。·DTMF信号检测器双音信号中的信息。·下图是一...
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DSP DTMF 信号发生器
- Altera公司30日宣布，在业界率先在28 nm FPGA器件上成功测试了复数高性能浮点数字信号处理(DSP)设计。独立技术分析公司Berkeley设计技术有限公司(BDTI)验证了能够在Altera Stratix® V和Arria® V 28 nm FPGA开发套件上简单方便的高效实现Altera浮点DSP设计流程，同时验证了要求较高的浮点DSP应用的性能。
Altera的浮点DSP设计流程经过规划，能够快速适应可参数赋值接口的设计更改，其工作环境包括来自MathWorks
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Altera FPGA DSP
- 基于CPLD的DSP人机接口模块的设计,CPLD(Complex programmable Logic Device，复杂可编程逻辑器件)是在传统的PAL、GAL基础上发展而来的，具有多种工作方式和高集成、高速、高可靠性等明显的特点。在超高速领域和实时测控方面有非常广泛的应用，日前的C
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模块 设计 接口 人机 CPLD DSP 基于
- 基于CAN总线的DSP芯片程序的受控加载实现,该技术使对DSP芯片程序的加载可以脱离仿真器而直接受控于列车的主控机#65377;该技术可靠性高#65380;使用灵活方便,具有很强的实用性#65377;磁悬浮列车上有很多基于DSP芯片的模块和系统#65377;目前, DSP芯片程序的
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受控 加载 实现 程序 芯片 CAN 总线 DSP 基于
- 1 引言随着信息技术革命的深入和计算机技术的飞速发展，低速、低可靠性的单片机以及小规模的集成电路已经越来越不能满足需要，正逐渐被DSP与可编程逻辑器件(如FPGA、CPLD)所取代。一方面，数字信号处理技术逐渐地发展
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FPGA DSP 雷达模拟 系统
- 当今可编程器件正朝着高密度、低功耗、高速的方向发展。今年，莱迪思半导体公司推出一种型号为ispMACH4000Z的CPLD器件系列，功耗极低，为便携式半导体消费品市场及其它对功耗有较高要求的电子产品市场提供了新的可编
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CPLD 超低功耗 电子 消费产品
- 引言利用图像传感器感知前方道路交通环境与障碍物位置，实现安全车距测量，对处于碰撞危险的汽车及时报警有利于减少交通事故，提高道路交通安全。由于理论计算的安全车距首先要以保障安全为前提，经常与驾驶员在行驶
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ARM9 DSP 汽车 碰撞预警
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