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VerilogHDL那些事儿-整合篇
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Verilog_HDL_那些事儿_时序篇v2
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VerilogHDL那些事儿_建模篇(for DB4CE15)
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A Verilog HDL Test Bench Primer
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《FPGA开发全攻略—技巧篇》
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从零开始学CPLD和Verilog+HDL编程技术
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设计与验证:Verilog+HDL(清晰带书签)
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[Verilog_HDL数字设计与综合].((美)Sanir.Palnitkar).第二版
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CPLD_DIY VGA实验 800x600@60Hz Verilog源代码、ModelSim测试激励、及烧录文件
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