- 本文给出了一个利用格雷码对地址编码的羿步FIFO的实现方法，并给出了VHDL程序，以解决异步读写时钟引起的问题。
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异步 FIFO VHDL 设计
- 在结构体中，设计任务的程序包内定义了一个8输入与门（and8）和一个二异或非门（xnor2）。把该程序包编译到库中，可通过USE从句来调用这些元件，并从work库中的gatespkg程序包里获取标准化元件。
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VHDL 结构体 结构化 描述法
- 据流描述（dataflow description）是结构体描述方法之一，它描述了数据流程的运动路径、运动方向和运动结果。例如，同样是一个8位比较器采用数据流法编程
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VHDL 结构体 数据流 描述法
- 无论是设计通信、消费、计算机或工业应用，MAX?II器件都能够为成本和功率受限的控制通道应用提供所需的功能。MAX II更低的价格，更低的功率和更大的容量使其成为复杂控制应用的理想方案，包括以往不可能在CPLD中实现的新应用。MAX II器件采用了全新 CPLD体系结构，比以往的MAX器件有重大改进。
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应用手册 CPLD
- VHDL是随着可编辑逻辑器件(PLD)的发展而发展起来的一种硬件描述语言。它是1980年美国国防部VHSIC(超高速集成电路)计划的一部分，并于1986年和1987年分别成为美国国防部和IEEE的工业标准。作为一种硬件设计时采用的标准语言，VHDL具有极强的描述能力，能支持系统行为级、寄存器传输级和门级三个不同层次的设计，这样设计师将在TOP-DOWN设计的全过程中均可方便地使用同一种语言。
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VHDL 有线顶盒 信源发生 方案
- Verilog HDL 中的标识符 (identifier) 可以是任意一组字母、数字、 $ 符号和 _( 下划线 ) 符号的组合，但标识符的第一个字符必须是字母或者下划线。另外，标识符是区分大小写的。
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Verilog 语言要素 VHDL
- Verilog HDL 是硬件描述语言的一种，用于数字电子系统设计。该语言是 1983 年由 GDA （ GateWay Design Automation ）公司的 Phil Moorby 首创的。 Phil Moorby 后来成为 Verilog － XL 的主要设计者和 Cadence 公司（ Cadence Design System ）的第一个合伙人。
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VerilogHDL VHDL 设计流程
- Verilog模块之间的连接是通过模块端口进行的。为了给组成设计的各个模块定义端口，我们必须对期望的硬件设计有一个详细的认识。不幸的是，在设计的早期，我们很难把握设计的细节。
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SystemVerilog 语言 VHDL
- Xilinx CoolRunner 系列CPLD器件分CoolRunner-Ⅱ系列和CoolRunner XPLA 3系列器件。1999年8月，Xilinx收购了Philips的CoolRunner生产线并开始提供XPLA（eXtenden Programmable Logic Array，加强型可编程逻辑阵列）系列器件
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Xilinx CoolRunner CPLD
- HDL 语言在国外有上百种。高等学校、科研单位、 EDA 公司都有自己的 HDL 语言。现选择较有影响的作简要介绍。
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HDL VHDL 种类
- Xilinx CPLD 器件可使用 Foundation 或 ISE 开发软件进行开发设计，也可使用专门针对 CPLD 器件的 Webpack 开发软件进行设计。XC9500系列器件分XC9500 5V器件、XC9500XL 3.3V器件和XC9500XV 2.5V器件3种类型，XC9500系列可提供从最简单的PAL综合设计到最先进的实时硬件现场升级的全套解决方案。
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Xilinx XC9500 CPLD
- 经过几十年的发展，全球各大开发商和供货商都开发出了多种可编程逻辑器件 . 比较典型的就是 Xilinx 公司的 FPGA 器件和 Altera 公司的 CPLD 器件系列，他们开发较早，占有大部分市场?在欧洲用 Xilinx 的人多，而 Altera 公司占有日本和亚太地区的大部分市场，在美国则是平分秋色。
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Xilinx Altera 芯片 选型 CPLD
vhdl-cpld介绍
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