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Verilog HDL基础之:Verilog HDL语言简介

  • Verilog HDL是硬件描述语言的一种,用于数字电子系统设计。它允许设计者用它来进行各种级别的逻辑设计,可以用它进行数字逻辑系统的仿真验证、时序分析、逻辑综合。它是目前应用最广泛的一种硬件描述语言之一。Verilog HDL是在1983年由GDA公司的Phil Moorby首创的。
  • 关键字: VerilogHDL  VHDL  Verilog-XL  华清远见  

Verilog HDL基础之:赋值语句和块语句

  • 在Verilog HDL语言中,信号有两种赋值方式:非阻塞赋值方式和阻塞赋值方式。块语句通常用来将两条或多条语句组合在一起,使其在格式上看更像一条语句。块语句有两种:一种是begin_end语句,通常用来标识顺序执行的语句,用它来标识的块称为顺序块;另一种是fork_join语句,通常用来标识并行执行的语句。
  • 关键字: VerilogHDL  华清远见  赋值语句  块语句  阻塞赋值  

Verilog HDL基础之:数据类型和运算符

  • Verilog HDL中总共有19种数据类型,数据类型是用来表示数字电路硬件中的数据储存和传送元素的。在本书中,我们先只介绍4个最基本的数据类型,它们分别是:reg型,wire型,integer型和parameter型。
  • 关键字: VerilogHDL  华清远见  数据类型  运算符  网络类型变量  

Verilog HDL基础之:实例5 交通灯控制器

  • 本实例通过Verilog HDL语言设计一个简易的交通等控制器,实现一个具有两个方向、共8个灯并具有时间倒计时功能的交通灯功能。
  • 关键字: VerilogHDL  华清远见  FPGA  交通灯控制器  

Verilog HDL基础之:程序基本结构

  • Verilog HDL是一种用于数字逻辑电路设计的语言。用Verilog HDL描述的电路设计就是该电路的Verilog HDL模型。Verilog HDL既是一种行为描述的语言,也是一种结构描述的语言。也就是说,既可以用电路的功能描述,也可以用元器件和它们之间的连接来建立所设计电路的Verilog HDL模型。
  • 关键字: VerilogHDL  数字逻辑电路  华清远见  

Verilog HDL基础之:实例4 PS/2接口控制

  • 本实例通过Verilog编程实现在红色飓风II代Xilinx开发板上面实现对键盘、LCD、RS-232等接口或者器件进行控制,将有键盘输入的数据在LCD上面显示出来,或者通过RS-232在PC机上的超级终端上显示出来。
  • 关键字: VerilogHDL  华清远见  

Verilog HDL基础之:程序设计经验(独家)

  • 对于Verilog HDL的初学者,经常会对语法中的几个容易混淆的地方产生困惑。本文列出几个常见问题和解决它们的小窍门。
  • 关键字: VerilogHDL  华清远见  

Verilog HDL基础之:与C语言的区别与联系(独家)

  • Verilog HDL基础之:与C语言的区别与联系。C语言很灵活,查错功能强,还可以通过PLI(编程语言接口)编写自己的系统任务直接与硬件仿真器(如Verilog-XL)结合使用。C语言是目前世界上应用最为广泛的一种编程语言,因而C程序的设计环境比Verilog HDL更完整。
  • 关键字: VerilogHDL  华清远见  C语言  

Verilog HDL基础之:组合逻辑电路的实现(原创)

  • Verilog HDL基础之:组合逻辑电路的实现。数字逻辑电路分为两种,分别是组合逻辑与时序逻辑。组合逻辑:输出只是当前输入逻辑电平的函数(有延时),与电路的原始状态无关的逻辑电路。时序逻辑:输出不只是当前输入的逻辑电平的函数,还与电路目前所处的状态有关。
  • 关键字: VerilogHDL  华清远见  数字逻辑电路  

Verilog HDL基础之:条件语句

  • Verilog HDL基础之if语句是用来判定所给定的条件是否满足,根据判定的结果(真或假)决定执行给出的两种操作之一。Verilog HDL语言提供了3种形式的if语句。case语句是一种多分支选择语句,if语句只有两个分支可供选择,而实际问题中常常需要用到多分支选择。Verilog语言提供的case语句直接处理多分支选择。
  • 关键字: VerilogHDL  华清远见  

Verilog HDL基础之:其他常用语句

  • Verilog HDL常用的其他语句有:循环语句、结构说明语句等。
  • 关键字: VerilogHDL  华清远见  

基于Verilog状态机的PLC背板总线协议接口芯片设计

  • 设计了一组基于CPLD的PLC背板总线协议接口芯片,协议芯片可以区分PLC的背板总线的周期性数据和非周期性数据。详细介绍了通过Verilog HDL语言设计状态机、协议帧控制器、FIFO控制器的过程,25MHz下背板总线工作稳定的试验结果验证了协议芯片设计的可行性。
  • 关键字: VerilogHDL  PLC背板  CPLD  

32位定浮点数正余弦函数FPGA实现方法

  • 本文首先介绍了查表算法和Cordic算法原理,在这两种算法基础上,用Verilog HDL语言对32位定点数的正余弦函数进行了编程设计,结合仿真综合结果,对这两种方法从运算精度,运算速度和占用硬件资源几方面进行了分析.进而采用不经过浮点定点转换,直接在Cordic算法改进的基础上实现32位浮点数的正余弦函数FPGA设计.最后,对这三种实现方法进行了综合评价.
  • 关键字: Cordic算法  VerilogHDL  正余弦函数  

基于Nios II的MIII总线转换板设计

  • 本文介绍的MIII总线转换板的主要功能是将机载火控设备的MIII总线数据转换成串口数据,以方便实现与PC机的通信,这样,PC机就可读取机载设备数据或发送指令以操作总线设备。
  • 关键字: MIII总线  VerilogHDL  NiosII  

3-DES IP核的VerilogHDL设计

  • 首先介绍了3-DES算法的加密/解密原理,在此基础上,采用流水线技术,设计了一种高速的3-DES加/解密IP核,并用VerilogHDL语言描述其中的各个模块。
  • 关键字: IP核  流水线技术  VerilogHDL  DES加/解密  
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