8月19日,2022第五届中国IC独角兽论坛在南京举办。RISC-V软硬件生态领导者赛昉科技蝉联“中国IC独角兽称号”,赛昉科技资深销售总监周杰出席颁奖典礼并发表主题演讲。 2021-2022(第五届)中国IC独角兽遴选活动由赛迪顾问股份有限公司、北京芯合汇科技有限公司联合主办,众多行业权威专家参与评选,作为中国RISC-V领军企业,赛昉科技连续第二年入选榜单。 “聚焦高端芯片”是“十四五”规划中关于加强关键数字技术创新应用的关键举措。赛昉科技始终聚焦于高性能RISC-V芯片研发,成
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RISC-V 赛昉科技
IT之家 8 月 22 日消息,据盛微先进科技消息,高清蓝牙协议标准 LHDC-V 版本现已发布,最高支持 24bit / 192KHz。官方表示,LHDC-V 版本在经典蓝牙音频传输与 LE Audio 架构下,于有效码率范围下实现真实 24bit / 192Khz 传输,频响范围来到了 20Hz – 96KHz,因为位与取采样率提升,可具备比起 CD 音质更大的动态范围,更能真实还原音乐的细节。官方称,LHDC 通过对车机的支持与车辆室内空间参数的优化与调整,为行车出行带来高音质与身历其境般
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蓝牙 标准 LHDC-V 盛微先进科技
IT之家 8 月 22 日消息,据赛昉科技宣布,首款集成 3D GPU 的量产 RISC-V 单板计算机明日发布。官方表示,“性能领先,接口丰富,价格便宜,全面开源!”据介绍,与此前产品相比,新一代 RISC-V 单板计算机在性能大幅领先同时,价格却大幅降低。玩游戏、3D 渲染、多图层并行,用户均能得到流畅体验,发布会现场将用 demo 为大家展示。中国工程院院士倪光南将为发布会做开场致辞。此外,还有更多 RISC-V 产业链、生态链的重磅嘉宾亲临现场。赛昉科技预告表示,“这是全球性能最高、也是
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GPU RISC-V 赛昉科技
智慧工业物联芯片解决方案的引领者,同时也是聚焦研发基于RISC-V开源指令集架构SoC芯片产品的高科技公司跃昉科技于8月16日在深圳举办“跃昉智慧物联芯,助力双碳新基建”新品发布会暨媒体沟通会,并于会上重磅发布全球首款定位高端工业级应用的可量产12nm RISC-V SoC芯片NB2及其配套板卡产品,预计Q4量产。四核1.8G的CPU,算力超过32000 DMIPS,850MHz 的GPU,1.4GHz NPU,支持Linux+ RTOS + OpenAMP异构OS运行环境,这款64位边缘智能处理器NB2
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跃昉科技 RISC-V 工业
第二届RISC-V中国峰会(RISC-V Summit China 2022)将于8月24日盛大开幕。RISC-V中国峰会于去年首次举行,获得巨大成功,线下观众超过1500人,线上观众超过3万人次,参与厂商超过100家,是迄今为止国内最大的RISC-V技术大会,已成为国内业界同仁、技术同好所期盼的标杆活动。 本届峰会主会将在线上举行,持续三天(8月24日-26日),预计线上参会超过10万人次,超过上届。同期各类同地活动将以线上线下结合形式举办,包括技术研讨会(workshops)、产品推广和培训
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RISC-V 中国峰会 报名
第二届RISC-V中国峰会(RISC-V Summit China 2022)将于8月24日盛大开幕。RISC-V中国峰会于去年首次举行,获得巨大成功,线下观众超过1500人,线上观众超过3万人次,参与厂商超过100家,是迄今为止国内最大的RISC-V技术大会,已成为国内业界同仁、技术同好所期盼的标杆活动。 本届峰会主会将在线上举行,持续三天(8月24日-26日),预计线上参会超过10万人次,超过上届。同期各类同地活动将以线上线下结合形式举办,包括技术研讨会(workshops)、产品推广和培训
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RISC-V 中国峰会
可定制RISC-V处理器知识产权(IP)和处理器设计自动化的领导者Codasip日前宣布,Veridify Security公司的抗量子安全工具现在可以通过安全启动功能支持Codasip的RISC-V处理器。在固件加载到Codasip处理器上时,Veridify的安全算法就会对其进行验证,以使RISC-V开发人员确信嵌入式系统是安全可用的。Veridify的安全启动功能是基于一种比传统加密方法运行速度更快的算法;只需要很小的代码空间和超低功耗,非常适合Codasip的低功耗嵌入式处理器系列。通过使用Ver
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Codasip RISC-V IP
可定制RISC-V处理器硅知识产权(IP)的领导者Codasip日前宣布,其Codasip Studio平台现已支持苹果公司macOS Monterey(当前macOS的主要版本)。Codasip Studio是一个处理器设计自动化平台,用于完成Codasip领先的RISC-V处理器IP的定制,使设计人员能够快速且轻松地定制其处理器设计,以面向特定领域中的应用实现最高性能。Codasip Studio还可以用于创建Codasip的业内最佳的RISC-V处理器内核,并帮助设计人员评估微架构的替代方案。应用软
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RISC-V IP
处理器设计自动化领域的领导性企业Codasip宣布,其可定制L31嵌入式RISC-V处理器荣获了2022年嵌入式世界大会(Embedded World 2022)处理器和知识产权(IP)类别的展会最佳产品大奖。最佳产品优胜者大奖是由《嵌入式计算设计(Embedded Computing Design)》依据产品的设计卓越性、相对性能和市场影响/颠覆性等标准进行评选并颁发。 Codasip的L31 RISC-V内核荣获处理器和IP类别的展会最佳产品大奖。图片来源:《嵌入式计算设计》《嵌入式计算设计
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Codasip L31 RISC-V
Imagination Technologies宣布推出其首款实时嵌入式IMG RISC-V CPU- RTXM-2200。这款高度可扩展、功能丰富、设计灵活的32位嵌入式解决方案适用于多种类型的大容量设备。RTXM-2200是Imagination 2021年12月发布的 Catapult CPU系列中的首批商用核之一。 Imagination的IMG RTXM-2200加快了公司RISC-V产品的扩展速度。它可以集成到复杂的系统级芯片(SoC)中,应用范围包括网络解决方案、数据包
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嵌入式 RISC-V CPU- RTXM-2200
业界首款支持免专利费RISC-V开放式指令集架构(ISA)的SoC现场可编程门阵列(FPGA)近日开始量产,迎来嵌入式处理器发展历程中的一个重要里程碑。随着客户继续快速采用PolarFire® SoC FPGA,Microchip Technology Inc.(美国微芯科技公司)宣布MPFS250T以及之前发布的MPFS025T已具备量产条件。Microchip同时宣布,旗下Mi-V生态系统将继续简化RISC-V的采用,以支持新一类体积更小、功耗和成本更低的工业、物联网和其他边缘计算产品。Microch
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RISC-V FPGA
西门子数字化工业软件近日推出适用于嵌入式开发的 Nucleus™ ReadyStart™ 解决方案,以应对 RISC-V 架构应用的迅速增长。该新版 Nucleus ReadyStart 嵌入式开发解决方案以去年发布的 RISC-V 设备商用实时操作系统 (RTOS) 为基础,更新了一系列新功能,可帮助客户增强基于 RISC-V 架构的下一代嵌入式产品的安全性、灵活性以及云连接能力。面向 RISC-V 的 Nucleus ReadyStart 将软件、IP、工具、服务集成在统一的“即用型”解决方案中,对于
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RISC-V 嵌入式
近日,欧拉开源操作系统在赛昉科技的昉·星光 RISC-V 单板计算机 VisionFive 上成功运行。openEuler 与 VisionFive 的适配工作由 RISC-V SIG 开发者袁穗聪(Samuel Yuan)负责并完成。目前,openEuler 在 VisionFive 上的基础软件适配成功,整体运行过程较为流畅,外设工作正常。VisionFive 由 RISC-V 软硬件生态领导者赛昉科技推出,是全球首批基于 Linux 的高性价比的 RISC-V 单板计算机。VisionFive 为开
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欧拉 开源操作系统 VisionFive RISC-V 单板计算机
处理器设计自动化领域的领导性企业Codasip近日宣布:通过采用西门子集团Siemens EDA的OneSpin IC验证工具,扩大了其形式验证解决方案的可用工具范围,以进行全面和彻底的处理器测试。Codasip不断在处理器验证方面投入巨资,以再接再厉为业界提供最高质量的RISC-V处理器半导体知识产权(IP)。Siemens EDA的OneSpin工具提供了一个先进且无比强大的验证平台,用以解决关键的芯片完整性问题。OneSpin是极为先进的形式验证工具,适用于汽车和其他高完整性处理器应用,能以最少的设
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Codasip 西门子EDA RISC-V 形式验证
4月18日,记者获悉,2022“玄铁杯”RISC-V应用创新大赛正式启动。本届大赛采用首款量产RISC-V处理器玄铁C906,参赛者可通过平头哥免费开放的“云上实验室”一键开发,在不受软硬件限制的RISC-V“算力自由”开发环境中,探索“碳中和”及工业控制等领域的创新应用。 (图说:2022“玄铁杯”RISC-V应用创新大赛开赛) RISC-V是近年兴起的一种CPU新架构,因其开放、灵活的特性而逐渐成为半导体行业的热门选择。当前,已有近2500家机构加入RISC-V基金会,包括阿里、华
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RISC-V 新架构 碳中和 工控 平头哥 玄铁处理器
rsic-v介绍
RISC-V(读作“RISC-FIVE”)是基于精简指令集计算(RISC)原理建立的开放指令集架构(ISA),V表示为第五代RISC(精简指令集计算机),表示此前已经四代RISC处理器原型芯片。每一代RISC处理器都是在同一人带领下完成,那就是加州大学伯克利分校的David A. Patterson教授。与大多数ISA相反,RISC-V ISA可以免费地用于所有希望的设备中,允许任何人设计、制造和 [
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