找到价格、性能和功耗的最佳结合点实际上就确保赢得了SoC设计，但说起来容易做起来难。在实际可用的双芯核架构、可编程加速器和数百万门FPGA出现以前，一种80:20法则用起来很奏效：如果计算负荷的80%为数据处理，那么选择RISC架构，在RISC中实施信号处理。而当今面临太多的架构选择，差别甚微，用单一处理器架构来解决优化问题已不可能。一种较为成功的方法是通过将计算资源与特性集匹配来实现。将一种复杂系统映射到硅中，在相当程度上依赖于设计是在现有SoC上实现还是从头做起。对于前一种情况，系统设计师应从了解四个
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TI SoC ASIC
利用嵌入式硅IP可以缩短SoC设计所需的开发时间，这已成为众所公认的事实。但要从完工后的整个系统角度出发，整合及验证来自多家厂商的元件，需要相当的时间和努力，然而它们却常被忽略。这会对嵌入式软件开发人员造成额外负担，因为他们需要SoC的外围和接口以及处理器的精确模型，才能在设计投片之前，针对正在开发的SoC，迅速完成应用固件的测试及除错。如果SoC平台以可配置处理器和外围IP为基础，这些IP又来自多家供货商，这种情形就更加重要，因为设计人员必须确认在特定配置下，每个元件的功能不会影响到其它元件的工作。除此
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ARC SoC ASIC
摘 要：AMBA总线是目前主流的片上总线。本文给出的双层AMBA总线设计能极大地提高总线带宽，并使系统架构更为灵活。文章详细介绍了此设计的实现，并从两个方面对两种总线方式进行了比较。关键词：双层AMBA总线;总线带宽;SoC
引言一般说来，SoC芯片是由片上芯核、用户设计的IP核以及将这两者集成在一起的总线组成的。片上芯核决定了使用何种片上总线以及芯片的体系结构。ARM系列嵌入式微处理器凭借其高性能、低功耗的特点占据了市场的主要份额，ARM7TDMI因其相对低廉的价格
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SoC 双层AMBA总线 总线带宽 SoC ASIC
赛普拉斯半导体公司的子公司——赛普拉斯微系统公司 (Cypress MicroSystems) 近日宣布：其体积最小、集成度最高的可编程系统级芯片 (PSoCTM) 混合信号阵列已进入批量生产销售阶段。除了4个可配置模拟部件和4个可配置数字部件之外，CY8C21x34器件还提供了用于程序存储器的8K字节快闪存储器和用于数据存储的512字节SRAM，从而使其成为对成本敏感的消费类和工业控制应用（比如触摸感应控制屏、安全传感器和控制、智能型温度、压力和流量传感器、大型传感器阵列、风扇控制器和电池充电器等）的理
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Cypress SoC ASIC
摘 要：本文介绍了IP核的概念及其在SoC设计中的应用，讨论了为提高IP核的复用能力而采用的IP核与系统的接口技术。 关键词：SoC；IP核；OCP引言随着半导体技术的发展,深亚微米工艺加工技术允许开发上百万门级的单芯片，已能够将系统级设计集成到单个芯片中即实现片上系统SoC。IP核的复用是SoC设计的关键，但困难在于缺乏IP核与系统的接口标准，因此，开发统一的IP核接口标准对提高IP核的复用意义重大。本文简单介绍IP核概念，然后从接口标准的角度讨论在SoC设计中提高I
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IP核 OCP SoC SoC ASIC
中国每三年举办一次的固态和集成电路技术国际会议(International Conference on Solid-State and Integrated-Circuit Technology，ICSICT)是目前在中国召开的集成电路和微电子技术领域最高级别和最大的国际会议。它提供了一个展示固态和集成电路领域最新发展的国际交流平台，为提高中国集成电路技术的学术水平和推动中国集成电路产业的发展起到了十分积极的作用。固态器件、集成电路、工艺技术、先进材料和其它相关的所有研究领域都属于会议的讨论范围。&nbs
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Cadence SoC ASIC
嵌入式标准产品（ESPs）的先驱企业QuickLogic公司（Nasdaq股票代码: QUIK）于今天日发布了QL92xxx 系列可编程片上系统器件（ProgrammableSOC）的。该系列产品系列以广受欢迎的以QuickMIPS 产品系列中的的QL902M为 为基础并，内置了了专为用于嵌入式数字媒体应用的器件而设计的附加预编程模块。该系列的首款产品为QL92010，其中内置了了一个IDE控制器。秉承QuickLogic一贯专注努力于提供有线/无线IP网络数字媒体传输和处理的芯片解决方案的传统，Quic
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QuickLogic SoC ASIC
2004年6月A版
摘 要：本文分析了深亚微米下超大规模SoC的电源设计中存在的问题，给出了业界适用的设计、验证方法，并以工程设计为例，给出层次性SoC设计中电源设计、验证的适用流程。
关键词：系统芯片；电源电压降；地电压反弹；电源网格
引言
SoC(系统芯片)是现代微电子技术向前发展的必然趋势。与工艺技术逐步先进的变化相适应，SoC芯片上的内核逻辑的供电电压也逐步降低。供电电源电压减小的一个显著好处是使整个芯片的功耗降低，然而它同时也带来了芯片噪声容限降低的负面影响。芯片供电电源
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SoC SoC ASIC
电子设计应用2004年第9期 门阵列的好处在于它不仅可以减小PCB板的尺寸，而且可以降低功耗、提高可靠性，以及降低整个系统成本。但由于门阵列的设计工具价格太高， 流片费用(NRE)的负担太重，风险高，设计周期太长， 所以不能被一般公司所采用。Xilinx开发出的第一批基于SRAM的FPGA， 由于其软件价格很低，没有流片费用，所以它比门阵列更容易普及而被工程师所采用。如今芯片产业已经可以把数百万门的逻辑放入一个芯片里，使其达到可以把整个系统浓缩到单个芯片的程度，这不仅代表把逻辑和ASIC 放入单一芯片，它
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FPSLIC SoC ASIC
赛普拉斯半导体公司 (NYSE：CY) 的子公司赛普拉斯微系统有限公司（Cypress MicroSystems）于今日宣布已开始生产一款新型可编程系统级芯片（PSoCTM）混合信号阵列。这种具有扩展数字集成功能的新型器件拓展了广受欢迎的PSoC架构的适用范围，以满足消费类、工业、办公自动化、电信和汽车应用中更大规模、更复杂的嵌入式控制功能的需要。赛普拉斯微系统公司的市场副总裁John McDonald说：“我们注意到客户需要更多的数字功能，以提高外围部件的集成度。我们的新款PSoC器件使得可用于实现片上
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赛普拉斯 SoC ASIC
日前，Mentor和华为共同宣布共同建立SOC软硬件协同验证环境。旨在加强SoC验证方面双方的全面合作。事先，华为已经利用Mentor公司提供的Seamless软硬件协同验证方案成功建立了ARM-based SoC验证环境。利用Seamless协同验证环境，华为已经成功调试，并解决了多款基于ARM7TDMI、 ARM926ejs、Power PC的SoC芯片软硬件接口问题。华为早在上个世纪90年代就认识到SoC的功能验证比传统的ASIC的功能验证更具有挑战性，需要付出更多的仿真努力，同时产品的开发周期也更
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Mentor Graphics SoC ASIC
美国Cadence设计系统公司公司（纽约证券交易所代码：CDN）董事会主席Ray Bingham先生一行，到北京集成电路设计园访问, 设计园公司总经理郝伟亚先生详细介绍了设计园以及北京集成电路设计产业发展情况。Ray Bingham先生表示，Cadence长期致力于中国电子产业的发展，支持北京集成电路产业的发展，对于作为中国7个国家IC设计基地之一的北京集成电路设计园，扩展其数字设计平台，选用Cadence SoC Encounter为实现很复杂、高性能的芯片提供经过验证的设计工具，应对纳米技术挑战，感
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Cadence SoC ASIC
美国Cygnal公司专门从事混合信号系统芯片(SoC)单片机的设计与制造。公司更新了原51单片机结构，设计了具有自主产权的CIP-51内核，运行速度高达每秒25MIPS。现已设计并为市场提供了29个品种的C8051F系列SoC单片机，预计今年年内还将完成20多个新的SoC单片机的设计。 C8051F系列是集成的混合信号系统芯片SoC单片机，具有与MCS-51内核及指令集完全兼容的微控制器，除了具有标准8051的数字外设部件之外，片内还集成了数据采集和控制系统中常用的模拟部件和其它数字外设及功能部件(参见图
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SoC ASIC
半导体器件定标(scaling)在量上的不断进展蕴育着系统级芯片(SoC)器件在设计和结构上质的深刻变化。IC器件定标可以加强功率效率、增加带宽和显著改进功能集成性，而要挖掘出硅的全部性能潜力，还须在设计复杂性管理和改进设计可重用性方面做同样的努力。代表ITRS对半导体定标的一致观点的一个简易技术模型示出了芯片设计上一系列重大变化。较高层次的可编程性可以缓解经济上的压力。专用处理器性能的不断提高和器件的自动生成将使处理器芯核在SoC结构体系中发挥重大作用，诸如从高性能控制到以前只能由硬连接逻辑才可以实现的
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SoC SoC ASIC
赛普拉斯半导体(Cypress Semiconductor)公司的子公司赛普拉斯微系统有限公司（Cypress MicroSystems）于今日宣布推出用于其可编程系统级芯片（PSOCTM）混合信号阵列的PSoC Designer 4.0集成开发环境（IDE）。PSoC Designer 4.0是一个完整的图形成套工具，它通过提供“点击”系统设计能力而为用户利用PSoC的功能和灵活性给予了帮助。PSoC Designer 4.0提供了设备和应用程序编辑器以及一个简单图形用户接口（GUI）下的编译器、调试器
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