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DDR的前世与今生(二)

  •   SDRAM与DDR SDRAM   SDRAM是比较久远的事情了,但我们一说到它肯定不会和 DDR混淆,我们通常理解的SDRAM其实是SDR SDRAM,为SDRAM的第一代,而DDR1则为第二代,乃至到我们现在使用的DDR4,其实为第五代SDRAM,在此需要澄清一下。以示区别,后续文 章里面用SDR来特指SDR SDRAM,而DDR就特指DDR SDRAM了。   就像很多人回复的一样,他们的本质区别就是周期操作方 式(也称时钟采样)的差异,这就导致后面设计上很大的不同。SDR都是“
  • 关键字: DDR  SDRAM  

e2v宣布计划延长Micron部分SDR和DDR存储产品的寿命

  • 射频功率、成像和高可靠性半导体解决方案领域的领军企业 e2v aerospace and defense, Inc. (e2v ad) 近日宣布,将延长世界领先高级存储解决方案供应商之一 Mic
  • 关键字: Micron  e2v  DDR   

IDT为Intel Xeon处理器提供企业解决方案

  • 混合信号半导体解决方案供应商 IDT® 公司宣布支持基于 Nehalem 的 Intel® Xeon® 处理器,该处理器采用可进行生产的 PCI Express®(PCIe®)交换和计
  • 关键字: IDT  DDR   

SDRAM连接电路设计详解

  • 介绍SDRAM电路设计之前先了解下SDRAM的寻址原理。SDRAM内部是一个存储阵列,可以把它想象成一个表格,和表格的检索原理一样,先指定行,再指定列,
  • 关键字: SDRAM  电路设计    

SRAM简介及与DRAM/SDRAM的比较

  • RAMRAM是指通过指令可以随机的、个别的对各个存储单元进行访问的存储器,一般访问时间基本固定,而与存储单元地址无关。RAM的速度比较快,但其保
  • 关键字: SRAM  DRAM  SDRAM  比较  

DDR的前世与今生(一)

  •   DDR SDRAM全称为Double Data Rate SDRAM,中文名为“双倍数据率SDRAM”。DDR是在原有的SDRAM的基础上改进而来,严格的说DDR应该叫DDR SDRAM,人们习惯称为DDR。   说到这里,很多人可能会问SDRAM、DRAM、SRAM或者RAM、ROM到底是什么鬼,怎么区别的?小编还是来简单普及下关于存储的基础知识吧。   ROM 和RAM指的都是半导体存储器,ROM是只读存储器(Read-Only Memory)的简称,是一种只能读出事先
  • 关键字: DDR  DRAM  

Xilinx MIG IP核的研究及大容量数据缓冲区的实现

  • 为了使DDR3 SDRAM更方便、多样地用于工程开发中,本文对XILINX公司DDR3 SDRAM提供的MIG核进行了分析研究,并在此基础上实现了大容量数据缓冲区的逻辑设计。通过对系统中各模块的作用及相互间关系的研究,发现该控制器256位接口对工程开发十分不便,通过创建FIFO控制系统和读写接口FIFO的方式,将接口转换为64位。该方案对控制核重新构建并上板测试,均符合高速数据传输缓存的要求,使DDR3成为一个大容量且可控的高速FIFO。
  • 关键字: MIG核  FIFO  DDR3 SDRAM  201608  

大话存储器——存储器无处不在

  •   特权同学对存储器的认识也许还很肤浅,但是不要紧,学习靠积累,靠总结。希望在大话存储器的一些文章里总结归纳一些和存储器相关的知识,也希望能够理出一条清晰的思路,让大家也让我自己对存储器有更深入的认识何了解。   提到存储器相信没有人会陌生,也许你的第一反应会是PC机的内存条、硬盘,如果你是个电子行业的学生或者从业者,你也许还会想到FLASH、SRAM、SDRAM、EEPROM等等。的确,信息时代的存储器可谓无处不在,也正是因为有了存储器,才让计算机(特权同学认为这个计算机的概念不仅仅是电脑,嵌入式的任
  • 关键字: 存储器  SDRAM  

零基础学FPGA (二十五)必会! 从静态时序分析到SDRAM时序收敛(下篇)

  •   七、SDRAM工作时钟相位偏移计算   从上篇文章中我们知道,我们的数据是要经过一定的延时才会到达目标器件的,这个延时也就是相对于源寄存器的时钟发射沿的时间延时,数据在源寄存器时钟的上升沿到来时输出,经过FPGA的走线,PCB走线等,到达目标寄存器的数据端口时会有一定的延时,而这个数据要想被目标器件的目的寄存器锁存,那么,目的寄存器的锁存时钟应该尽量在数据的有效窗口内才能确保数据被捕获成功。所谓数据的有效窗口,就是数据在两次变化之间的中间部分,也是数据最稳定的部分。   所以,要想将数据正确捕获,
  • 关键字: FPGA   SDRAM  

零基础学FPGA (二十四)必会! 从静态时序分析到SDRAM时序收敛(上篇)

  •   下面我们进入正题,今天我们讲时序   一、从静态时序分析说起   我理解的静态时序分析,就是我们在不加激励的情况下,通过对电路进行时序的延迟计算,预计电路的工作流程,对电路提出我们需要的一些约束条件,比如我们需要从A寄存器到B寄存器的延迟不能大于10ns,如果我们不添加时序约束,综合工具可能会有好几条路径,按照它自己的要求来布局布线,那么从A寄存器到B寄存器的时间就有可能是20ns或者15ns之类的路径,而我们需要的是不能大于10ns,因此,我们需要添加时序约束,再根据特定的时序模型,使我们的系统
  • 关键字: FPGA  SDRAM  

零基础学FPGA (二十三) SDR SDRAM(架构篇)

  •   今天我们来讲的是SDRAM的架构以及设计,这也是小墨第一次接触架构,也谈不上给大家讲,就是把我理解的当做一个笔记分享给大家,有什么错误也请积极指正,毕竟我也是没有老师教,也是自己摸索的,难免有些不合理的地方。   一、SDRAM 工作部分   1、上电初始化        我们先来看第一部分,上电初始化。上电初始化我们知道,上电之后我们需要等待200us的稳定期,这段时间我们可以用一个定时器来计数,这没什么问题,然后进入的是预充电部分,这个时候,预充电的时候,sdram_cmd
  • 关键字: FPGA  SDRAM  

零基础学FPGA (二十二) SDR SDRAM(理论篇)

  •   其实说实话这一个月来也没怎么看新知识,大体梳理了一下以前学过的知识,回顾了一下SOPC的学习。对于SOPC的学习我打算暂时先放一放,因为前面还有一个要写的没有完成,也是一直以来无法写起的一个题目,就是今天我们要写的SDRAM的操作。等写完这个,我们再回到SOPC,带领大家调USB2.0!   由于SDRAM本身就是一个比较复杂的东西,之前小墨在学这方面东西的时候感觉很是吃力,于是那时候便暂时放下了,知道年后这段时间,小墨又重新拾起这个知识点,想要一口气把它调通了,再往下看其他的东西。学SDRAM,理
  • 关键字: FPGA  SDRAM  

信号在PCB走线中传输时延

  •   信号在媒质中传播时,其传播速度受信号载体以及周围媒质属性决定。在PCB(印刷电路板)中信号的传输速度就与板材DK(介电常数),信号模式,信号线与信号线间耦合以及绕线方式等有关。随着PCB走线信号速率越来越高,对时序要求较高的源同步信号的时序裕量越来越少,因此在PCB设计阶段准确知道PCB走线对信号时延的影响变的尤为重要。本文基于仿真分析DK,串扰,过孔,蛇形绕线等因素对信号时延的影响。   1.引言   信号要能正常工作都必须满足一定的时序要求,随着信号速率升高,数字信号的发展经历了从共同步时钟到
  • 关键字: PCB  DDR  

零基础学FPGA (二十) 举一反三,基于SOPC的定时器中断与串口数据收发

  •   SOPC的课程已经结束了,短短4天,要消化的内容还真不少。今天又开始了DDR2 SDRAM的课程,其实在我来北京之前他们已经开始SDRAM的课程了,想起我做SDRAM的时候,真的是好费劲,又没人指点,代码写了一大串,前仿真也做的差不多,后仿就不行了,有些东西不知道怎么解决,还涉及到时序约束这门听起来高大上的知识,所以那段时间把我纠结的不轻。看样子在我离开北京之前这边应该是一直讲SDRAM了,上课的是李凡老师,一个很和蔼,很低调的老师,据说已经做了三四十年的工程师了,也是国内顶尖的人物了。打算这几天好好
  • 关键字: SOPC  SDRAM  

多运动物体检测与跟踪算法实现,高精度室内定位系统设计

  •   项目主要内容:   运动目标的检测与跟踪已在众多的领域得到了广泛的应用,但是由于嵌入式处理器自身的速度限制,此类应用主要集中在PC机上,相对来说,成本较高而且灵活性和移动性能不够好。将此算法应用到嵌入式系统上能有效地降低成本、提高设备的移动性和灵活性、减小设备体积,具有实际意义。   由于目前嵌入式处理器速度和处理器硬件结构的限制,常用的嵌入式微处理器(比如ARM9、XScale)很难达到实时高速检测跟踪的要求。于是为了达到高速精确检测和跟踪多运动目标的要求,综合考虑FPGA各方面的优点,本项目提
  • 关键字: SDRAM  Ethernet  
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