- 引言 锁相环(PLL: Phase-locked loops)是一种利用反馈控制原理实现的频率及相位的同步技术，其作用是将电路输出的时钟与其外部的参考时钟保持同步。随着集成电路加工中功能器件的尺寸缩小，器件电源电压也呈下降
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VCO 方案
- 环路滤波器具有低通特性,它可以起到图1-5(a)中低通滤波器的作用,更重要的是它对环路参数调整起着决定性的作 ...
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pll 环路 滤波器
- 拥有模拟和数字领域的优势技术、提供领先的混合信号半导体解决方案的供应商 IDT® 公司(Integrated Device Technology, Inc.; NASDAQ: IDTI) 面向便携应用推出全球首款集成可编程时钟发生器的音频子系统。新器件通过集成，可实现占板空间的最小化、降低系统成本，同时由于无需长货期的外部晶体和振荡器，缩短产品上市时间。
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IDT 音频 PLL
- 基于DDS+PLL技术的频率合成器的设计,摘要：介绍了一种频率合成技术的设计与实现，基于DDS与PLL的技术产生高频信号频率。该频率合成器由高性能DDS芯片AD9852与锁相环芯片ADF4360-7构成。该方案控制简单、编程灵活、可靠性高，且产生的信号具有输出频率高
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合成器 设计 频率 技术 DDS PLL 基于
- Analog Devices, Inc. (ADI)，全球领先的高性能信号处理解决方案和 RF IC 供应商，最近推出一款用于无线通信系统的 PLL（锁相环）频率合成器 ADF4351，它实现了集成度、性能、灵活性与频率范围的业界最佳组合。就单个 RF器件而言，它支持最宽的连续频率范围。
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ADI PLL
- 摘要：研究了一种基于以太网物理层时钟同步的高带宽低噪声压控振荡器(VCO)，该VCO采用交叉耦合的电流饥饿型环形振荡器，通过级联11级环路电路和改善其控制电压变换电路，优化了VCO的输出频率范围以及降低了输出时钟的
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PLL VCO 设计 同步 时钟 以太网 物理 用于
- 随着科学技术的发展，通信、测量等各个领域对信号源的要求越来越高，高速任意波形发生器成为市场的热点。高速DAC作为任意波形发生器的关键部分，其性能对高速信号有着极大的影响。AD9779A是目前国内能买到的性能较
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频带 优化 PLL 配置 寄存器 AD9779A
- 经常有要阻挡某些频率信号的情况，其中最常见的是50Hz或60Hz的电力线工频。图1中的PLL陷波滤波器可以用于阻拦不需要的频率。IC1 LM567C是一只音调解码器。C1、R1A和R1B等元件决定了IC1探测的频率F：F=1/[C1(R1A
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需要 频率 阻拦 用于 滤波器 PLL
- 电路设计、噪声分析及仿真
ADF4108主要由一个低噪声数字鉴相器(PDF)、一个精密电荷泵、一个可编程参考分频器、可编程A(6bit)及B(13bit)分频计数器和一个双模分频器(P/P+1)构成。在这里，随模式控制高、低电平的不同，双模分频器采用两个不同的分频模数P+1和P。双模分频器的输出同时驱动两个可编程分频器，他们分别预置在A和B(A<B)，并进行减计数。在除A和除B分频器未计数到零时，模式控制为高电平，双模分频器输出频率为f0/(p+1)。在输入A(P+1)个周期之后，除A分频
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分频器 VCO ADF4108
- 不管是放到测试设置中，还是作为被测设备的一部分，时钟恢复都在进行准确的测试测量时发挥着重要作用。由于...
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PLL 时钟恢复 测试测量
- 1 引言 频率源是现代射频和微波电子系统的心脏,其性能直接影响整个电子系统的功能，成为非常重要的部件。 频率源分为二大类：自激振荡源和合成频率源。常见的自激振荡源有晶体振荡器、腔体振荡器、介质振荡器、
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PLL 合成 频率源
- VCO电路的设计VCO电路为使用上章的备注栏所介绍的库拉普振荡电路。将线圈与电容组合，使达到设计规格的40M~60 ...
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PLL-VCO
- 在此说明以晶体振荡器做为基准振荡器，将其与VCO以及PLL电路组合成为信号产生器的情形也被称为频率合成器。此 ...
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PLL-VCO
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