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EEPW首页 >> 主题列表 >> ip核

SoC设计IP核选择策略

  • IP核可以两种形式提供给客户:软核和硬核。两种方式都可使客户获得在功能上经过验证的设计。软核也被称为可综合内核,需要由客户进行综合并在其SoC上实现。而硬核已完全实现(完成了版图设计),可直接用于制造。(从技术上说,一种设计只有生产后才能实现。但是在此情况下,实现的意思是指安排布局并可直接投入生产)。SoC团队只需将硬核像一个单片集成电路片那样置入芯片即可。软核和硬核具有不同的问题和好处。
  • 关键字: 技术支持  IP核  定制  

基于USB2.0和DDR2 SDRAM IP核的数据采集系统设计与实现

  • 本文设计的高速数据采集系统是应用于芯片现场测试的实时数据采集系统,由于被测试芯片为250 MHz 8 bit的高速AD输出, 因此, 该数据采集系统的数据采集率是2 Gbps。为了达到实时、高速、海量的数据采集, 该系统利用DDR2 SDRAM的高速数据传输能力和海量存储能力做为采集数据的缓存,然后通过具有即插即用、易扩展、传输速率较高等特点的USB2.0接口来将DDR2 SDRAM中的数据传输到计算机中进行存储和分析。
  • 关键字: 乒乓缓存  数据采集  IP核  

基于SoPC架构的四通道SSI通信控制器

  • 采用VHDL硬件描述语言,以Xilinx公司的FPGA为设计平台,设计实现了以开源软核MC8051为核心的控制单元,控制4路SSI协议模块的SoPC架构的通信控制器,并对通信控制器进行了功能仿真与验证。该控制器可灵活进行IP核模块扩展,并可作为外围处理机与TI公司TMS320C6000系列DSP进行互连通信,将慢速串行通信任务进行分离,从而减轻DSP的负担,提高系统的整体性能。
  • 关键字: IP核  同步串行接口协议  SoPC架构  

3-DES IP核的VerilogHDL设计

  • 首先介绍了3-DES算法的加密/解密原理,在此基础上,采用流水线技术,设计了一种高速的3-DES加/解密IP核,并用VerilogHDL语言描述其中的各个模块。
  • 关键字: IP核  流水线技术  VerilogHDL  DES加/解密  

基于Nios II的过程控制实验装置的研究

  • 利用SOPC强大的IP核和容易配置的优势简化设计流程。充分发挥NiosⅡ强大的并行处理能力。该系统主要涉及多个下位机与FPGA的通信问题。
  • 关键字: SOPC  IP核  NiosII  

MCUUSB设备控制器IP核的设计

  • 本论文针对USB1.1 协议规范,本着自主开发USB控制芯片,把MCU 和USB 设备控制器用软核的形式集成在一块芯片上,微控制器我们是用14 位指令字长度,且是单字节指令和单周期指令,其核心指令只有 39 条,容易掌握和设计,而且完全满足总体设计的要求。
  • 关键字: USB控制芯片  IP核  MCU  

基于FPGA 的二维提升小波变换IP核设计

  • 提出了一种高效并行的二维离散提升小波(DWT)变换结构,该结构只需要7 行数据缓存,即可实现行和列方向同时进行滤波变换。
  • 关键字: 小波变换  数据缓存  FPGA  IP核  

面积优先的分组密码算法SMS4 IP核设计

  • 对新分组密码算法SMS4进行了FPGA实现。所设计的SMS4算法的IP核主要包括具有加解密功能的非流水线式数据通路和实时产生子密钥的密钥扩展模块,并且支持电子密码本(ECB)和分组链接(CBC)两种工作模式。提出了一种不含密钥初始化的运行模式,使解密吞吐率提高近一倍。
  • 关键字: 分组密码  IP核  FPGA  

基于Avalon-ST接口帧读取IP核的设计和应用

  • 研究基于Avalon-ST接口帧读取的IP核设计应用,通过Avalon-ST接口将外部存储中不同格式的帧数据转化为视频流输出。根据Avalon总线协议及Avalon-ST视频协议研究设计方案,使用Verilog HDL语言对模块进行硬件设计,并将实现的模块进行测试。
  • 关键字: Avalon-ST  IP核  Verilog  

有功电能计量IP核的设计

  • 对有功电能计量的数学模型进行了分析,给出了相应的IP核实现模型,并详细讨论了CIC抽取滤波器、IIR高通滤波器、FIR低通滤波器、数字频率变换等模块的原理与设计。
  • 关键字: 有功电能  CycloneII  IP核  

基于FPGA的二-十进制转码器设计

  • 针对二进制转十进制(BCD)转码器的FPGA实现目标,提出了一种高效、易于重构的转码器设计方案。并在FPGA开发板上成功地实现了该设计。
  • 关键字: BCD转码器  IP核  路径延迟  

FPGA并行计算抽象接口的设计与实现

  • 本设计为基于C语言开发的程序开发了一个FPGA的并行计算接口,凡是以C语言设计的程序,均可通过调用本设计的接口,把复杂的算法、数值处理交给FPGA芯片完成,在不需要程序员学习FPGA知识以及使用FPGA开发工具的前提下,大大地减轻CPU的负荷以及从根本上提高了程序的执行效率,是FPGA并行化应用的一次全新尝试。
  • 关键字: IP核  调度模块  FPGA  PCI设备驱动  Express总线  

基于FPGA的3D图像处理器IP核的实现

  • LCD显示屏的应用越来越广,数量越来越多。LCD显示屏应用广泛,无处不在。如家庭各种电器设备。更常见是用于各种公共场合如体育馆、广场等商业用途。给我们传递一种更为直观、生动的信息。从此我们的生活发生了巨大改变。巨大的应用巨大的市场带来了巨大的商机。基于FPGA的LCD显示的3D影像是为了LCD显示屏的信息量更多,满足人需求。
  • 关键字: IP核  3D图像处理器  FPGA  LCD  Verilog  

基于FPGA的信息安全系统设计

  • 本模块采用xilinx公司的Spartan 3E系列XC3S500E型FPGA作为核心控制芯片,对采集到底模拟信号进行数字转换后通过3DES算法进行加密、然后通过网络传输,再经过解密算法解密出明文数据。
  • 关键字: 信息安全系统  RAM  IP核  FPGA  乒乓操作  

基于Altera浮点IP核实现浮点矩阵相乘运算的改进设计

  • 嵌入式计算作为新一代计算系统的高效运行方式,应用于多个高性能领域,如阵列信号处理、核武器模拟、计算流体动力学等。在这些科学计算中,需要大量的浮点矩阵运算。而目前已实现的浮点矩阵运算是直接使用VHDL语言编
  • 关键字: Altera  浮点  IP核  点矩阵    
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ip核介绍

IP核概述   IP核则是一段具有特定电路功能的硬件描述语言程序,该程序与集成电路工艺无关,可以移植到不同的半导体工艺中去生产集成电路芯片。利用IP核设计电子系统,引用方便,修改基本元件的功能容易。具有复杂功能和商业价值的IP核一般具有知识产权,尽管IP核的市场活动还不规范,但是仍有许多集成电路设计公司从事IP核的设计、开发和营销工作。IP核有两种,与工艺无关的VHDL程序称为软核;具有特定电路 [ 查看详细 ]

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