1 引 言
相控阵是通过波控系统控制阵列天线各单元通道的相位、幅度以形成空间波束并控制其方位角和俯仰角。早期的波控系统一般采用硬件电路来实现，这种实现方法的缺点是设备量大，不灵活，很难实现波束的复杂计算，不易满足特殊要求。后来采用单片机、DSP芯片来设计波控系统，单片机通常不计算波控码，仅仅是根据接收到的波控码布相，而DSP可以自己计算波控码，但是单片机、DSP都是象流水线一样串行的运行指令，也就是说，不能并行地对各天线单元通道进行波控码计算和布相。
针对波控系统要求高速计算、多通道并行逻
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以太网 接口 天线 FPGA
半导体调研机构Gartner多年来一直在跟踪ASIC设计项目数量，其趋势已经无疑被认定向下。最新技术的ASIC设计费用已经上升到一个很高点，以致许多中小规模的公司用不起而只能采用FPGA。而ASIC只有依靠正在研发的各种降低其设计费用的新方法才有希望挽回颓势。
拥有独特的过孔层布线定制专利技术以及零掩模费和无最低订货量限制的新结构化ASIC平台供应商eASIC在其90nm Nextreme ASIC产品的基础上，又发布了其新一代Nextreme-2系列产品。Nextreme-2系列是目前市面上唯
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ASIC FPGA 信号处理 富士通
Altera公司今天公布了其亚太区年度SOPC World大会的时间和地点。大会将于2008年10月在印度和中国的5个城市举办。
大会包括技术研讨和展览两部分，系统设计人员通过此次大会来将了解到怎样降低系统成本，并满足严格的功耗预算要求，提高效能。在技术研讨会上，Altera及其合作伙伴将为出席人员介绍最先进的高功效可编程器件以及高效能开发工具等。
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Altera FPGA SOPC
目前，越来越多的FPGA设计开始采用嵌入式处理器，如PowerPC和赛灵思(Xilinx)的MicroBlaze处理器来完成控制任务，...
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FPGA 嵌入式 处理器 除错率 赛灵思
电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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DSP FPGA FIR QuartusⅡ
“电子产品需求持续变化，只给制造商两条出路――Differentiate or Die (要么追求差异化，要么关门消亡！)这给可编程器件带来了巨大的发展机遇！”8月28日，年初走马上任的Xilinx总裁兼CEO Moshe Gavrielov首次接受中国媒体的采访，透露了Xilinx新的发展策略，概括起来就是三“新”：新架构、新思路、新服务。
Moshe曾经供职于NSC、LSI、Cadence等公司，从微处理器芯片、ASIC芯片、EDA软件再到可编
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处理器 EDA FPGA Xilinx PLD Moshe
1 引 言
在雷达及声纳信号处理系统中，波束形成算法通常采用DSP软件编程实现，控制逻辑电路采用CPLD来完成，这种方法具有软件编程灵活、功能易于扩展的优点，但对于实时性能要求很高的系统，如雷达、声纳探测和超声成像等系统中为了提高对目标变化实时跟踪和测量，就必须尽量缩短信号处理的时间，过长的运算处理时间会对水下目标的探测性能产生较大的影响。声纳工作环境中总存在着各种干扰(例如本舰辐射噪声、近场其他船只的干扰等)，普通波束形成系统是一种预形成波束系统，当他处在各向同性、均匀韵噪声场时，可能具有相当
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FPGA 芯片 自适应 BDF
对于服务提供者，影响无线接入盈利的主要因素是网络的成本。演进的基础设施支持不断扩大的用户基站，在设施的维护和改进过程中，服务提供者控制网络的成本变得越来越重要了。
开放式基站结构发起组织(OBSAI)
无线原始设备制造商（成员为Hyundai、LGE、Nokia、Samsung和 ZTE ）建立了开放式基站结构发起组织(OBSAI)，针对收发基地站收发信机(BTS)的配置和互连，从一组通用模块中开发了一组规范。由另外一些无线原始设备制造商（成员为Ericsson、Huawei、NEC、No
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FPGA OBSAI 无线网络 基站
介绍了一种采用FPGA设计的SDH设备时钟的构成及设计原理；并给出了相关的测试结果；测试结果表明该SDH设备时钟完全满足ITU-T G.813建议规范的各项时钟指标要求。
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FPGA SDH 设备 时钟
FSK(Frequeney-ShiftKeying，频移键控)是用不同频率的载波来传送数字信号。FSK信号具有抗干扰能力强、传输距...
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FPGA 调制解调器
引言DFT(DiscreteFourierTransformation)是数字信号分析与处理如图形、语音及图像等领域的重要变换工...
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FFT FPGA
近年来，随着经济的高速增长，无线通信得到了飞速地发展。由于扩展频谱信号具有抗干扰、保密、抗侦破和抗衰落等特点，扩频通信在军事无线通信领域（如测控通信）中被广泛应用；随着技术的成熟及成本的降低，其在民用通信市场上具有更广大的发展前景。
本文首先介绍了FPGA的设计思想及流程，然后以一种扩频通信调制器为例，描述了如何实现自顶向下的设计：包括调制器的顶层设计、划分的下一层基本单元的设计等，并重点分析了基本单元之一的PN码产生器的设计实现及仿真验证过程。
FPGA设计方法简介
FPGA技术的
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FPGA 扩频调 制器 PN码 仿真
赛灵思公司（Xilinx, Inc. (NASDAQ: XLNX) ）今天宣布，作为Spartan-3A FPGA 系列平台延伸的小封装FPGA正式量产。这些小封装FPGA在提供突破性价位的同时，针对消费、有线和无线通信、网络、工业以及其它许多成本敏感的应用领域，可以大大降低系统总体成本。
除了更多封装可供选择以外，Spartan-3A FPGA 延伸平台还提供了从5万门到340万系统门的更广泛的器件密度范围以及电源管理功能，可帮助设计人员尽量减少电路板上的元器件数量并提供低成本复杂计算和嵌入式
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Xilinx FPGA Spartan-3A
美国国家仪器有限公司（National Instruments，简称NI）近日发布全新的NI Single-Board RIO设备，可为工程师及科学家在发布嵌入式控制及数据采集应用时提供低成本的集成硬件选项。8款全新sbRIO-96xx设备在一块印刷电路板（PCB）上集成了嵌入式实时处理器、现场可编程门阵列（FPGA）、模拟和数字I/O，对于需要在小体积上实现灵活、高性能、高可靠性的应用是理想的选择。工程师及科学家可通过NI LabVIEW 图形化系统设计平台来自定义Single-Board RIO硬
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NI 嵌入式 数据采集 RIO FPGA
1 引言
在一些需要特殊运算的应用电路中，只读存储器ROM是关键元件，设计人员通常利用ROM创建各种查找表，从而简化电路设计，提高电路的处理速度和稳定性。FPGA是基于SRAM的可编程器件。掉电后FPGA上的配置信息将全部丢失，所以由FPGA构造的数字系统在每次上电后要依赖于外部存储器来主动配置或在线被动配置。真正意义上的ROM应具有掉电后信息不丢失的特性，因此利用FPGA实现的ROM只能认为器件处于用户状态时具备ROM功能。使用时不必要刻意划分，而ROM单元的初始化则是设计人员必须面对的问题。
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FPGA ROM mit文件 SRAM
fpga介绍
FPGA是英文Field－Programmable Gate Array的缩写，即现场可编程门阵列，它是在PAL、GAL、EPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。
FPGA采用了逻辑单元阵列LCA（Logic Cell Array）这样一个新概念，内部包括可 [
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