摘要：首先对采用SRAM工艺的FPGA的保密性和加密方法进行原理分析，然后提出一种实用的采用单片机产生长伪随机码实现加密的方法，并详细介绍具体的电路和程序。
关键词：静态随机存储器（SRAM） 现场可编程门阵列（FPGA） 加密
在现代电子系统设计中，由于可编程逻辑器件的卓越性能、灵活方便的可升级特性，而得到了广泛的应用。由于大规模高密度可编程逻辑器件多采用SRAM工艺，要求每次上电，对FPGA器件进行重配置，这就使得可以通过监视配置的位数据流，进行克隆
关键字：
静态随机存储器（SRAM） 现场可编程门阵列（FPGA） 加密 MCU和嵌入式微处理器
1 引言
随着EDA技术的发展及大规模可编程逻辑器件CPLD／FPGA的出现，电子系统的设计技术和工具发生了巨大的变化，通过EDA技术对CPLD／FP-GA编程开发产品，不仅成本低、周期短、可靠性高，而且可随时在系统中修改其逻辑功能。本文介绍了一种以Altera公司可编程逻辑器件EP1K30TC144-3为控制核心，附加一定外围电路组成的出租车计费器系统。
2 系统总体结构
基于CPLD的出租车计费器的组成如图1所示。各部分主要功能包括：信号输入模块对车轮传感器传送的脉冲信号进行计数(
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嵌入式系统 单片机 CPLD FPGA 计费器 嵌入式
利用Verilog HDL 硬件描述语言自顶向下的设计方法和QuartusⅡ 软件，在复杂的可编程逻辑器件(FPGA, Field Programmable Gate Array)中实现了发电机组频率测量计的设
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FPGA 发电机组 测量计 频率
引言
本文采用FPGA实现了IDE硬盘接口协议。系统提供两套符合ATA-6规范的IDE接口，一个与普通IDE硬盘连接，另一个与计算机主板上的IDE接口相连。系统采用FPGA实现接口协议，完成接口数据的截获、处理（在本文中主要是数据加密）和转发，支持PIO和Ultra DMA两种数据传输模式。下面重点介绍用FPGA实现接口协议的方法。
1 IDE接口协议简介
1.1 IDE接口引脚定义
IDE（Integrated Drive Electronics）即“电子集成驱动器”，又称为A
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嵌入式系统 单片机 FPGA IDE硬盘 ATA-6 嵌入式
Actel 公司宣布专业从事视频增强技术的瑞典LYYN AB公司已经利用Actel的ProASIC3系列现场可编程门阵列 (FPGA) 器件开发出软件和硬件视频处理平台，此举进一步显示了低功耗单芯片FPGA技术所具备的先进创新性。这个解决方案提高了视频录像的清晰度，可在雪、雾、水底淤泥和黑暗环境中提供更好的可见度。LYYN的产品主要用于遥控操作车辆 (ROV) 和飞机 (UAV) 以及便携式设备如水底摄像机和先进的监视系统等。
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嵌入式系统 单片机 Actel FPGA LYYN 嵌入式
北京艾科瑞德科技有限公司日前宣布推出面向软件无线电（Software Defined Radio,SDR）应用的解决方案—FFT-SDR-V4。由于采用了美国德州仪器公司（Texas Instruments，简称“TI”）最高运算能力的DSP（TMS320C6416, 1G）和Xinlinx高容量的FPGA (2000万门)，解决了软件无线电发展中的瓶颈技术—信号处理的运算能力问题。 所谓软件无线电，就是采用数字信号处理技术，在可编程控制的通用硬件平台上，利用软件来定义实现无线电台的各部分功能：包括
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艾科瑞德 DSP FPGA 无线电 嵌入式 消费电子
直接数字合成器，是采用数字技术的一种新型频率合成技术，他通过控制频率、相位增量的步长，产生各种不同频率的信号。他具有一系列的优点；较高的频率分辨率；可以实现快速的频率切换；在频率改变时能够保持相位的连续；很容易实现频率、相位和幅度的数控调制等。目前可采用专用芯片或可编程逻辑芯片实现DDS[1]，专用的DDS芯片产生的信号波形、功能和控制方式固定，常不能满足具体需要[2]。可编程逻辑器件具有器件规模大、工作速度快及可编程的硬件特点，并且开发周期短，易于升级，因为非常适合用于实现DDS。
1 DDS的
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嵌入式系统 单片机 DSP Builder DDS FPGA 嵌入式
引言
低密度奇偶校验（Low Density Parity Check Code，LDPC）码是一类具有稀疏校验矩阵的线性分组码，不仅有逼近Shannon限的良好性能，而且译码复杂度较低, 结构灵活，是近年信道编码领域的研究热点，目前已广泛应用于深空通信、光纤通信、卫星数字视频和音频广播等领域。LDPC码已成为第四代通信系统(4G)强有力的竞争者，而基于LDPC码的编码方案已经被下一代卫星数字视频广播标准DVB-S2采纳。
编码器实现指标分析
作为前向纠错系统的重要部分，设计高速率低复
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嵌入式系统 单片机 LDPC FPGA 奇偶校验 嵌入式
摘 要：针对传统Otsu局部递归分割方法很难实时实现的局限性，提出了一种适合现场可编程门阵列(FPGA)中Nios II软核处理器实现的快速Otsu局部递归分割算法，该算法的思路是把一次Otsu分割得到的目标区域作为新的图像再进行一次Otsu分割，得到的结果作为最终分割阈值．利用并行Nios II和VHDL实现的硬件加速逻辑协同设计保证算法的实时实现。实验结果表明，在不同的背景下，利用本文设计能够实时稳定地对目标分割提取，具有较好的鲁棒性。 关键字：FPGA&nb
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嵌入式系统 单片机 FPGA Nios II 0tsu分割 局部递归 嵌入式
摘要：本文设计了一个以FPGA为核心处理器实现红外视频图像数字预处理的系统，利用Altera公司提供的DE2开发板，把系统大部分的功能模块集成在一片FPGA 上，大大优化了整个系统的性能。该方案采用Altera公司推出的低成本、高密度的Cyclone Ⅱ系列FPGA，提高了系统的设计灵活性。细胞神经网络IP核的开发，充分利用了细胞神经网络在图像处理方面的优势，提高了整个系统的处理效率。实现了细胞神经网络的一种高效数字实现方案,并且采用分布式算法可以提供更高的运行速度。 关键词 边缘检测；细胞神经网络；FP
关键字：
消费电子 边缘检测 细胞神经网络 FPGA 嵌入式 消费电子
1 引 言
卫星移动通信系统所能提供的业务的可行性与质量在很大程度上受到卫星与移动终端间信道特性的影响。研究这些影响，就需要在一定传播特性下进行实验。由于条件所限，不可能进行实时现场实验，这在技术和经费上都存在问题，所以采用一个能反映实际星地链路特性的信道模拟系统可以降低一些难度太大和成本超高的测试试验的难度和成本，是一个很好的解决方法。
1.1 国内外的研究状况
目前有很多科研机构和高校进行这方面的研究，例如：澳大利亚南澳大学研制出移动卫星信道模拟器MSCS-1，该模拟器具有记录和重
关键字：
嵌入式系统 单片机 FPGA 模拟系统 卫星 嵌入式
Altera宣布，Silicon视频系统(SVS)公司选用了低成本、低功耗Cyclone® III FPGA来生产市场上最紧凑的高性价比多画面产品。多画面产品用于专业音频/视频、安全监控和广播监视等需要多幅图像显示处理的应用中。 在新的SVS多画面产品中，Cyclone III FPGA实现了色彩空间转换、FIFO、时钟转换，支持所有的显示分辨率。在以前的多画面产品中，实现这些功能需要采用多个分立器件。 作为Altera® Cycl
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消费电子 SVS FPGA 视频系统 消费电子
在现代电子系统设计中，由于可编程逻辑器件的卓越性能、灵活方便的可升级特性，而得到了广泛的应用。由于大规模高密度可编程逻辑器件多采用SRAM工艺，要求每次上电，对FPGA器件进行重配置，这就使得可以通过监视配置的位数据流，进行克隆设计。因此，在关键、核心设备中，必须采用加密技术保护设计者的知识产权。 1 基于SRAM工艺FPGA的保密性问题 通常，采用SRAM工艺的
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嵌入式系统 单片机 SRAM FPGA 加密 嵌入式
在CDMA通信系统中，用于基站信号转发的接收机是一个核心模块，一台接收机只是处理一路用户的解扩解调显然是不合理的，为了提高接收机的效率和降低成本，有必要设计一种多路CDMA信号通用解扩解调平台。而FPGA具有功能强大，开发工程投资小，周期短，可反复编程修改，保密性能好，开发工具智能化等优点，本项目决定采用FPGA作为设计平台；本文首先建立了CDMA信号的扩频调制与解扩解调系统模型，然后提出设计这样一个多路CDMA信号通用解扩解调平台。该平台将保证处理CDMA解扩解调的
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通讯 无线 网络 嵌入式系统 单片机 FPGA DS/CDMA 无线 通信
fpga：quartusⅡ介绍
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