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主从触发器(master-slave flip-flop)基本原理

图13-11(a)所示为主从RS触发器原理电路。它是由两个高电平触发方式的同步RS触发器构成。其中门E、F、G、H构成主触发器，时钟信号为CP，输出为Q、，输入为R、S。门A、B、C、D构成从触发器，时钟信号为，输入为主触发器
关键字：基本原理 flip-flop master-slave 触发器主从

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flip-flop介绍

触发器（学名双稳态多谐振荡器，台湾译作正反器)(bistable multivibrator, flip-flop)在电子学里，可应用在数字电路上，是循序逻辑元器件的其中一类。其线路图由逻辑门组合而成，可记录“1”和“0”数据，其结构均由SR锁存器派生而来。在一个触发器里，所包括的有“0”、“1”、输入/输出信号和时钟频率。 [ 查看详细 ]

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