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利用SmartCompile和赛灵思的设计工具进行设计保存(07-100)

  •   在FPGA环境下,设计保存实施比较复杂,需要保存的事项包括:一项设计的HDL描述、一个模块的综合网表、约束文件内的布局信息,以及在局部比特文件中的配置数据。赛灵思集成软件环境ISE 9.1i 软件以新的SmartCompile 技术为特色,其中包含两种新的方法:SmartGuide和Partitions,这两种方法可以保存像布局或布线这样的设计执行数据,并且可以减少解决问题所花费的时间。   SmartGuide采用命名和拓朴匹配技术来识别一个FPGA设计中相对于以前的实现还没有发生改变的各个部分。
  • 关键字: 赛灵思  SmartCompile  
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